hbox-docs: T45 terminado con T45r (2ada724); instrucciones de Michelle v1.3 con las figuras de T45r
Co-Authored-By: Claude Opus 5.5 <noreply@anthropic.com> Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx
This commit is contained in:
parent
77ff8185c1
commit
b1ffc885d4
@ -4,8 +4,8 @@ tags: [project-drogheda, hardware, hbox, einarboard, v6, layout, pcb, michelle,
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project: Project Drogheda
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author: "Helgen Technologies (redacción: Claude; decide: Leo)"
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date: 2026-10-27
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version: 1.2
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status: "ACTIVO — v6 en HBox_PCB 15b956e: esquemático con T48, T49 y T41; el PCB es tu 9a6f250 del 26-oct. Leo decidió el 27-oct, 13:06: D-26-1 (a) y D-22-4 (b). 27-oct, 14:30: T45 listo y probado en una copia (R80 pasa abajo de Q7); la RF LTE pasa a T45b, el jueves 30"
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version: 1.3
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status: "ACTIVO — 28-oct, 12:20: T45 terminado (tú a mano + T45r, HBox_PCB fb95d15). Haz git pull --ff-only y presiona B; sigue el bloque B y R112 (§2) para el miércoles 29. T45b el jueves 30 sobre tu commit del bloque B"
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audience: "Michelle (layout de la v6), Leo"
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@ -13,7 +13,13 @@ audience: "Michelle (layout de la v6), Leo"
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**Michelle:** esta semana trabajas **solo la v6** (`hbox-watchdog-v6.kicad_pcb`). La V5.6 y la V5.7 ya quedaron listas para el pedido del piloto: **no las abras**.
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Lo que cambió desde tu commit del lunes (`9a6f250`):
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!!! success "28-oct, 12:20: T45 terminado (HBox_PCB `fb95d15`). Ya puedes abrir la v6"
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- Hiciste a mano casi todo T45 en `f1c8879`: R80 abajo de Q7, `/VEH5V` por F.Cu, `/MAIN5V` de JP5 y R85 desde Q7.5 y las 6 vías del EP de U4. Por eso el script de T45 se detuvo sin escribir: así está hecho, no escribe sobre un PCB que cambió.
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- **T45r** hizo lo que faltaba sobre tu `235150b`: la **toma CLN** ahora sale de R80.2 por adentro (antes salía de la barra S de Q7 y el límite de entrada quedaba ≈ 8 % abajo), la **toma VIN** sale de la esquina de adentro de R80.1, **6 vías en el EP de U7**, `/VEH5V` de 2.0 mm de C100 a C101 y fuera los 7 colgantes. El detalle y las figuras, en el §2.
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- DRC: **0 errores, 0 sin conectar, paridad limpia y 0 colgantes.** De L5.2 a R80.1 quedan ≈ 5 mΩ (antes 31).
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- **Antes de seguir:** `git pull --ff-only` y **B** (rellenar zonas): T45r no guardó el relleno. Luego, el bloque B y R112 (§2), con las mismas fechas.
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Lo que cambió el 27-oct, desde tu commit del lunes (`9a6f250`):
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- **Claude revisó tu trabajo del fin de semana** ([revisión del 26-oct](v6-revision-26oct.md)). El DRC dio 0 errores y en el bloque B hay buen avance. Hay una regresión (la toma VIN de R80) y faltan la mitad del bloque B, R112 y los bloques C, D y E. Cada pendiente ya está en el tablero con su fecha.
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- **T48 (Leo, 27-oct): una sola SIM.** La v6 se queda con la nano-SIM J11. Sale la eSIM: U13, R41, R63, R65 y R69, que de todos modos no se montaban.
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@ -48,6 +54,8 @@ Abre la v6 en KiCad 10.
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## 1. Martes 28, temprano: Actualizar PCB con T48 + T49 + T41 (≈ 1 h) · pendiente `t-v6-una-sim`
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**Hecho** (28-oct, 10:05: `a945c30` y `f1c8879`). DRC de `235150b`: 0 errores, 0 sin conectar y paridad limpia.
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@ -122,31 +130,36 @@ git push
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## 2. Después de T45 (martes 28 y miércoles 29): bloque B y R112
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**Primero:** `git pull --ff-only` (trae `fb95d15`), abre la v6 y presiona **B** (rellenar zonas). T45r no guardó el relleno: en la Mac de Leo, al guardar, KiCad redibuja con otra forma el texto «EinarBoard v6». Si al abrir lo ves distinto, avísale a Leo.
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**Qué hace T45** (`tools/t45_v6.py`, probado el 27-oct en una copia de tu `9a6f250`: DRC con 0 errores y 0 sin conectar, y la prueba de Kelvin del script pasa). Arregla la regresión de la [revisión del 26-oct, §3](v6-revision-26oct.md#3-la-regresion-la-toma-vin-de-r80):
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- **R80 se mueve** de (178.96, 103.89) a **(174.6, 108.87)**, vertical, justo abajo de Q7: el pad 2 pegado a los pines S (1–3) y el pad 1 junto a C100. Donde estaba, R80.1 quedaba encerrado por el anillo de `/MAIN5V` (Q7 → C77…C81 → U17.1/24): ninguna pista de F.Cu podía llegarle desde L5 sin cruzar `/MAIN5V`. Por eso tu ruta tenía que ir por In2.
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- **`/VEH5V`:** de C100.1 a R80.1 con 1.5 mm (el cuello entre C99.2 y R86.2 no da para más), entrando por el lado de afuera del pad. De C100 a C101 se ensancha a 2.0 mm. De L5.2 a R80.1 quedan ≈ 7 mΩ, contra 31 antes. Se borran la vía de (180.1, 103.2) y los 8 mm de In2.
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- **`/VIN_SW`:** de R80.2 a los pines S de Q7 con 2.0 mm (1.7 mm de largo). Se borra la vuelta vieja de 1.0 mm.
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- **Tomas Kelvin:** VIN y CLN salen de R80.1 y R80.2 por el lado de adentro (entre los dos pads, bajo el cuerpo), bajan por una vía a **B.Cu** con 0.25 mm y suben junto a C86 (VIN → C86/C87 → U17.6) y en (179.2, 105.5) (CLN → tu pista de 0.5 mm → U17.7). El script comprueba que ninguna de las dos toque cobre de potencia fuera de su pad.
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- **`/MAIN5V` de JP5.1 y R85.1:** la pista de y = 107.5 pasaba por el lugar nuevo de R80 y se borró. Ahora toman el 5 V de Q7.5 con **0.35 mm entre los pines 3 y 4 de Q7** (corriente de µA). Para dejarla pasar, la barra de los pines S de Q7 se acortó 0.23 mm. La vía de GND de (175.0, 108.7) se borró porque quedaba bajo R80.
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- **EP de U4 y de U7:** 6 vías de GND en cada uno, y fuera el cuello de GND de 0.25 mm de U4 (figura de abajo).
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- **Limpieza del 26-oct:** las 3 vías y las 3 pistas sueltas.
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**Cómo quedó T45** (tu `f1c8879` + T45r, `tools/t45r_v6.py`). La regresión de la [revisión del 26-oct, §3](v6-revision-26oct.md#3-la-regresion-la-toma-vin-de-r80) queda resuelta:
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- **R80** se queda donde lo pusiste, en **(174.4, 108.9)**, vertical y abajo de Q7: el pad 2 junto a los pines S y el pad 1 junto a C100.
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- **`/VEH5V`**, de L5.2 a R80.1, todo en F.Cu: 2.0 mm hasta la diagonal, 1.5 mm en la diagonal a C101, **2.0 mm de C101 a C100** (T45r ensanchó ese tramo y el remate de la diagonal, que eran de 1.5) y 1.0 mm de C100 a R80.1 (el tuyo: a 1.5 mm tocaría C99.2). Quedan ≈ 5 mΩ, contra 31 antes, ya sin la vía de (180.1, 103.2) ni el In2.
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- **`/VIN_SW`**, de R80.2 a los pines S de Q7: tu pista de 1.0 mm (1.6 mm de largo, ≈ 0.8 mΩ). Pasa la regla T15 y queda fuera de la medición: se queda así.
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- **Toma CLN (U17.7), nueva:** sale de R80.2 por el lado de adentro (0.25 mm, entre los dos pads), sube por el lado este a una **vía nueva en (175.7, 106.8)**, va por B.Cu con 0.3–0.4 mm a la vía de siempre en (179.2, 105.5) y de ahí sigue por tu pista de 0.5 mm a U17.7. Antes salía de una vía junto a los pines S de Q7: con ≈ 0.8 mΩ de cobre en serie con los 10 mΩ de R80, el límite de entrada quedaba ≈ 8 % abajo. Esa vía y su tramo de B.Cu se borraron.
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- **Toma VIN (U17.6):** sale de la esquina de adentro de R80.1 con 0.3 mm a tu vía de (175.0, 109.1) y sigue por tu ruta de B.Cu de 1.0 mm (por x = 173.8 y y = 103.7) a la vía de (179.2, 103.7) → C86/C87 → U17.6. Se cambió el tramo de 1.0 mm que salía del centro del pad, para dejar pasar la toma CLN.
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- **`/MAIN5V` de JP5.1 y R85.1:** tu pista de 0.3 mm desde Q7.5, entre los pines 3 y 4 de Q7 (corriente de µA). Se queda así.
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- **EP de U4 y de U7:** U4 con tus 6 vías; U7 con 6 vías de T45r (figura de abajo).
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- **Limpieza:** fuera las 3 vías (2 de `/24V` y 1 de `/BAT_PLUS`) y las 4 pistas colgantes (`/3V3`, `/GNSS_RTK_STAT`, `/PFI` y la nueva de `/1V8_MODEM` en (155.4, 74.5)).
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**Avisos del DRC que T45 deja a propósito:**
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Antes de escribir, T45r comprueba que ninguna de las dos tomas toque cobre de potencia fuera de su pad y que todo lo suyo quede dentro de las reglas, con 0.05 mm de sobra como mínimo.
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- 11 de ancho de pista: las tomas Kelvin, de 0.25–0.3 mm, son de `/VEH5V` y `/VIN_SW`, que son redes de 1 mm, y la pista de 0.35 mm de `/MAIN5V` a JP5.1. **No las ensanches.**
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- 8 de serigrafía: las referencias de JP5, R85, R86, R80 y C99 quedaron encima de R80 o entre sí. Las acomoda T44 al cierre.
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**Avisos del DRC que quedan a propósito:**
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- 6 de ancho de pista: las tomas Kelvin, de 0.25–0.4 mm, son de `/VEH5V` y `/VIN_SW`, que son redes de 1 mm. **No las ensanches.** De los 111 avisos de ancho, los otros 105 ya estaban; los de tus bloques se van cuando los cierres.
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- Serigrafía: los mismos 10 traslapes de antes. Los acomoda T44 al cierre.
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**Qué cambia en tu bloque B:**
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- **No muevas R80, Q7, C86, C87, C100 ni C101**, ni las vías y pistas de las tomas (las de B.Cu, entre x = 174.6 y 179.8 y entre y = 103.9 y 109.25). Si algo te estorba, avísale a Claude.
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- **No muevas R80, Q7, C86, C87, C100 ni C101, ni nada dentro del recuadro rojo de la figura:** las tomas entre los pads de R80, las vías de (175.7, 106.8) y (175.0, 109.1) y las pistas de B.Cu hasta (179.2, 105.5) y (179.2, 103.7). **Ojo:** las tomas son de la misma red que la potencia (`/VIN_SW` y `/VEH5V`). Si una pista de potencia las toca, el DRC no avisa, pero la medición deja de ser Kelvin. Si algo te estorba, avísale a Claude; con T45b, Claude vuelve a revisar las tomas sobre tu commit del bloque B.
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- El lugar viejo de R80, entre Q7, C77 y C86, quedó libre: úsalo para el polígono de `/MAIN5V` y para acercar C77–C81 a U17.1/24.
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- Cuando muevas R85/R86 a U17.18 (B6), **la rama de arriba de R85 toma el 5 V de los capacitores de VSYS**, como dice el plan; JP5.1 se queda con su pista de 0.35 mm. Con R86 fuera de ahí, el cuello de `/VEH5V` de 1.5 mm junto a C99.2 se puede ensanchar a 2 mm (opcional).
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- B2 ya queda: Q7 pegado a R80 y `/VIN_SW` de 2.0 mm.
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- Cuando muevas R85/R86 a U17.18 (B6), **la rama de arriba de R85 toma el 5 V de los capacitores de VSYS**, como dice el plan; JP5.1 se queda con su pista de 0.3 mm.
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- B2 ya queda: Q7 pegado a R80 y `/VIN_SW` de 1.0 mm.
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| Pendiente | Qué | Listo cuando | Vence |
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@ -161,13 +174,13 @@ Commits: `v6 bloque B: …` y `v6 bloque A: R112`. Súbelos **el miércoles 29 e
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Están en el [plan de fines de semana, §4](v6-plan-fines-de-semana.md#4-domingo-25-bloques-c-d-y-e-modem-gnss-y-ethernet).
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**Jueves 30, temprano: Claude corre T45b** sobre tu commit del miércoles. Lleva la RF LTE por F.Cu (U6.60 → C19/R9 → C5 → D8 → J8) con su cerca de vías y hace el tramo de `/VBAT_MODEM` de C13 a los pines 55–57 con el cruce por B.Cu que pide el plan (§4.1, punto 3); si hace falta, recorre C14 o C15. Mientras corre, no abras la v6; luego `git pull`. Las vías de los EP ya las puso T45.
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**Jueves 30, temprano: Claude corre T45b** sobre tu commit del miércoles. Lleva la RF LTE por F.Cu (U6.60 → C19/R9 → C5 → D8 → J8) con su cerca de vías y hace el tramo de `/VBAT_MODEM` de C13 a los pines 55–57 con el cruce por B.Cu que pide el plan (§4.1, punto 3); si hace falta, recorre C14 o C15. Mientras corre, no abras la v6; luego `git pull`. Las vías de los EP ya están (las de U4, tuyas; las de U7, de T45r). En la misma corrida, Claude vuelve a revisar las tomas Kelvin de R80.
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| Pendiente | Qué te toca | Vence |
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| `t-v6-c-modem` | C44/C34 a ≤ 3 mm y C52 junto a U4.2. R28/R27 a ≤ 2 mm de U4.5, con el nodo FB corto. `/VBAT_MODEM` como polígono de ≥ 3 mm **de L1.2 a C13**; de C13 a los pines 55/56/57, con C14–C18, lo deja T45b. C4 a ≤ 3 mm de L1.2. TP5 a 2.54 mm de TP6. **No toques la RF LTE, su cerca de vías ni C14–C18** (T45b) | 31-oct |
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| `t-v6-d-gnss` | C70 a ≤ 2 mm de U25.1. `/ANT_BIAS` a ≥ 1 mm de la RF. `/SW_IN` y `/SW_5V` fuera de In1 (la opción del plan: F1 junto a Q11). TP9 junto a U18.49 | 31-oct |
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| `t-v6-e-eth` | U7: D12 a ≤ 2 mm del pin 1, L2 a ≤ 5 mm y `/ETH_FB` de ≤ 5 mm en F.Cu. Las 6 vías del EP ya las puso T45 | 31-oct |
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| `t-v6-e-eth` | U7: D12 a ≤ 2 mm del pin 1, L2 a ≤ 5 mm y `/ETH_FB` de ≤ 5 mm en F.Cu. Las 6 vías del EP ya están (T45r) | 31-oct |
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Cierre (plan §4.4): DRC con 0 errores y 0 sin conectar; `/RF_LTE` y `/RF_ANT_LTE` solo en F.Cu, sin vías y con In1 sólido debajo; EP de U4 y de U7 con 6 vías cada uno; J8 y J13 con 2 vías por pad de tierra. Commit: `v6 bloques C + D + E`.
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@ -185,8 +198,10 @@ Del [plan, §6 y §7](v6-plan-fines-de-semana.md#6-sabado-31-bloques-f-g-y-h1-pa
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Escríbele a Leo con el commit, el designador y la coordenada, y una captura. Si una regla de aquí choca con otra, avisa antes de decidir: puede ser un error de estas instrucciones.
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*Coordenadas y conteos sacados del PCB `9a6f250` y del esquemático `15b956e`, con scripts que simulan lo que borra Actualizar PCB y buscan los extremos de pista sin conexión, igual que KiCad: extremo dentro de otra pista de la misma capa, de una vía, de un pad o del relleno de una zona de su red. Los lugares de D18–D20 se revisaron contra los pads, pistas y vías de alrededor. Las figuras salen del mismo PCB.*
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*Coordenadas y conteos sacados del PCB `9a6f250` y del esquemático `15b956e`, con scripts que simulan lo que borra Actualizar PCB y buscan los extremos de pista sin conexión, igual que KiCad: extremo dentro de otra pista de la misma capa, de una vía, de un pad o del relleno de una zona de su red. Los lugares de D18–D20 se revisaron contra los pads, pistas y vías de alrededor. Las figuras salen del mismo PCB. El §2 (v1.3) sale del PCB `fb95d15`, con los mismos scripts.*
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*v1.1 (27-oct, 13:30): decisiones de Leo de las 13:06 (D-26-1 a, D-22-4 b), T41 en el §1, T45 en vez del regreso de `/VEH5V` y la limpieza.*
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*v1.2 (27-oct, 14:30): T45 listo y probado en una copia (R80 abajo de Q7, tomas Kelvin por B.Cu, EP de U4 y U7, limpieza), con sus dos figuras en el §2. La RF LTE y el tramo de `/VBAT_MODEM` de C13 a los pines pasan a T45b, el jueves 30.*
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*v1.3 (28-oct, 12:45): T45 terminado. Hiciste a mano casi todo y T45r (`fb95d15`) hizo el resto: toma CLN Kelvin desde R80.2, toma VIN desde la esquina de adentro de R80.1, EP de U7, `/VEH5V` de 2.0 mm de C100 a C101 y la limpieza. El §2 dice cómo quedó, con figuras nuevas y el recuadro de lo que no se mueve; antes de seguir, `git pull` y B.*
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Binary file not shown.
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After Width: | Height: | Size: 162 KiB |
Binary file not shown.
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After Width: | Height: | Size: 443 KiB |
@ -1 +1 @@
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Subproject commit 1e63a7c7383c7235fcb2aa46ff7fab4edbaaa1ae
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Subproject commit 2ada72498a7b7a06526c6970ba8227cfaa401849
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