From 056437d8138c815a228fee651b002142882eede6 Mon Sep 17 00:00:00 2001 From: =?UTF-8?q?Leopoldo=20Rodr=C3=ADguez?= Date: Mon, 26 Oct 2026 23:52:56 -0600 Subject: [PATCH] =?UTF-8?q?26-oct=20(noche):=20revisi=C3=B3n=20independien?= =?UTF-8?q?te=20del=20pedido=20de=20V5.6/V5.7=20(piloto=20NO-GO=20hasta=20?= =?UTF-8?q?A1=E2=80=93A6)?= MIME-Version: 1.0 Content-Type: text/plain; charset=UTF-8 Content-Transfer-Encoding: 8bit Página hardware/revision-pedido-26oct (revisión de un agente + verificación de Claude): paquete bien (regenerado idéntico), 7 piezas sin existencia en JLC ni para 5 tarjetas, CPL con 21/20 rotaciones equivocadas contra la huella de JLC (U14 a 180°, electrolíticos invertidos, D20/U8/U12 a 90°, JST al revés) y Q6 1.9 mm corrido. CPL propuestos y tablas en hardware/files/. Avisos en los documentos de diseño V5.6/V5.7 y en la auditoría final del 22-oct; índice de hardware y bitácora al día. Lote 2026-10-26_revision-pedido-v56-v57. Co-Authored-By: Claude Opus 5.5 Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx --- .../2026-10-26_revision-pedido-v56-v57.json | 154 +++++++ docs/bitacora.md | 1 + docs/hardware/auditoria-final-22oct.md | 8 + docs/hardware/diseno-v56.md | 10 +- docs/hardware/diseno-v57.md | 10 +- ...v6_PROD_positions_PROPUESTA-rotaciones.csv | 227 +++++++++++ ...v7_PROD_positions_PROPUESTA-rotaciones.csv | 230 +++++++++++ .../files/existencias_JLC_2026-10-26.csv | 108 +++++ docs/hardware/files/rotaciones_V5.6_Rev6.csv | 22 + docs/hardware/files/rotaciones_V5.7_Rev7.csv | 21 + ...ogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png | Bin 0 -> 160938 bytes docs/hardware/index.md | 29 +- docs/hardware/revision-pedido-26oct.md | 378 ++++++++++++++++++ mkdocs.yml | 1 + scripts/sync-docs.sh | 8 + 15 files changed, 1201 insertions(+), 6 deletions(-) create mode 100644 backend/lotes/2026-10-26_revision-pedido-v56-v57.json create mode 100644 docs/hardware/files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv create mode 100644 docs/hardware/files/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv create mode 100644 docs/hardware/files/existencias_JLC_2026-10-26.csv create mode 100644 docs/hardware/files/rotaciones_V5.6_Rev6.csv create mode 100644 docs/hardware/files/rotaciones_V5.7_Rev7.csv create mode 100644 docs/hardware/img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png create mode 100644 docs/hardware/revision-pedido-26oct.md diff --git a/backend/lotes/2026-10-26_revision-pedido-v56-v57.json b/backend/lotes/2026-10-26_revision-pedido-v56-v57.json new file mode 100644 index 0000000..55c6d9c --- /dev/null +++ b/backend/lotes/2026-10-26_revision-pedido-v56-v57.json @@ -0,0 +1,154 @@ +{ + "lote": "2026-10-26_revision-pedido-v56-v57", + "autor": "claude", + "motivo": "Revisión independiente del pedido de V5.6 y V5.7 (26-oct): piloto NO-GO hasta cerrar A1 a A6 (CPL corregido y sin faltantes en JLC); volumen NO-GO hasta el banco", + "fuente": "/hardware/revision-pedido-26oct/", + "cambios": [ + { + "crear": { + "id": "t-piloto-v5-piezas", + "titulo": "Piloto V5.6/V5.7: consignar AP64350SP-13 y STM32F411RET6 y fijar alternas con existencia (LIS2DH12TR, AO4406A, inductores, 12.4 kΩ)", + "pista": "compras", + "estado": "por-hacer", + "responsable": "adriana, leo", + "version_tarjeta": "V5.6", + "fecha_limite": "2026-10-28", + "descripcion": "Existencia en JLC el 26-oct, releída a las 23:36. Para 5 + 5 hacen falta 14 de cada una (22 de la 12.4 kΩ):\n- STM32F411RET6 C94355: 2\n- AP64350SP-13 C2071691: 1\n- SC7A20TR C5126709: 2\n- AO4406AL C35349: 0\n- MWSA0804S-4R7MT C17700167: 0\n- 12.4 kΩ C103261: 1\n- V5.7: SRP1265A-100M C840531: 0\n\nPropuesta:\n1. AP64350SP-13 ×14 y STM32F411RET6 ×14 en consigna, en un solo envío (Digi-Key o Mouser → JLC) o por Global Sourcing. El AP64350 no tiene alterna y marca la fecha del piloto. Con el RET6 el piloto queda con la misma memoria que el volumen; el RCT6 (C222222) es el plan B.\n2. LIS2DH12TR C110926 en lugar de la SC7A20: misma huella y rotación, y alcanza también para el volumen.\n3. AO4406A C2944312.\n4. L2: MWSA0804S-3R3MT C17700166 o -6R8MT C17700169. U13 trabaja con D ≈ 0.63–0.70: revisar en banco a 4.8 V con escalón.\n5. V5.7, L4: SRP1265A-150M C189912 o la -100M en consigna (Bourns).\n6. R23: C22865.\n\nCada alterna se revisa en el visor de JLC. Listo cuando: el carrito de JLC no tiene faltantes para 5 + 5.", + "enlaces": [ + { + "titulo": "Revisión del pedido, §6.6", + "url": "/hardware/revision-pedido-26oct/" + }, + { + "titulo": "Existencias de JLC (CSV)", + "url": "/hardware/files/existencias_JLC_2026-10-26.csv" + } + ], + "etiquetas": [ + "piloto", + "compras", + "V5.7" + ] + }, + "si_no_hay": [ + "consignar AP64350" + ] + }, + { + "crear": { + "id": "t-v5-t46-rotaciones", + "titulo": "T46: rotaciones y posición del CPL en KiCad (FT Rotation Offset en 21/20 piezas y FT Position Offset en Q6) y Rev6/Rev7 regenerados", + "pista": "ingenieria", + "estado": "por-hacer", + "responsable": "claude, leo", + "version_tarjeta": "V5.6", + "fecha_limite": "2026-10-28", + "descripcion": "Script de campos; no toca cobre. Agrega `FT Rotation Offset` en el esquemático y en el PCB de V5.6 y V5.7 a U14, C1, C14, C30, C68, C73, D20, Q6, U8, U12, J1–J4, J8–J10, J14, J16 (solo V5.6), K1 y Y4, y `FT Position Offset = -1.897,0` a Q6. Luego regenera Rev6/Rev7 con el Fabrication Toolkit y comprueba tres cosas: que el CPL nuevo sea igual al propuesto de la revisión del 26-oct, que Gerber y BOM no cambien y que el DRC siga igual. Con KiCad cerrado y el visto bueno de Leo. Así el piloto y el volumen salen del mismo paquete y nadie gira piezas a mano en el visor.", + "enlaces": [ + { + "titulo": "Revisión del pedido, §6.3", + "url": "/hardware/revision-pedido-26oct/" + }, + { + "titulo": "Rotaciones V5.6 (CSV)", + "url": "/hardware/files/rotaciones_V5.6_Rev6.csv" + }, + { + "titulo": "Rotaciones V5.7 (CSV)", + "url": "/hardware/files/rotaciones_V5.7_Rev7.csv" + } + ], + "etiquetas": [ + "piloto", + "fabricación", + "V5.7" + ] + }, + "si_no_hay": [ + "T46" + ] + }, + { + "crear": { + "id": "t-v55-revision-polaridad", + "titulo": "Mirar una V5.5 armada: muesca de los JST (P2 de 5 V y demás), pin 1 de U6 y franja de los electrolíticos contra la serigrafía", + "pista": "ingenieria", + "estado": "por-hacer", + "responsable": "jesus", + "version_tarjeta": "V5.5", + "fecha_limite": "2026-10-28", + "descripcion": "La V5.5 se pidió con las mismas rotaciones que hoy salen mal en el CPL de la V5.6/V5.7 (revisión del 26-oct, §6.3) y funciona: JLC las corrigió a mano. Hay que confirmarlo en una tarjeta armada:\n1. La muesca de los JST P2 (5 V), P4, P6, P8, P11 y P14 como la dibuja la serigrafía. Si P2 está al revés, los arneses de 5 V se armaron para esa posición y no sirven en una V5.6 bien armada.\n2. El punto de pin 1 de U6 (LTC4040) en la marca de la serigrafía.\n3. La franja (−) de C10, C3, C43, C78 y C103 del lado contrario al «+».\n\nFoto de cada uno al tablero. Si algo sale al revés, avisar a Leo de inmediato: puede haber unidades en campo con la misma pieza invertida.", + "enlaces": [ + { + "titulo": "Revisión del pedido, §6.3", + "url": "/hardware/revision-pedido-26oct/" + } + ], + "etiquetas": [ + "piloto", + "banco" + ] + }, + "si_no_hay": [ + "muesca de los JST" + ] + }, + { + "id": "t-v56-piloto", + "poner": { + "titulo": "Piloto V5.6 + V5.7: pedir 5 + 5 a JLC con el CPL corregido y sin faltantes (revisión independiente del 26-oct, A1 a A6)", + "descripcion": "Paquetes production/HBOX_v5_Rev6_PROD (V5.6) y HBOX_v5_Rev7_PROD (V5.7): bien; se regeneraron idénticos el 26-oct (Gerber, BOM y CPL contra el PCB). Antes de pagar (revisión independiente del 26-oct, §4): (A1) CPL corregido: T46 en KiCad (recomendado) o el CPL propuesto de la revisión; son 21 rotaciones en la V5.6, 20 en la V5.7 y la posición de Q6. (A2) Sin faltantes: AP64350SP-13 y STM32F411RET6 en consigna; alternas con existencia para SC7A20, AO4406AL, MWSA0804S-4R7, 12.4 kΩ y, en la V5.7, SRP1265A-100M (t-piloto-v5-piezas). (A3) PCB: 4 capas, 1.6 mm, JLC04161H-7628, ENIG, Via covering «Epoxy Filled & Capped» (obligatorio) y «Confirm production file». Ensamble solo arriba, con rayos X en U14 y U1 en las notas. (A4) Releer existencias el día del pago. (A5) No subir production/netlist.ipc (es el de la V5.7). (A6) Un renglón por código LCSC. En la imagen final de JLC, revisar: pin 1 de U14, D20, U8, U12 y Q6; franja (−) de C1, C14, C30, C68 y C73 opuesta al «+»; pestaña de los JST J1–J4, J10 y J16. Los LED D1 y D13–D17 no se giran. Número de orden al acta y a la bitácora. Al llegar: lupa en U14 antes de energizar y la compuerta de banco (§8). Headers de MOD1: 10 juegos, se sueldan en Querétaro.", + "bloqueada_por": [ + "t-compras-prioridad", + "t-registrar-instaladas", + "t-alta-responsables-campo", + "t-piloto-v5-piezas", + "t-v5-t46-rotaciones" + ], + "enlaces": [ + { + "titulo": "Revisión independiente del pedido (26-oct)", + "url": "/hardware/revision-pedido-26oct/" + }, + { + "titulo": "CPL propuesto V5.6", + "url": "/hardware/files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv" + }, + { + "titulo": "CPL propuesto V5.7", + "url": "/hardware/files/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv" + }, + { + "titulo": "Auditoría final (22-oct)", + "url": "/hardware/auditoria-final-22oct/" + }, + { + "titulo": "Inventario", + "url": "/tableros/inventario/" + } + ] + }, + "nota": "26-oct: la revisión independiente dejó el piloto en NO-GO hasta cerrar A1–A6: 7 piezas no alcanzan en JLC ni para 5 tarjetas y el CPL trae 21/20 rotaciones equivocadas (U14 a 180°, electrolíticos invertidos) y Q6 1.9 mm corrido." + }, + { + "id": "t-preorden-108-322-bom", + "nota": "26-oct (revisión independiente): el volumen sigue en NO-GO hasta la compuerta de banco del piloto. Pre-ordenar ya, en paralelo: STM32F411RET6, AP64350SP-13, LIS2DH12 o SC7A20, AO4406, MWSA0804S-4R7MT y SRP1265A-100M." + }, + { + "id": "t-fw-070", + "nota": "26-oct: 0.7.0-pre es la compuerta del piloto (revisión del pedido, §6.8 y §8). Si el piloto lleva STM32F411RCT6 (plan B), compilar para GENERIC_F411RCTX: EEPROM en 0x08020000 y binario < 128 KB." + }, + { + "id": "t-preordenes-v6", + "nota": "26-oct 23:36: JLC ya tiene THVD1410DR (7 306), TPS7A2033PDBVR (150 147) y SF72S006 (11 661). Para las 20 del piloto de la v6 ya no hace falta pre-orden; releer el día del pedido." + }, + { + "id": "t-paquetes-aldair", + "nota": "26-oct: antes de mandarle a Aldair los paquetes de V5.6/V5.7 va T46 (CPL corregido, mismo Gerber y BOM) y la lista A1–A6 de la revisión independiente del pedido." + }, + { + "id": "t-banco-v5-procedimiento-t43", + "nota": "26-oct: la compuerta mínima de banco está en la revisión independiente del pedido (§8): recepción con lupa y rayos X de U14, rieles, I²C, módem, LTC4040, U15 de la V5.7, comunicaciones, ignición, mecánica y 24 h a 45 °C." + } + ] +} \ No newline at end of file diff --git a/docs/bitacora.md b/docs/bitacora.md index 7f94b2b..6bf85e8 100644 --- a/docs/bitacora.md +++ b/docs/bitacora.md @@ -23,6 +23,7 @@ Arriba, lo que pasó en el tablero de pendientes y en las actas en los últimos ### Octubre de 2026 **26 oct** +: [Revisión independiente del pedido de V5.6 y V5.7](hardware/revision-pedido-26oct.md): **piloto NO-GO hoy, GO al cerrar A1 a A6; volumen NO-GO hasta pasar el banco.** El paquete se regeneró idéntico y DRC, ERC y paridad están limpios. Pero 7 piezas no alcanzan en JLC ni para 5 tarjetas: el AP64350 va en consigna y marca la fecha. Además, el CPL lleva 21 y 20 rotaciones equivocadas para las huellas de JLC (el LTC4040, los electrolíticos, D20, U8, U12, Q6 y varios JST), y Q6 va 1.9 mm corrido. La V5.5 salió con las mismas rotaciones y JLC las corrigió a mano. Los CPL corregidos están junto a la revisión; T46 lo deja permanente en KiCad. Lote `2026-10-26_revision-pedido-v56-v57`. : [Revisión de la v6 después del fin de semana](hardware/v6-revision-26oct.md) (Michelle, `9a6f250`): DRC con **0 errores** y 0 sin conectar; en el bloque B Q7 ya quedó junto a R80 y U17, `/VIN_SW` salió de In2, la toma CLN quedó Kelvin y el EP de U17 tiene 9 vías, con 146 vías de GND nuevas. **Regresión:** `/VEH5V` ahora llega a R80 por In2 y la toma VIN (U17.6) dejó de ser Kelvin (límite de entrada ≈ 10 % corrido). Falta la mitad del bloque B y los bloques C, D y E; G1 en riesgo → D-26-1 (Leo). : [Costeo JLCPCB e importación](hardware/costeo-jlc-26oct.md) de 135 V5.6, 365 V5.7 y 60 v6, tres pedidos el mismo día: a JLC ≈ **US$36,060** con envío UPS; aterrizado sin IVA **MX$1,104 / 998 / 3,163 por tarjeta**; IVA de importación ≈ MX$112k (acreditable). Pedimento A1 con IGI 0%. **12 piezas sin existencia suficiente en JLC** para los tres pedidos juntos (STM32F411RET6, AP64350, SC7A20, AO4406A, inductores): resolverlas antes de pagar. [Modelo en Excel](hardware/2026-10-26_Drogheda_Costeo-JLCPCB_V5.6-V5.7-v6_v1.0.xlsx); lote `2026-10-26_costeo-jlc`. diff --git a/docs/hardware/auditoria-final-22oct.md b/docs/hardware/auditoria-final-22oct.md index 2a10afd..e3c785f 100644 --- a/docs/hardware/auditoria-final-22oct.md +++ b/docs/hardware/auditoria-final-22oct.md @@ -16,6 +16,14 @@ audience: Leo (decide el pedido), Michelle, Jesús, Aldair, Adriana **Pregunta (Leo, 22-oct, 10:01):** ¿se piden hoy? Y que todos los puertos funcionen, que la V5.7 no use la Mean Well, que el módem no provoque un apagón, que en batería duerma 10 min, despierte, reporte dos veces y vuelva a dormir, empezar el firmware, y una sola auditoría con riesgos, easy wins y matriz. +!!! danger "26-oct: el «GO hoy» de abajo quedó superado" + La [revisión independiente del pedido (26-oct)](revision-pedido-26oct.md) encontró dos cosas que esta auditoría no vio: + + - **Existencias.** Con la existencia de JLC en vivo, 7 piezas no alcanzan ni para 5 tarjetas. Esta auditoría usó la base local de JLC del 1-ago. + - **Rotaciones.** El CPL tiene 21 (V5.6) y 20 (V5.7) piezas con la rotación equivocada para la huella de JLC: el LTC4040, los electrolíticos, D20, U8, U12, Q6 y varios JST. La condición (2) de abajo apuntaba a las huellas de easyeda2kicad, que sí están bien. + + Piloto: **NO-GO hasta cerrar A1 a A6** de esa revisión. El NO-GO del volumen sigue igual. + !!! success "Veredicto: GO al piloto de 5 V5.6 + 5 V5.7, hoy, con tres condiciones de pedido que no tocan el cobre" - **(1) Vías «Epoxy Filled & Capped» + rayos X en U6**: las tres vías térmicas del LTC4040 caen dentro de las ventanas de pasta (al 50 %). Es la causa de los puentes de la V5.5/V4. - **(2) Rotación y polaridad en el visor de JLC** de U6, U7, U25, U26, L22, Q7, U16, D34, D10 y los electrolíticos: las huellas easyeda2kicad no pasan por la tabla de correcciones del Fabrication Toolkit y nunca se han fabricado. diff --git a/docs/hardware/diseno-v56.md b/docs/hardware/diseno-v56.md index 70f2ba4..6cfb4ce 100644 --- a/docs/hardware/diseno-v56.md +++ b/docs/hardware/diseno-v56.md @@ -11,6 +11,14 @@ audience: "Leo, Michelle (layout), Jesús (banco), Aldair (fabricación), Adrian # EinarBoard V5.6 (HBOX 5.6) — documento de diseño +!!! danger "26-oct: revisión independiente del pedido. El piloto es NO-GO hasta cerrar A1 a A6" + La revisión encontró dos cosas que este documento no tenía: + + - **7 piezas sin existencia en JLC ni para 5 tarjetas:** STM32F411RET6, AP64350SP-13, SC7A20TR, AO4406AL, MWSA0804S-4R7MT y 12.4 kΩ (R23). + - **21 piezas con la rotación del CPL equivocada para la huella de JLC.** Entre ellas: U14 a 180°; C1, C14, C30, C68 y C73 invertidos; D20, U8 y U12 a 90°; Q6, con 1.9 mm de corrimiento además; J16, J3, J4 y J10 al revés. + + La lista de «revisar en el visor» del §11 y del §13.1 ya no basta: **el CPL se corrige antes de pedir**. El paquete, el DRC y el netlist están bien. [**▶ Revisión independiente del pedido (26-oct)**](revision-pedido-26oct.md). El PDF (v1.3) es de antes de esta revisión. + !!! warning "Estado al 22-oct-2026: lista para el piloto de 5; las 108 esperan el banco con 0.7.0" El paquete de fabricación `HBOX_v5_Rev6_PROD` está verificado y ya trae T42a (victorias rápidas), T43 (designadores en orden) y T44 (serigrafía de 0.8 mm). **El piloto de 5 V5.6 + 5 V5.7 tiene GO** (D-22-1), con dos condiciones de pedido que no tocan el cobre: vías tapadas y rayos X en U14, y la revisión de rotaciones en el visor de JLC (§13.1). **D-22-9** (tamaño de los designadores) quedó decidida el 23-oct: (b), designadores de 0.8 mm con trazo de 0.15 mm, colocados por script con T44. **Las 108 siguen en NO-GO** hasta que el piloto pase el banco con el firmware 0.7.0: hoy ningún firmware enciende el módem de esta tarjeta (§13.4). @@ -767,7 +775,7 @@ De la [auditoría final del 22-oct](auditoria-final-22oct.md), en la numeración | # | Condición | Por qué | Estado | |---|---|---|---| | 1 | Vías **Epoxy Filled & Capped** y **rayos X en U14** | Las tres vías térmicas del LTC4040 (QFN de 0.5 mm) caen dentro de las ventanas de pasta al 50 %. Es la causa de los puentes y bolitas de la V5.5 y la V4 | se pide así | -| 2 | Rotación y polaridad en el visor de JLC (lista del §11) | Varias huellas vienen de easyeda2kicad y nunca se han fabricado (U13, U1); la tabla de correcciones del Fabrication Toolkit no las cubre | al pedir | +| 2 | Rotación y polaridad: **corregir el CPL** (21 piezas y la posición de Q6) y revisar en el visor | 26-oct: las huellas de easyeda2kicad (U13, U1) están bien. Las que fallan son huellas de la biblioteca de KiCad donde la tabla del Fabrication Toolkit no coincide con la pieza de JLC ([revisión del 26-oct](revision-pedido-26oct.md)) | antes de pedir (A1) | | 3 | D18 SMBJ33A → **SMBJ33CA** | Con el arnés al revés, el unidireccional conduce | ✅ T42a (C83325) | | P-1 | Relleno de zonas fresco en el `.kicad_pcb` | Una exportación sin rellenar habría mandado cobre de GND sobre vías de T34/T35 | ✅ 22-oct, 13:00 | diff --git a/docs/hardware/diseno-v57.md b/docs/hardware/diseno-v57.md index 81797eb..80af5bf 100644 --- a/docs/hardware/diseno-v57.md +++ b/docs/hardware/diseno-v57.md @@ -11,6 +11,14 @@ audience: "Leo, Michelle (layout), Jesús (banco), Aldair (fabricación), Adrian # EinarBoard V5.7 (HBOX 5.7) — documento de diseño +!!! danger "26-oct: revisión independiente del pedido. El piloto es NO-GO hasta cerrar A1 a A6" + La revisión encontró dos cosas que este documento no tenía: + + - **7 piezas sin existencia en JLC ni para 5 tarjetas:** STM32F411RET6, AP64350SP-13, SC7A20TR, AO4406AL, MWSA0804S-4R7MT, 12.4 kΩ (R23) y SRP1265A-100M (L4). + - **20 piezas con la rotación del CPL equivocada para la huella de JLC.** Entre ellas: U14 a 180°; C1, C14, C30, C68 y C73 invertidos; D20, U8 y U12 a 90°; Q6, con 1.9 mm de corrimiento además; J3, J4 y J10 al revés. + + La lista de «revisar en el visor» del §11 y del §13.1 ya no basta: **el CPL se corrige antes de pedir**. Las huellas de easyeda2kicad (U15, L4, U13 y U1) sí están bien. El paquete, el DRC y el netlist están bien. [**▶ Revisión independiente del pedido (26-oct)**](revision-pedido-26oct.md). El PDF (v1.3) es de antes de esta revisión. + !!! warning "Estado al 22-oct-2026: lista para el piloto de 5; las 322 esperan el banco con 0.7.0" El paquete de fabricación `HBOX_v5_Rev7_PROD` está verificado y ya trae T42a (victorias rápidas), T43 (designadores en orden) y T44 (serigrafía de 0.8 mm). **El piloto de 5 V5.6 + 5 V5.7 tiene GO** (D-22-1), con dos condiciones de pedido que no tocan el cobre: vías tapadas y rayos X en U14, y la revisión de rotaciones en el visor de JLC (§13.1). **D-22-9** (tamaño de los designadores) quedó decidida el 23-oct: (b), designadores de 0.8 mm con trazo de 0.15 mm, colocados por script con T44. En el banco del piloto se mide además la fuente a bordo U15 a 9, 24 y 32 V (D-21-2). **Las 322 siguen en NO-GO** hasta que el piloto pase el banco con el firmware 0.7.0: hoy ningún firmware enciende el módem de esta tarjeta (§13.4). @@ -748,7 +756,7 @@ De la [auditoría final del 22-oct](auditoria-final-22oct.md), en la numeración | # | Condición | Por qué | Estado | |---|---|---|---| | 1 | Vías **Epoxy Filled & Capped** y **rayos X en U14** | Las tres vías térmicas del LTC4040 (QFN de 0.5 mm) caen dentro de las ventanas de pasta al 50 %. Es la causa de los puentes y bolitas de la V5.5 y la V4 | se pide así | -| 2 | Rotación y polaridad en el visor de JLC (lista del §11) | Varias huellas vienen de easyeda2kicad y nunca se han fabricado (U15, L4, U13, U1), y D21 es nuevo. La tabla de correcciones del Fabrication Toolkit no las cubre | al pedir | +| 2 | Rotación y polaridad: **corregir el CPL** (20 piezas y la posición de Q6) y revisar en el visor | 26-oct: las huellas de easyeda2kicad (U15, L4, U13, U1) están bien. Las que fallan son huellas de la biblioteca de KiCad donde la tabla del Fabrication Toolkit no coincide con la pieza de JLC ([revisión del 26-oct](revision-pedido-26oct.md)) | antes de pedir (A1) | | 3 | D18 SMBJ33A → **SMBJ33CA** | Con el arnés al revés, el unidireccional conducía y abría F2 (SMD) | ✅ T42a (C83325) | | P-1 | Relleno de zonas fresco en el `.kicad_pcb` | Una exportación sin rellenar habría mandado cobre de GND sobre vías de T36/T37 | ✅ 22-oct, 13:00 | diff --git a/docs/hardware/files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv b/docs/hardware/files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv new file mode 100644 index 0000000..3c72583 --- /dev/null +++ b/docs/hardware/files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv @@ -0,0 +1,227 @@ +Designator,Mid X,Mid Y,Rotation,Layer +C1,76.595,-44.19,180.0,top +C10,117.49,-52.63,270.0,top +C11,129.755,-52.72,270.0,top +C12,139.66,-52.95,270.0,top +C13,140.395,-56.965,270.0,top +C14,146.16,-57.165,0.0,top +C15,86.555,-57.84,0.0,top +C16,92.455,-62.0,270.0,top +C17,94.075,-62.0,270.0,top +C18,101.23,-58.5,270.0,top +C19,130.565,-58.13,270.0,top +C2,89.6,-42.2,180.0,top +C20,134.075,-57.74,0.0,top +C21,179.61,-58.855,90.0,top +C22,83.625,-65.435,90.0,top +C23,99.82,-62.93,270.0,top +C24,102.31,-62.93,270.0,top +C25,104.39,-62.71,270.0,top +C26,130.565,-62.74,90.0,top +C27,134.075,-64.843333,0.0,top +C28,134.075,-66.657778,0.0,top +C29,149.61,-63.125,270.0,top +C3,89.8,-44.2,180.0,top +C30,166.995,-66.955,180.0,top +C31,99.12,-70.86,180.0,top +C32,112.045,-69.165,180.0,top +C33,134.075,-70.69,0.0,top +C34,149.61,-70.52,270.0,top +C35,183.435,-68.36,180.0,top +C36,98.625,-76.98,270.0,top +C37,127.31,-76.01,90.0,top +C38,129.1,-76.69,270.0,top +C39,134.075,-72.504445,0.0,top +C4,89.8,-46.0,180.0,top +C40,134.075,-74.318889,0.0,top +C41,134.075,-76.133334,0.0,top +C42,149.61,-74.435,270.0,top +C43,171.6,-73.88,90.0,top +C44,134.075,-77.947778,0.0,top +C45,162.5,-79.54,270.0,top +C46,185.4,-79.8,180.0,top +C47,193.8,-80.8,90.0,top +C48,139.025,-83.395,90.0,top +C49,141.725,-84.28,180.0,top +C5,83.755,-48.945,270.0,top +C50,150.48,-85.14,0.0,top +C51,161.58,-86.015,0.0,top +C52,134.135,-90.306587,0.0,top +C53,150.48,-88.176667,180.0,top +C54,150.48,-91.0,0.0,top +C55,150.48,-93.4,180.0,top +C56,160.71,-96.365,180.0,top +C57,172.58,-102.765,90.0,top +C58,146.0,-109.8,0.0,top +C59,152.2,-111.8,270.0,top +C6,113.6,-51.4,180.0,top +C60,153.275,-109.2,180.0,top +C61,133.25,-116.515,180.0,top +C62,136.4,-113.2,90.0,top +C63,137.0,-116.4,90.0,top +C64,146.4,-112.2,0.0,top +C65,146.4,-115.0,0.0,top +C66,166.595,-112.85,180.0,top +C67,133.25,-121.095,0.0,top +C68,140.09,-120.945,180.0,top +C69,146.0,-120.2,90.0,top +C7,185.36,-51.255,0.0,top +C70,149.455,-120.89,270.0,top +C71,163.665,-124.055,90.0,top +C72,168.395,-123.27,0.0,top +C73,184.735,-123.78,0.0,top +C74,196.46,-66.625,270.0,top +C75,184.215,-71.155,270.0,top +C8,83.755,-53.54,270.0,top +C9,116.28,-55.69,180.0,top +D1,159.8,-43.6,90.0,top +D10,134.075,-79.812778,0.0,top +D11,144.6825,-79.65,180.0,top +D12,134.135,-85.937381,0.0,top +D13,196.2725,-96.33,180.0,top +D14,182.15,-105.71,180.0,top +D15,182.15,-108.86,180.0,top +D16,182.15,-112.01,180.0,top +D17,182.15,-115.16,180.0,top +D18,177.58,-121.7075,90.0,top +D19,191.565,-126.295,180.0,top +D2,124.5025,-49.935,0.0,top +D20,167.2,-128.0,270.0,top +D21,190.8175,-50.625,0.0,top +D3,179.78,-52.075,0.0,top +D4,152.2,-52.6,90.0,top +D5,72.97,-69.095,180.0,top +D6,72.77,-77.09,90.0,top +D7,72.805,-72.545,270.0,top +D8,95.57,-74.6575,90.0,top +D9,104.3925,-76.81,0.0,top +F1,132.4,-43.8,180.0,top +J1,106.8,-44.6,180.0,top +J10,195.13,-106.425,90.0,top +J11,137.6,-129.3,0.0,top +J12,151.0,-129.3,0.0,top +J13,164.175,-133.25,0.0,top +J14,73.515,-135.405,0.0,top +J15,182.7,-133.8,0.0,top +J16,115.85,-44.6,180.0,top +J2,124.95,-44.6,180.0,top +J3,143.95,-44.755,180.0,top +J4,153.15,-44.8,180.0,top +J5,167.6,-44.875,0.0,top +J6,73.64,-58.265,270.0,top +J7,67.545,-73.91,270.0,top +J8,174.2,-83.8,270.0,top +J9,196.5,-83.8,270.0,top +K1,158.3225,-57.1325,270.0,top +L1,169.525,-58.86,0.0,top +L2,137.675,-104.65,180.0,top +L3,173.645,-109.63,0.0,top +L4,188.95,-57.07,180.0,top +Q1,149.0,-50.4,180.0,top +Q2,124.555,-52.805,180.0,top +Q3,196.4975,-53.73,180.0,top +Q4,196.52,-58.3,180.0,top +Q5,117.225,-76.31,180.0,top +Q6,194.48,-119.987,270.0,top +Q7,156.26,-122.4875,270.0,top +R1,159.2,-46.4,180.0,top +R10,86.555,-55.9,180.0,top +R11,113.6,-53.0,180.0,top +R12,119.545,-52.675,90.0,top +R13,121.4,-52.625,90.0,top +R14,127.73,-52.685,90.0,top +R15,131.605,-52.72,90.0,top +R16,133.455,-52.74,90.0,top +R17,134.2,-55.2,180.0,top +R18,135.85,-52.775,270.0,top +R19,137.59,-52.765,270.0,top +R2,86.555,-47.975,0.0,top +R20,138.615,-56.94,270.0,top +R21,83.72,-57.8,90.0,top +R22,83.755,-61.46,90.0,top +R23,86.555,-59.815,180.0,top +R24,111.955,-60.59,180.0,top +R25,134.075,-59.4,0.0,top +R26,134.075,-61.214444,0.0,top +R27,111.955,-62.78,180.0,top +R28,134.075,-63.028889,180.0,top +R29,151.215,-63.145,270.0,top +R3,86.555,-49.82,180.0,top +R30,134.075,-68.55,180.0,top +R31,115.798571,-72.76,270.0,top +R32,117.797143,-72.76,90.0,top +R33,119.795714,-72.76,90.0,top +R34,121.794286,-72.76,90.0,top +R35,127.046429,-72.76,270.0,top +R36,129.045,-72.76,90.0,top +R38,67.575,-81.805,270.0,top +R39,70.425,-81.77,270.0,top +R4,86.555,-51.67,180.0,top +R40,134.14,-81.797778,0.0,top +R41,171.8,-77.775,90.0,top +R42,134.135,-83.752778,0.0,top +R43,171.8,-83.6,90.0,top +R44,134.135,-88.121984,180.0,top +R45,146.77,-89.465,270.0,top +R46,134.135,-92.491191,0.0,top +R47,134.135,-94.675794,180.0,top +R48,189.175,-96.4,0.0,top +R49,192.585,-96.405,0.0,top +R5,101.8,-50.4,0.0,top +R50,145.4,-104.6,0.0,top +R51,145.4,-106.895,180.0,top +R52,165.475,-102.34,180.0,top +R53,165.475,-104.7425,180.0,top +R54,165.475,-107.145,180.0,top +R55,185.875,-105.71,180.0,top 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+C15,86.555,-57.84,0.0,top +C16,92.455,-62.0,270.0,top +C17,94.075,-62.0,270.0,top +C18,101.23,-58.5,270.0,top +C19,130.565,-58.13,270.0,top +C2,89.6,-42.2,180.0,top +C20,134.075,-57.74,0.0,top +C21,180.921,-62.1135,180.0,top +C22,83.625,-65.435,90.0,top +C23,99.82,-62.93,270.0,top +C24,102.31,-62.93,270.0,top +C25,104.39,-62.71,270.0,top +C26,130.565,-62.74,90.0,top +C27,134.075,-64.843333,0.0,top +C28,134.075,-66.657778,0.0,top +C29,149.61,-63.125,270.0,top +C3,89.8,-44.2,180.0,top +C30,166.995,-66.955,180.0,top +C31,99.12,-70.86,180.0,top +C32,112.045,-69.165,180.0,top +C33,134.075,-70.69,0.0,top +C34,149.61,-70.52,270.0,top +C35,181.517,-72.5135,180.0,top +C36,98.625,-76.98,270.0,top +C37,127.31,-76.01,90.0,top +C38,129.1,-76.69,270.0,top +C39,134.075,-72.504445,0.0,top +C4,89.8,-46.0,180.0,top +C40,134.075,-74.318889,0.0,top +C41,134.075,-76.133334,0.0,top +C42,149.61,-74.435,270.0,top +C43,171.6,-73.88,90.0,top +C44,134.075,-77.947778,0.0,top +C45,162.5,-79.54,270.0,top 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+C105362,FMF06FTHR010-LH,1206,expand,182670,1,1,22,521,ok +C12074,HR911105A,Plugin,expand,69795,1,1,14,508,ok +C12447,0603WAF4022T5E,0603,expand/pref,177340,2,1,27,659,ok +C125098,LTST-C191KGKT,0603,expand,114477,1,1,14,508,ok +C125103,LTST-C193TBKT-5A,0603,expand,66167,1,1,14,508,ok +C131469,BAT54W,SOD-123,expand,551,1,1,14,508,ok +C138687,CL32B106KBJNNNE,1210,expand,98928,1,1,22,521,ok +C144394,B3B-XH-A(LF)(SN),"Plugin,P=2.5mm",expand,83170,1,1,14,508,ok +C144395,B4B-XH-A(LF)(SN),"Plugin,P=2.5mm",expand,707039,1,1,14,508,ok +C14663,CC0603KRX7R9BB104,0603,base,42416584,27,28,291,14153,ok +C14860,CL31B106KAHNNNE,1206,expand,1178995,1,1,22,521,ok +C14872,X49SM25MSD2SC,HC-49S-SMD,expand,29114,2,2,24,1013,ok +C15051,MP1584EN-LF-Z,SOIC-8-EP,expand,4889,2,1,19,644,ok +C15127,AO3401A,SOT-23,base,702490,1,1,14,508,ok +C1525,CL05B104KO5NNNC,0402,base,34451522,1,1,22,521,ok +C153036,FS32X225K101EGG,1210,expand,277062,0,2,16,750,ok +C1542,0402B682K500NT,0402,expand/pref,131442,0,1,11,378,ok +C15578,TLV1117LV33DCYR,SOT-223,expand,23619,1,1,14,508,ok +C1563,0402CG390J500NT,0402,expand,118193,0,1,11,378,ok +C158012,B2B-XH-A(LF)(SN),"Plugin,P=2.5mm",expand,418872,5,4,49,2159,ok +C15849,CL10A105KB8NNNC,0603,base,13193254,1,1,22,521,ok +C1604,0603B222K500NT,0603,base,892782,2,1,27,659,ok +C1631,0603B682K500NT,0603,base,363128,1,1,22,521,ok +C1644,CL10C150JB8NNNC,0603,base,1123913,2,2,32,1031,ok +C1647,CL10C180JB8NNNC,0603,base,278989,2,2,32,1031,ok +C1653,CL10C220JB8NNNC,0603,base,1966272,2,2,32,1031,ok +C165527,MVK50V47M6.3*8 6.3TP,"SMD,D6.3xL8mm",expand,62,1,1,22,521,no alcanza para el volumen +C165760,RC0603FR-07162KL,0603,expand,7775,0,1,11,378,ok +C1710,CL21B103KBANNNC,0805,base,1361136,1,1,22,521,ok +C17700165,MWSA0804S-2R2MT,"SMD,8.8x8.2mm",expand,171,1,1,14,508,no alcanza para el volumen +C17700167,MWSA0804S-4R7MT,"SMD,8.8x8.2mm",expand,0,1,1,14,508,NO ALCANZA PARA EL PILOTO +C17700171,MWSA0804S-100MT,"SMD,8.8x8.2mm",expand,4457,2,1,19,644,ok +C177479,RCT03499KFLF,0603,expand,1630,1,1,22,521,ok +C1779,CL21A475KAQNNNE,0805,base,1964573,1,1,22,521,ok +C18164540,BSMD1812-400-12V,1812,expand,12684,1,1,14,508,ok +C19666,CL10A475KO8NNNC,0603,base,3429948,2,2,32,1031,ok +C19702,CL10A106KP8NNNC,0603,base,12618743,1,1,22,521,ok +C20526,MMBT3904(RANGE:100-300),SOT-23,base,2158058,2,2,24,1013,ok +C2071691,AP64350SP-13,SO-8-EP,expand,1,1,1,14,508,NO ALCANZA PARA EL PILOTO +C20917,AO3400A,SOT-23,base,1205825,2,2,24,1013,ok +C21190,0603WAF1001T5E,0603,base,33984733,7,7,82,3581,ok +C2238,X49SM36864MSD2SC-1,HC-49S-SMD,expand,10870,1,1,14,508,ok +C22772,0603WAF1022T5E,0603,expand,154630,0,1,11,378,ok +C22775,0603WAF1000T5E,0603,base,10444970,1,1,22,521,ok +C22787,0603WAF1200T5E,0603,base,2332719,9,9,102,4601,ok +C22797,0603WAF1302T5E,0603,base,467734,0,1,11,378,ok +C22840,0603WAF1431T5E,0603,expand,9350,1,1,22,521,ok +C22859,0603WAF100JT5E,0603,base,6806974,1,1,22,521,ok +C22965,0603WAF2703T5E,0603,expand/pref,269754,1,1,22,521,ok +C2297,KT-0805G,0805,base,2366049,6,6,64,3033,ok +C22978,0603WAF3301T5E,0603,base,5476672,1,1,22,521,ok +C23082,0603WAF5762T5E,0603,expand,62251,0,1,11,378,ok +C23138,0603WAF3300T5E,0603,base,3778167,2,2,32,1031,ok +C23162,0603WAF4701T5E,0603,base,16739119,3,3,42,1541,ok +C23185,0603WAF499JT5E,0603,base,1626268,4,4,52,2051,ok +C23186,0603WAF5101T5E,0603,base,21935613,4,4,52,2051,ok +C23189,0603WAF5601T5E,0603,base,881960,1,1,22,521,ok +C23260,0603WAF9101T5E,0603,base,640322,1,1,22,521,ok +C23630,CL10A225KO8NNNC,0603,base,3066577,1,1,22,521,ok +C25803,0603WAF1003T5E,0603,base,17789622,14,11,139,6034,ok +C25804,0603WAF1002T5E,0603,base,39185175,15,15,164,7661,ok +C25808,0603WAF1203T5E,0603,base,1142916,1,1,22,521,ok +C25811,0603WAF2003T5E,0603,base,2352030,1,1,22,521,ok +C25967,0603WAF3162T5E,0603,expand,128114,2,2,32,1031,ok +C2624,IRFR5305TRPBF,DPAK(TO-252AA),expand,20422,1,1,14,508,ok +C2689642,PTS636SK25SMTRLFS,"SMD,6x3.5mm",expand,2473,1,1,14,508,ok +C28262,CL10C680JB8NNNC,0603,expand/pref,131114,1,1,22,521,ok +C2827694,PESD5V0S1BA,SOD-323,expand,505231,3,3,34,1518,ok +C2848306,SHT40-AD1B-R3,DFN-4-EP(1.5x1.5),expand,5841,1,1,14,508,ok +C28695,G5V-1 DC5,"DIP,12.5x7.5mm",expand,7506,1,1,14,508,ok +C2925557,PM200V-11-10-H43,"Plugin,P=2mm",expand,17205,2,2,24,1013,ok +C308878,TRS3232EIDR,SOIC-16,expand,3691,1,1,14,508,ok +C31850,0603WAF2202T5E,0603,base,3087311,3,3,42,1541,ok +C32346,Q13FC13500004,SMD3215-2P,base,484620,1,1,14,508,ok +C32843,W5500,LQFP-48_7x7,expand,22748,1,1,14,508,ok +C35349,AO4406AL,SOIC-8,expand,0,1,1,14,508,NO ALCANZA PARA EL PILOTO +C38523,CL10C120JB8NNNC,0603,base,634113,2,2,32,1031,ok +C4184,0603WAF2002T5E,0603,base,6792673,1,0,11,143,ok +C424683,DB128V-5.0-5P-GN-S,"Plugin,P=5mm",expand,8013,1,1,14,508,ok +C440198,GRM21BR61H106KE43L,0805,base,1336870,5,5,62,2561,ok +C45783,CL21A226MAQNNNE,0805,base,4093380,10,10,112,5110,ok +C5116483,2.54-1*4,"Plugin,P=2.54mm",expand,32078,1,1,14,508,ok +C5126709,SC7A20TR,LGA-12(2x2),expand,2,1,1,14,508,NO ALCANZA PARA EL PILOTO +C5160226,15EDGRC-3.5-03P-14-00A(H),"Plugin,P=3.5mm",expand,3728,2,2,24,1013,ok +C524806,TPS54360BDDAR,SOIC-8-EP,expand,57332,0,1,7,370,ok +C5440143,CS3225X7R476K160NRL,1210,expand,150235,2,4,42,1776,ok +C57112,0603B103K500NT,0603,base,5978702,4,3,47,1678,ok +C57156,"SC16IS752IPW,128",TSSOP-28,expand,7982,1,1,14,508,ok +C687163,LTC4040EUFD#TRPBF,VQFN-24-EP(4x5),expand,2211,1,1,14,508,ok +C7095263,USB4085-GF-A,Plugin,expand,2767,2,2,24,1013,ok +C7519,USBLC6-2SC6,SOT-23-6L,expand,36446,1,1,14,508,ok +C7605,"PCF8574T/3,518",SOIC-16-300mil,expand,18194,1,1,14,508,ok +C80857,BZX84C15LT1G,SOT-23,expand,31023,1,1,14,508,ok +C81598,1N4148W,SOD-123,base,4027574,1,1,14,508,ok +C83205,K2-6639DP-B4SW-04,"Plugin-4P,6x6mm",expand,1491,2,2,24,1013,ok +C83325,SMBJ33CA,DO-214AA,expand,36376,1,1,14,508,ok +C840531,SRP1265A-100M,"SMD,13.5x12.5mm",expand,0,0,1,7,370,NO ALCANZA PARA EL PILOTO +C85100,B560C-13-F,SMC(DO-214AB),expand,134240,0,1,7,370,ok +C8678,SS34,SMA(DO-214AC),base,3576474,5,4,49,2159,ok +C881921,OVZ221M1CTR-0608,"SMD,6.3x7.7mm",expand,97216,3,3,42,1541,ok +C88744,35TZV100M6.3X8,"SMD,D6.3xL8mm",expand,27730,1,1,22,521,ok +C8963,SP3485EN-L/TR,SOIC-8,base,370715,1,1,14,508,ok +C94355,STM32F411RET6,LQFP-64(10x10),expand,2,1,1,14,508,NO ALCANZA PARA EL PILOTO +C99269,TMP102AIDRLR,SOT-563,expand,34576,2,2,24,1013,ok +C99550,0452003.MRL,2410,expand,20092,0,1,7,370,ok diff --git a/docs/hardware/files/rotaciones_V5.6_Rev6.csv b/docs/hardware/files/rotaciones_V5.6_Rev6.csv new file mode 100644 index 0000000..ff3ccff --- /dev/null +++ b/docs/hardware/files/rotaciones_V5.6_Rev6.csv @@ -0,0 +1,22 @@ +Ref,Valor,LCSC,Huella KiCad,Huella de JLC (biblioteca),Rotación en el CPL,Rotación que necesita JLC,FT Rotation Offset,Efecto si JLC lo deja como dice el CPL +U14,LTC4040EUFD,C687163,QFN-24-1EP_4x5mm_P0.5mm_EP2.65x3.65mm,VQFN-24_L5.0-W4.0-P0.50-BL-EP-1,90,270,+180,"180°: pin 1 del LTC4040 cae en el pad 13 -> tarjeta muerta; no se ve en la alineación de pads (QFN simétrico), solo en el punto de pin 1" +C1,100uF/6.3V,C88744,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-FD,0,180,+180,polaridad invertida en /3V3_ETH (+ a GND) +C14,220uF/16V polymer,C881921,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-LS7.2-FD,180,0,+180,polímero invertido en /VEH5V -> se pone en corto: sin 5 V +C30,220uF/16V polymer,C881921,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-LS7.2-FD,0,180,+180,polímero invertido en /3V3_MODEM -> riel del módem en corto +C68,220uF/16V polymer,C881921,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-LS7.2-FD,0,180,+180,polímero invertido en /SW_5V -> etapa RTK en corto +C73,47uF/50V,C165527,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-FD,180,0,+180,electrolítico invertido en /24V -> se calienta y ventea a 24 V +D20,USBLC6-2SC6,C7519,SOT-23-6,SOT-23-6_L2.9-W1.6-P0.95-LS2.8-BL,180,270,+90,90°: no asienta (JLC lo ve); si lo corrige a 90° en vez de 270°: VBUS<->GND +Q6,IRFR5305,C2624,TO-252-2,TO-252-3_L6.5-W6.1-P4.58-LS9.9-BR,90,270,+180,"180°: el tab cae en los pads de G/S (JLC lo ve). Además FT Position Offset = -1.897,0: con 270° la huella de JLC queda 1.9 mm corrida (Mid Y −118.09 → −119.987)" +U8,TMP102,C99269,SOT-563,SC-89-6_L1.6-W1.2-P0.50-LS1.6-BL,0,270,+270,90°: no asienta (JLC lo ve); si lo corrige mal: V+<->GND +U12,TMP102,C99269,SOT-563,SC-89-6_L1.6-W1.2-P0.50-LS1.6-BL,0,270,+270,90°: no asienta (JLC lo ve); si lo corrige mal: V+<->GND +J1,RESET-EXT,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés (interruptor externo: sin efecto eléctrico) +J2,CUTOFF-SW,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés (interruptor: sin efecto eléctrico) +J3,FAN 2-pin,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés: ventilador con polaridad invertida +J4,PANEL_LED,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés: LED del panel no prende +J16,5V-IN-SD15B05,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés: 5 V de la Mean Well entra invertido -> daño +J10,RGB_LED_EXT,C144395,JST_XH_B4B-XH-A_1x04_P2.50mm_Vertical,CONN-TH_B4B-XH-A-LF-SN,270,90,+180,THT al revés: LED RGB externo no funciona +J8,XBEE-ROW-1 (VCC/DOUT/DIN),C2925557,PinSocket_1x10_P2.00mm_Vertical,HDR-TH_10P-P2.00-V-F,0,270,+270,90° (zócalo simétrico; JLC lo corrige) +J9,XBEE-ROW-2,C2925557,PinSocket_1x10_P2.00mm_Vertical,HDR-TH_10P-P2.00-V-F,0,270,+270,90° (zócalo simétrico; JLC lo corrige) +J14,TTL_UARTB,C5116483,PinHeader_1x04_P2.54mm_Vertical,HDR-TH_4P-P2.54-V-M-1,90,0,+270,90° (header simétrico) +K1,G5V-1 DC5,C28695,Relay_SPDT_Omron_G5V-1,RELAY-TH_G5V-1,0,270,+270,90° (solo entra de una forma) +Y4,32.768kHz,C32346,Crystal_SMD_3215-2Pin_3.2x1.5mm,FC-135R_L3.2-W1.5,270,90,+180,cristal no polarizado: sin efecto diff --git a/docs/hardware/files/rotaciones_V5.7_Rev7.csv b/docs/hardware/files/rotaciones_V5.7_Rev7.csv new file mode 100644 index 0000000..bd8d14a --- /dev/null +++ b/docs/hardware/files/rotaciones_V5.7_Rev7.csv @@ -0,0 +1,21 @@ +Ref,Valor,LCSC,Huella KiCad,Huella de JLC (biblioteca),Rotación en el CPL,Rotación que necesita JLC,FT Rotation Offset,Efecto si JLC lo deja como dice el CPL +U14,LTC4040EUFD,C687163,QFN-24-1EP_4x5mm_P0.5mm_EP2.65x3.65mm,VQFN-24_L5.0-W4.0-P0.50-BL-EP-1,90,270,+180,"180°: pin 1 del LTC4040 cae en el pad 13 -> tarjeta muerta; no se ve en la alineación de pads (QFN simétrico), solo en el punto de pin 1" +C1,100uF/6.3V,C88744,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-FD,0,180,+180,polaridad invertida en /3V3_ETH (+ a GND) +C14,220uF/16V polymer,C881921,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-LS7.2-FD,180,0,+180,polímero invertido en /VEH5V -> se pone en corto: sin 5 V +C30,220uF/16V polymer,C881921,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-LS7.2-FD,0,180,+180,polímero invertido en /3V3_MODEM -> riel del módem en corto +C68,220uF/16V polymer,C881921,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-LS7.2-FD,0,180,+180,polímero invertido en /SW_5V -> etapa RTK en corto +C73,47uF/50V,C165527,CP_Elec_6.3x7.7,CAP-SMD_BD6.3-L6.6-W6.6-FD,180,0,+180,electrolítico invertido en /24V -> se calienta y ventea a 24 V +D20,USBLC6-2SC6,C7519,SOT-23-6,SOT-23-6_L2.9-W1.6-P0.95-LS2.8-BL,180,270,+90,90°: no asienta (JLC lo ve); si lo corrige a 90° en vez de 270°: VBUS<->GND +Q6,IRFR5305,C2624,TO-252-2,TO-252-3_L6.5-W6.1-P4.58-LS9.9-BR,90,270,+180,"180°: el tab cae en los pads de G/S (JLC lo ve). Además FT Position Offset = -1.897,0: con 270° la huella de JLC queda 1.9 mm corrida (Mid Y −118.09 → −119.987)" +U8,TMP102,C99269,SOT-563,SC-89-6_L1.6-W1.2-P0.50-LS1.6-BL,0,270,+270,90°: no asienta (JLC lo ve); si lo corrige mal: V+<->GND +U12,TMP102,C99269,SOT-563,SC-89-6_L1.6-W1.2-P0.50-LS1.6-BL,0,270,+270,90°: no asienta (JLC lo ve); si lo corrige mal: V+<->GND +J1,RESET-EXT,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés (interruptor externo: sin efecto eléctrico) +J2,CUTOFF-SW,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés (interruptor: sin efecto eléctrico) +J3,FAN 2-pin,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés: ventilador con polaridad invertida +J4,PANEL_LED,C158012,JST_XH_B2B-XH-A_1x02_P2.50mm_Vertical,CONN-TH_B2B-XH-A-LF-SN,0,180,+180,THT al revés: LED del panel no prende +J10,RGB_LED_EXT,C144395,JST_XH_B4B-XH-A_1x04_P2.50mm_Vertical,CONN-TH_B4B-XH-A-LF-SN,0,180,+180,THT al revés: LED RGB externo no funciona +J8,XBEE-ROW-1 (VCC/DOUT/DIN),C2925557,PinSocket_1x10_P2.00mm_Vertical,HDR-TH_10P-P2.00-V-F,0,270,+270,90° (zócalo simétrico; JLC lo corrige) +J9,XBEE-ROW-2,C2925557,PinSocket_1x10_P2.00mm_Vertical,HDR-TH_10P-P2.00-V-F,0,270,+270,90° (zócalo simétrico; JLC lo corrige) +J14,TTL_UARTB,C5116483,PinHeader_1x04_P2.54mm_Vertical,HDR-TH_4P-P2.54-V-M-1,90,0,+270,90° (header simétrico) +K1,G5V-1 DC5,C28695,Relay_SPDT_Omron_G5V-1,RELAY-TH_G5V-1,0,270,+270,90° (solo entra de una forma) +Y4,32.768kHz,C32346,Crystal_SMD_3215-2Pin_3.2x1.5mm,FC-135R_L3.2-W1.5,270,90,+180,cristal no polarizado: sin efecto diff --git a/docs/hardware/img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png b/docs/hardware/img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png new file mode 100644 index 0000000000000000000000000000000000000000..aca3d2c078ee5cd40cee4fd0b00fbaa170f448c7 GIT binary patch literal 160938 zcmeEuX$=~Q`a88)nRu8eielB? zrfEn~OuZCESFvCoe)H&^#Yu|d46?P>Fd_f%;^$_AU$4Ob+u2HcT2t)Qq7aI@LCIh8 zqWkp=yvpSFtF-=jmD|6+%Fo+fk-SpT)=t)bqokazxUG$xg1C&NwY|84l)SXKl$@ls zwY{w*{%no!qC5Nh8FXr#&sp#x%rzmYFZEwF(!A@Mk*3KUHWVb1RmOxGubId}!g>#rU8Lt*GcV8!O4^L-X30qfdKRbH~ zPj8O{&UXKPY5x5G{!$NbXGdpuaa#{}2fP%E@95{g-`(S&`+hrnA6su{PqIAz4x4{{ zqQIY@DB$bl>?7dd>}oGy?Ta7m1-$LO{Oo;v1w0%CtOfiKJObA4b^>nJ0Rm3e2kZrG zz3r`i?d=3Syan7m?3^8(@o)0BUmt-l_r;d^NVxfUIQSmK{;50S=Ttj)Ea>mA_O^C) zRsUnJwB2o8aeH<@v13nu@37i`-(j+p5_Z#szcw1T@9yk?RdKQR$0hra2n|ic&(_|)+$$Yi?cE)HotAM%QWUMq z@B3Ku>prAyUH|oj{mKJmQ=Q%Zh*Mg&|M_yAeViTLt$qEx?frHCCDML{*82aW1o1~S z{`GPH@le`IOUZ1smz2gSl$H^fk#Ud|m$#R+5tl}qkwvbNb#RdM{=Mave+T-}|BFZA zkB=7pmwW$@r|j?J{(C!FD&x+?HuV@?J1a3-6TMI9Nm9-g=?B}lJlo86cAuwe!5^Qy z_J8-ee+Aj^kF`rbr#xJLs_TY>*(D~;rborA%go1|R%X6UJF#Y2(vC9UU%P3EFt_)% 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z7LXdAGww#Ki#Vwus>x98K^lxz;BS0E4Xv?+fT5&46IKL)Brcq=+ar*f6YN84=|_yao7_~!%!*>V3VMr;Gude09ci0 za)Gf?i{ga%>Bx}{RzUwUe8SCG;Hdj#Ha^bA@l|X(N64iSi6FY6Sw8#_V>nv?m+FZW zyVtMJ12jwZ3c*POhaCtEhr(VvC1z2FQ|t3K6hZ5fv6Cx=T<~WM-Nus8QYZrouT6D6-`w`?m#pfc(2n5EllAk?(Z)q23 z1ikuXnc7R|3m#rKb@d4vkVfF)Fe7iDo_^jcqU*p`2_PxJ_+IuMSPUHS{S5F^p^cHg zbD!fkZT>}2QyxXM*Jm1UZI=k0F-TQ{>zL3}j>4wV;H};n^Du6q!hrDdIEfnYD9rX30nCBj(Z5W2h~mP zAu=68SoKP|k^rP1Cf=?K=MDD$O0)jk>ZiChonE^-ZgoJScv3GTy%2+;%dgXAvyIy2 zZjL~#?AW9RVL9kPqjK^QWnUbGTBv~U7L1Q3g1yxqGawQN(z|}icyY}|5_5gJBVC6M zIYR)4;>7w%LE1St6k1LkLedsPm(LHhb8o7o87jz=HjLb2d2L;jwn;R>UrVcnGc?4uc=LtTFP0u-{f@6f0~dK zn=p+BfEVD6OkD}50?Ejiag8>ACpdhgZka%=4AmK}+aX^u^877PFIpcE#=pJ0m6RK| z#svXQMbUistpFZB!Qkg#XR@4AX+?ps%mT|IM+2T+@whL)!Q68v&StBE($1%*MFSAF; zrO8tWY2Dz?lQWn_AzkqO`}ZmtCdkj8%5YlM7>k}RMkyT(53$X2#c;}+8&K@I8DBu* zq}*vV&hV05Xc;l!nEtkU*#>i?;*3Er9hp_}xEH#rC)mbmy}wqm9yHixrF=GAKbl1` zJ=8KAs56xeP)ca$=LNJaM-Ct;5Ve3VpHHAF+7Dv?$(?(XKtD#ke5^O!Y-+~QGI_#a zs?ZP2yFsZ_^}SdSIoSOM*+#zy48R(ZTCAi&qN|q9P6p&&aOvi~`qh5e>h^6eWLJb? zCxeA0Xk9!Ub}F2SE=7E0yw^eU?=9I!5K1S3%fA@}j0mbzg8)4!DcTY+(C0NfWm~tm zu*$h&HfAvmyPSr&;vppL(#`02BQlx@j-;CRGG5q$c)8c9$0{3CAlh%@$y+<}AkSm- zeL%Po@~mzc39g2cqpbaHJSX%>o!)Dmi0dl?&M#5JBCy?94Y=x^`X7{*`fs(Lvx`Y#Hsk+MDoy8Y=?ZIT3jI}0ZgDMkk40z2WjS%+M z)C{$283h6<$?dgNXH+xZo<;z<;2lJ{oj%`O{$sQHfQz^ctn@R?z$Q*WzFWEbLJgAM zptZoISHOiBdz4fJDN_2QDtG}yp!S9BzFcAkUmlTfRyOW>NCutXX~+are{ti^T;zqo zvWBIX+^BO}E7D1Bdo|~Gy%c((dRb7F6qZj}QJwpK;C`!LTzrIxKtwT9Z8%c?fvXHn zqG9&*^lTXzUYUIqw0Q?WQ$tzSRCS5Lh<1UxxXPv9V@>j+*wZSnUKavEK4u!p zPHAaF6;B}I5ZvH*4|Y@e`gFr`QE;j?zpDKLE-?hQ|64+=f0g1uoghA78rk6%;O`tX zQ0z=?x6CXNr$Kx&Xm^IAry#N^Hw;FeCy;0;Ed!Po!n6+`_JvLk_2)FiccTd4Z`*J9 z^*aEZn8q3iIbIh>GE>N11>SlxGU*_7pP%d|JbuQ55}^LSINxT64fFGb{+GdD>H@*R z<T$D=VuSTGdt2vlTbf1wxcHN9fR^dT?=Yv{28}vb?WD}^Bn0q!kP=u|su?N{ zv#vI=K86$~b7}b8+oS`3CD;3$>>;fNA<-)XB(jPxe2{%$k6nDnKzK5G)X$fi@Ptr5 zq^{V&nlSNxu~KuZS3v-z|GpT+t{k2qE)5u^k%%+%gQidX&~yoCIZ?WlSK~Y+Etvf> zEGOf!Iv~ zk0Mzs%OE`p9w7{(@AG9bY9?H(hG@_Gk)+s;lm<0t%MG^_CVrsMXzQl8UXQ!+W`1&T zDx&ZKoCzQAiBxp|k$}S+*#P`=+L4;)*-kGDR8BityjCJU+ zJdYIjaJ@Ydr6jzdOntTzG>bMB=9>Fh08#_*F}Wifsm13t6R(~*?`RmA^)Dkzy%2V^ zQNrc3TM_Tj!Fg`I-+R^_D4SJQ?^*9?=f~b&6H>tgD>h!dsxhLD{jNoCW+hl%0UwiI z*pCD?j}F{QLJDrRE4M(JuE{;cmR~WlfQTb%vxBYR!HKOmvG9qCy7jO0>6V{gAIZT+ zEV*OL&hJ}Wdg1b=$;?o}S;HuU*ZA{^@a{t+%N}1UXMe&p8~n>yGrn&#_s^B#UMg!U zZlLU({aI%Ss7Vt_-fLwj=<{9*#2(xhbH7-eb#{0OJWtU2QXi)I208C&Ql7(Su>wCg zUEY#yk+1NvGpZ}DJ{{rgA4Rm-W2m@yU6zMy2hM9LlotT~Y}-#YIx|m`$I5O^o*Z?T z{5JT{7JKGxI7_w_-Pk}DF`}&qc*oI5cvY^b^pARchRrD+z%qvzRXx81ymkcjK`=hn z{CcNQ&H*j$sE3*`0|uiTex1hvrwBC%A()~C-$Wczy|O|7iA>)`-U$7d|Ft$PH=d~B z!{bnKc{-v}58ct6=C3#22D1%ZWKbZ2rY+=-xt&z8So3ZBy;NDO*z)@pmoF3#c1wwT z7ecrV!bKRh0AoALftm&QX0s#%^k3bES}ccck{Ol-Y%;`i-LX`#O8^g4C&QuI7zZce zh2f?$=Jts+QW)hkx9uRsJ)W-`7CM70)yFpXMOh1s# z`a=Sxon_AhkQF!X8O`i1I~TUT+}h=^l-%`X(p}wdu9SKi}S^i9kx!aDy?dxLRX|5?O7oWu=Kgw8%@Zq z!{`QI=ZQX{f)`=QQw(8OObQ_}ibLXg^HE@1{vi)#SI}@cqLR2FaX~|d@n?U&+t!Wz z99#$he^C&9n2D)$(ByTyrN`uP)&Ouupq2s1L)9n576$eDAqiasqU}NwbiusFnNVYM z^AF?EA`=Bq8Oc<*lWMx9pKP=L6^S1aJ`!7z{S~_&ai5z`&p6&J-W0d;?kfWl&F0?6H zS$(iq{z{OQ5ieP80ee*ZS5XQ0;uKV3Y1C+}Z7~{enre-ZeH}6wxN)Lwb+T!*p1)NYh-nrj5fwVmePSA7-}lyvSMatm= zWi7l-z^~sc&TIz?b~K%HICg3?2djo2!VUcpyOzxt#7L(w!R`U7Q1C+(`O{yJ>p$=_ zobTs9-c;2$gI$T9q6&a)Q%#)$cf&3~@&K@z_4|XEzgdtZ_4|g>zIT6Qwz?inS;xVb z?Y$}bd)DrlkJw}ub&Z!aJ%|m~ca;RmrXoRgWpg9OjJ!jNI%lZ)?JY#}pm zcTg$Bc3q21Oo`Yw@5Y7JONqb}0OzX~e9f`R;d`Sgwv45{s2WiG#Zz%7Bm# zC26z_cw3{Dc`Eiho|)%^f{OJ)n)PG!yoTb01qNP2X78^%z4xQJV80uBVI*DudmWm$ z7U;*~OJAP;nBWER%4Q~{RT8rJwwo3oxlPL}D+C}K{U8e}g{Xlh!PPS*n~#Y8Aa48q zVffeok?KX@E@3imZt!-kT*YKJU7Ilyk5hdaE~?D?G_{b#<^!2SDWyAMNK~md>G{rO z_6;QI>*F@O2l$AO)7g~}s8jvd^)?#x+ibwSSD{=DP-ky$kst4PuI2p|zC&G}sYby*qrD z^PfdlN+TphHe4`jTlIfe|ABvhiHBip_NU@2O)H*+^Qd43x`+oEM8m>xi}f+1kj7EA zYvkRL?-rS%%m!dEc7?~CZ#PX){1yHB?7SsAuIYDZ-U|4GQGWscTXS=Bbfd2FrePP} ztSI8(A0QGYXcSa!@EkQRM+;S8zLa0Qv3cub@3QkW3E;HE)2{N;Z9ES8|G!I7QTyWG zb-gyG#D81+=Ksd3W%t?Za?*)xy45KB|MKx^wi|goLFp%=Ig;-p#kbR>c1zM7zcRBe z0*@Bz8wWk<;z?y@PCI5IFoB~Ix%@6o+syaPL`^lhpOm(DX%Y`VWZ!f-tv#Wzun-D- zi5fyiEFd`vb=QynPn!7KlR36i^DoZ=hTz}T<~HWxpZ6&YgXRY+UKynm&`%U(Rb?_S IT)+3f0AS!UH2?qr literal 0 HcmV?d00001 diff --git a/docs/hardware/index.md b/docs/hardware/index.md index 22a2964..790e925 100644 --- a/docs/hardware/index.md +++ b/docs/hardware/index.md @@ -4,9 +4,30 @@ title: "Tarjetas y hardware" # Tarjetas y hardware -Estado de cada versión de la EinarBoard al **22-oct-2026**, con sus documentos vigentes, los históricos y el siguiente paso. ¿No sabes qué tarjeta tienes? [Manuales por tarjeta](../manuales/index.md) te la identifica por serigrafía, conectores y LEDs. Estado vivo (tareas, decisiones, responsables): [Tablero de ingeniería](../tableros/ingenieria.md). +Estado de cada versión de la EinarBoard al **26-oct-2026**, con sus documentos vigentes, los históricos y el siguiente paso. ¿No sabes qué tarjeta tienes? [Manuales por tarjeta](../manuales/index.md) te la identifica por serigrafía, conectores y LEDs. Estado vivo (tareas, decisiones, responsables): [Tablero de ingeniería](../tableros/ingenieria.md). -!!! success "22-oct: auditoría final de producción de V5.6 y V5.7 — GO al piloto de 5 + 5 con tres condiciones de pedido" +!!! danger "26-oct (noche): revisión independiente del pedido de V5.6 y V5.7. Piloto NO-GO hoy; GO al cerrar A1 a A6" + - **El paquete está bien.** Se regeneró idéntico y el CPL coincide con el PCB. DRC: solo los 3 de MOD1, 0 sin conectar y paridad 0. T43 no cambió el netlist y T44 solo cambió la serigrafía. + - **Faltan piezas en JLC aun para el piloto.** Existencia releída en vivo a las 23:36: + - STM32F411RET6: 2. + - AP64350SP-13: 1, sin alterna. Va en consigna y es la ruta crítica. + - SC7A20TR: 2. + - AO4406AL: 0. + - MWSA0804S-4R7MT: 0. + - 12.4 kΩ: 1. + - SRP1265A-100M (V5.7): 0. + - **El CPL tiene rotaciones equivocadas para las huellas de JLC:** 21 en la V5.6 y 20 en la V5.7. + - U14 (LTC4040) va a 180°. + - C1, C14, C30, C68 y C73 van invertidos. + - D20, U8 y U12 van a 90°. + - Q6 va a 180° y además 1.9 mm corrido. + - J16, J3, J4 y J10 van al revés. + - **La V5.5 salió con las mismas rotaciones** y funciona porque JLC las corrigió a mano; no hay que depender de eso. Hay CPL corregidos, y T46 lo deja permanente en KiCad. + - **Volumen (135 / 365): NO-GO** hasta pasar la compuerta de banco con 0.7.0-pre. Mientras, sus piezas se pre-ordenan en paralelo. + + [**▶ Revisión independiente del pedido**](revision-pedido-26oct.md) · CPL propuestos: [V5.6](files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv) · [V5.7](files/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv) · [existencias en JLC](files/existencias_JLC_2026-10-26.csv) + +!!! success "22-oct: auditoría final de producción de V5.6 y V5.7 — GO al piloto de 5 + 5 con tres condiciones de pedido (superado el 26-oct: ver arriba)" - **V5.6 y V5.7 — paquetes verificados.** `HBOX_v5_Rev6_PROD` y `HBOX_v5_Rev7_PROD` son idénticos a una regeneración con relleno fresco (0.000 mm² de diferencia); DRC solo con los 3 de MOD1, 0 sin conectar, paridad solo PWR_FLAG, RS1 Kelvin en las dos; BOM y CPL cuadran con el PCB. Todos los puertos funcionan en hardware; la V5.7 va de 9 a 32 V sin la SD-15B; el apagón del módem de la V5.5 desapareció por diseño. - **Condiciones del pedido (no tocan el cobre):** (1) vías *Epoxy Filled & Capped* + rayos X en U6 (3 vías dentro de la pasta del QFN); (2) rotación y polaridad en el visor de JLC (U6, U7, U25, U26, L22, Q7, U16, D34, D10, electrolíticos: huellas easyeda2kicad nunca fabricadas); (3) BOM: D10 SMBJ33A → SMBJ33CA. - **NO-GO para las 108 / 322** hasta que el piloto pase el banco con el firmware 0.7.0: hoy ningún firmware enciende el módem de estas tarjetas. `board_v56.h` ya existe; 0.7.0-pre (módem, NTC, LFP, ignición por ADC) es 1 día y va antes de que lleguen las tarjetas. @@ -33,8 +54,8 @@ Estado de cada versión de la EinarBoard al **22-oct-2026**, con sus documentos | Tarjeta | Estado | Pedido | Proyecto KiCad | Firmware | |---|---|---|---|---| | V5.5 | En campo (15 pzas, 22-ago). No se fabrica más. | — | `hbox-watchdog-v5` (tag `v5.5-as-fabbed`) | `hbox-v5-bringup_0.6.0` CAMPO · 0.6.3 banco | -| V5.6 | **Auditoría final del 22-oct: GO al piloto** con tres condiciones de pedido (vías tapadas + rayos X en U6, visor de JLC, D10 → SMBJ33CA). Paquete `HBOX_v5_Rev6_PROD` verificado = cobre con relleno fresco; DRC y paridad limpios. P-1 cerrado a las 13:00 (relleno fresco en el repo, re-verificado; falta el commit) ([auditoría final](auditoria-final-22oct.md)). **T42a** aplicado (D-22-7: a): BOM con existencia y `/IGN_IN` a 0.3 mm ([victorias rápidas](v56-v57-victorias-rapidas-22oct.md)). **T43:** designadores en orden y Rev6 regenerado ([designadores](designadores-t43-22oct.md)). **T44** (23-oct): serigrafía de 0.8 mm, Rev6 regenerado, solo cambia la serigrafía ([T44](v6-t44-serigrafia.md)). [**Documento de diseño**](diseno-v56.md). | 113 (piloto de 5 primero, se pide hoy) | `hbox-watchdog-v5` | 0.7.0: `board_v56.h` listo; 0.7.0-pre por escribir (1 día) | -| V5.7 | **Auditoría final del 22-oct: GO a los 5 prototipos** con las mismas condiciones. Fuente U25 a 5.32 V / 600 kHz: 9–32 V sin la SD-15B; C149/C150 se quedan (D-21-2) y el timbre se mide en banco; D10 → SMBJ33CA es obligatorio aquí (con el arnés al revés abre F2, que es SMD) ([auditoría final](auditoria-final-22oct.md)). **T42a** aplicado, con la 2.ª vía de `/SYS5V` (E-11) ([victorias rápidas](v56-v57-victorias-rapidas-22oct.md)). **T43:** designadores en orden, «IGN 12-24V» y Rev7 regenerado ([designadores](designadores-t43-22oct.md)). **T44** (23-oct): serigrafía de 0.8 mm, Rev7 regenerado, solo cambia la serigrafía ([T44](v6-t44-serigrafia.md)). [**Documento de diseño**](diseno-v57.md). | 327 (5 prototipos primero, se piden hoy) | `hbox-watchdog-v57` (convive con v5) | el mismo 0.7.0 (mismos pines de MCU) | +| V5.6 | **26-oct: piloto NO-GO hasta cerrar A1 a A6**: 7 piezas sin existencia en JLC y 21 rotaciones del CPL que corregir ([revisión independiente](revision-pedido-26oct.md)). Antes: **Auditoría final del 22-oct: GO al piloto** con tres condiciones de pedido (vías tapadas + rayos X en U6, visor de JLC, D10 → SMBJ33CA). Paquete `HBOX_v5_Rev6_PROD` verificado = cobre con relleno fresco; DRC y paridad limpios. P-1 cerrado a las 13:00 (relleno fresco en el repo, re-verificado; falta el commit) ([auditoría final](auditoria-final-22oct.md)). **T42a** aplicado (D-22-7: a): BOM con existencia y `/IGN_IN` a 0.3 mm ([victorias rápidas](v56-v57-victorias-rapidas-22oct.md)). **T43:** designadores en orden y Rev6 regenerado ([designadores](designadores-t43-22oct.md)). **T44** (23-oct): serigrafía de 0.8 mm, Rev6 regenerado, solo cambia la serigrafía ([T44](v6-t44-serigrafia.md)). [**Documento de diseño**](diseno-v56.md). | 113 (piloto de 5 primero, se pide hoy) | `hbox-watchdog-v5` | 0.7.0: `board_v56.h` listo; 0.7.0-pre por escribir (1 día) | +| V5.7 | **26-oct: piloto NO-GO hasta cerrar A1 a A6**: 7 piezas sin existencia en JLC (con SRP1265A-100M) y 20 rotaciones del CPL que corregir ([revisión independiente](revision-pedido-26oct.md)). Antes: **Auditoría final del 22-oct: GO a los 5 prototipos** con las mismas condiciones. Fuente U25 a 5.32 V / 600 kHz: 9–32 V sin la SD-15B; C149/C150 se quedan (D-21-2) y el timbre se mide en banco; D10 → SMBJ33CA es obligatorio aquí (con el arnés al revés abre F2, que es SMD) ([auditoría final](auditoria-final-22oct.md)). **T42a** aplicado, con la 2.ª vía de `/SYS5V` (E-11) ([victorias rápidas](v56-v57-victorias-rapidas-22oct.md)). **T43:** designadores en orden, «IGN 12-24V» y Rev7 regenerado ([designadores](designadores-t43-22oct.md)). **T44** (23-oct): serigrafía de 0.8 mm, Rev7 regenerado, solo cambia la serigrafía ([T44](v6-t44-serigrafia.md)). [**Documento de diseño**](diseno-v57.md). | 327 (5 prototipos primero, se piden hoy) | `hbox-watchdog-v57` (convive con v5) | el mismo 0.7.0 (mismos pines de MCU) | | v6 | Revisada el 22-oct (`d5f5002` + T40): **NO LISTA**. T28 cerró 2 de los 8 bloqueantes de la [auditoría v6](v6-auditoria-produccion-16oct.md), T25 regresó los barrenos, T38 corrigió courtyards, MH6 y el `/3V3` bajo los barrenos, **T39 hizo el bloque A** (D34 entre U25 y L22, MH8 libre) y **T40 liberó MH4**. Faltan los bloques B a H y D-22-4 ([estado, §7](v6-estado-21oct.md#7-t40-22-oct-tarde-mh4-libre)). **T43:** designadores en orden ([tabla](designadores-t43-22oct.md)). **T44:** serigrafía de 0.8 mm, 338 de 350; 12 para Michelle ([T44](v6-t44-serigrafia.md)). **26-oct:** revisión del fin de semana: avance en el bloque B, **regresión en la toma VIN de R80** y los bloques C, D y E sin empezar; G1 en riesgo, D-26-1 para Leo ([revisión](v6-revision-26oct.md)). [**Documento de diseño**](diseno-v6.md). Plan: [fines de semana 24-oct → 22-nov, rev. 1.7](v6-plan-fines-de-semana.md). | 130 + reemplazos (piloto de 20, pedido previsto el 2-nov) | `hbox-watchdog-v6` | 0.7.x (`board_v6.h` + NTRIP), no existe | | V4 | En prueba y campo. Sin producción nueva. | — | `hbox-watchdog-v4` | `hbox-tarjetaV4_0.6.0` CAMPO | | V3 | 3 unidades en campo. Registro congelado. | — | `hbox-watchdog-v3-PROD` (no editar) | `hbox-tarjetaV3_4.0.0` | diff --git a/docs/hardware/revision-pedido-26oct.md b/docs/hardware/revision-pedido-26oct.md new file mode 100644 index 0000000..615853d --- /dev/null +++ b/docs/hardware/revision-pedido-26oct.md @@ -0,0 +1,378 @@ +--- +title: "Revisión independiente del pedido a JLCPCB: EinarBoard V5.6 y V5.7" +date: 2026-10-26 +version: 1.0 +status: "PARA DECISIÓN DE LEO. Piloto: NO-GO hoy, GO en cuanto se cierren A1 a A6. Volumen: NO-GO hasta que el piloto pase la compuerta de banco con el firmware 0.7.0-pre." +author: "Helgen Technologies (revisión independiente: Claude)" +audience: Leo (decide y paga), Aldair (paquete y pedido), Adriana (compras), Jesús (banco) +--- + +# Revisión independiente del pedido a JLCPCB: V5.6 y V5.7 + +*26-oct-2026. Archivos revisados: HBox_PCB en `9a6f250`. Los archivos de la V5.6 y la V5.7 no cambian desde `d19c832`. Paquetes `HBOX_v5_Rev6_PROD` y `HBOX_v5_Rev7_PROD` del 23-oct, 09:08. Existencias de JLC leídas en vivo el 26-oct a las 22:40.* + +**Pregunta:** ¿qué puede hacer que el pedido falle? Se buscaron tarjetas que no funcionen, que no se puedan ensamblar, que no quepan o que se queden esperando piezas. Todo se revisó otra vez. Las conclusiones de las auditorías del 22 al 26-oct se tomaron como algo por comprobar, no como dato. + +## 1. Veredicto + +| | Piloto (5 piezas) | Volumen (costeo del 26-oct) | +|---|---|---| +| **V5.6** (`hbox-watchdog-v5` / `HBOX_v5_Rev6_PROD`) | **NO-GO hoy.** GO en cuanto se cierren A1 a A6 (§4) | **NO-GO para las 135** hasta pasar la compuerta de banco (§8) | +| **V5.7** (`hbox-watchdog-v57` / `HBOX_v5_Rev7_PROD`) | **NO-GO hoy.** GO en cuanto se cierren A1 a A6 (§4) | **NO-GO para las 365** hasta pasar la compuerta de banco (§8) | + +!!! success "Lo que está bien, y está muy bien" + - **El paquete es la tarjeta.** Se regeneró desde los archivos del repositorio con el mismo Fabrication Toolkit. Los 15 Gerber y taladros salen **idénticos** salvo la línea de fecha. El BOM y el CPL salen **idénticos byte por byte**. + - El CPL coincide con el PCB en las 226 y 229 piezas, en posición, cara y rotación. + - **T43 no cambió el netlist** y **T44/T44b solo cambiaron la serigrafía**. Se comprobó por estructura, no por fecha. + - **DRC:** 3 errores, que son los NPTH de MOD1 excluidos por diseño. **0 sin conectar y 0 de paridad. ERC con 0 errores.** + - Barrenos y contorno iguales al Gerber de la V5.5 que sí se fabricó. Solo falta MH11. + - `board_v56.h` coincide con el netlist en los 31 pines que define. + +!!! danger "Lo que impide pagar hoy" + 1. **Faltan piezas en JLC aun para el piloto.** De 6 piezas de la V5.6 y 7 de la V5.7 no hay existencia ni para 5 tarjetas: STM32F411RET6 (**2**), AP64350SP-13 (**1**), SC7A20TR (**2**), AO4406AL (**0**), MWSA0804S-4R7MT (**0**), 12.4 kΩ 1 % (**1**) y, en la V5.7, SRP1265A-100M (**0**). JLC no arranca un pedido con faltantes. La auditoría del 22-oct dijo «GO hoy» con la base local de JLC del 1-ago. + 2. **El CPL manda 21 piezas (V5.6) y 20 (V5.7) con una rotación que no coincide con la huella que JLC tiene para esa pieza.** Entre ellas está el **LTC4040 U14, girado 180°**, y los **5 capacitores polarizados, invertidos**. + - La V5.5 se mandó con las mismas rotaciones en el LTC4040, los electrolíticos, el DPAK, el TMP102 y el JST del 5 V; la V4, en el LTC4040 y los electrolíticos. Esas tarjetas funcionan, así que JLC (o quien revisó el visor) las corrigió. + - No hay que depender de eso. Un LTC4040 girado 180° asienta perfecto en sus pads y solo se nota por el punto de pin 1. + 3. **No existe firmware para estas tarjetas** (0.7.0). Sin él, el piloto no se puede evaluar. Hay que empezarlo ya, no cuando lleguen. + +!!! note "Verificación de Claude (26-oct, 23:40) sobre esta revisión" + - **Rotaciones: confirmadas con otro script.** Se repitió la comparación con código propio, pad por pad y viendo qué es cada pad: + - En las huellas de JLC de C1, C14, C30, C68 y C73, el pad 1 es el «+» (la serigrafía de JLC lo marca), igual que en KiCad. + - En los LED de JLC, el pad 1 es el ánodo; en KiCad es el cátodo. + - Resultado: las mismas 21 (V5.6) y 20 (V5.7) correcciones del CPL propuesto, y los LED se quedan como están. + - **Una corrección más: la posición de Q6.** Con la rotación ya corregida, la huella de JLC del IRFR5305 queda **1.9 mm corrida** hacia la pestaña: su origen es el centro del encapsulado y el de KiCad no. Las patas de G y S quedarían en la orilla de sus pads. El CPL propuesto ya trae Q6 con `Mid Y = −119.987` (antes −118.09), en las dos tarjetas. En KiCad se fija con `FT Position Offset = -1.897,0`. Las demás piezas quedan a ≤ 0.3 mm de sus pads. + - **Existencias: confirmadas.** Se releyeron en vivo a las 23:36 desde la Mac: son las mismas cifras de la §6.6. + - **De paso, la v6.** Sus tres piezas de pre-orden ya tienen existencia en JLC: THVD1410DR 7 306, TPS7A2033PDBVR 150 147 y SF72S006 11 661. Para las 20 del piloto de la v6 ya no hace falta pre-ordenarlas; hay que releer el día del pedido. + +!!! tip "Ajustes de Claude a las acciones, para que el piloto sea igual al volumen" + - **A1, por el camino (c) y con script (T46).** Claude agrega `FT Rotation Offset` a las 21/20 piezas y `FT Position Offset` a Q6, en el esquemático y en el PCB. Luego regenera Rev6/Rev7 y comprueba que el CPL nuevo sea igual al propuesto. + - Solo cambian campos; el cobre no se toca. + - Se corre con KiCad cerrado y con el visto bueno de Leo. + - Así el piloto y el volumen salen del mismo paquete y nadie tiene que girar piezas a mano en el visor. + - **A2: el STM32F411RET6 en consigna, en el mismo envío que el AP64350**, en lugar de cambiar al RCT6. + - El AP64350 ya obliga a esperar la consigna, así que no cuesta días. + - El piloto queda con la misma memoria que el volumen: el mapa de flash de FOTA (D-22-6) es de 512 KB. + - El RCT6 queda como plan B. + - **A2: alternas que también sirvan para el volumen.** La LIS2DH12TR (22 109 en existencia) alcanza para las 500 y es la pieza original de ST: mejor que pre-ordenar la SC7A20. La AO4406A (C2944312, 31 017) también alcanza. + - **L2, la bobina de U13.** U13 baja de `/SYS5V` (4.8–5.3 V) a 3.33 V, con ciclo de trabajo de 0.63 a 0.70. + - Con menos inductancia sube la pendiente de bajada de la corriente. En control por corriente pico, eso le quita margen contra la oscilación subarmónica. + - Con la de 3.3 µH, revisar en el banco a 4.8 V de entrada (respaldo) con escalón de carga. + - La de 6.8 µH (C17700169, 276 en existencia) es la opción con más margen para el piloto. + - **A8, una revisión más en una V5.5.** Ver que la muesca de P2 (5 V), P4, P6, P8, P11 y P14 esté como dice la serigrafía. + - Si JLC no las corrigió en la V5.5, los arneses se armaron para esa posición, y en una V5.6/V5.7 bien armada el 5 V entraría al revés. + - De paso, ver el punto del pin 1 de U6 y la franja de C10, C3, C43, C78 y C103. Confirma que JLC sí corrigió la V5.5 a mano. + - **Headers de MOD1 para el piloto.** Tener 10 juegos a la mano (4 por tarjeta, 32 pines) y soldarlos al llegar las tarjetas: JLC no los pone. + +## 2. Matriz de riesgos (si se pagara hoy como está) + +S = severidad y P = probabilidad, de 1 a 5. Ordenados por S × P. + +| # | Riesgo | Tarjeta | S | P | S×P | Mitigación (acción) | +|---|---|---|---|---|---|---| +| R1 | Faltantes en JLC (7 piezas) bloquean incluso el piloto | ambas | 4 | 5 | **20** | A2: alternas verificadas (§6.6) y consigna del AP64350 | +| R2 | 0.7.0 no existe: el piloto llega y no se puede probar (ni siquiera enciende el módem) | ambas | 4 | 4 | **16** | A7: 0.7.0-pre antes de que lleguen las tarjetas | +| R3 | Pedir el volumen antes del banco. La V5.5 tuvo un defecto de diseño que solo salió en banco: el módem no arranca en batería, lo que obligó a hacer la V5.6. La V5.5 y la V4 tuvieron además puentes de soldadura en el LTC4040 | ambas | 5 | 3 | **15** | No pagar volumen; pre-ordenar sus piezas en paralelo (§7) | +| R4 | U14 LTC4040: el CPL dice 90° y la pieza de JLC necesita 270°. Girado 180° = tarjeta muerta, y el QFN no se retrabaja fácil | ambas | 5 | 2 | **10** | A1 (rotación) y revisión del pin 1 en «Confirm production file» | +| R5 | C1, C14, C30, C68 y C73 invertidos: los polímeros se ponen en corto y el de 50 V ventea a 24 V | ambas | 5 | 2 | **10** | A1 | +| R6 | Headers de MOD1 (32 pines) fuera del BOM: 16 000 soldaduras a mano en las 500 | ambas | 2 | 5 | **10** | B6: presupuestarlo o pasarlo al BOM en la siguiente revisión | +| R7 | Arneses: los JST del borde superior se movieron 12 a 38 mm (J10 de la V5.7, 66.6 mm). Con T43 cambiaron los nombres (P2 → J16, P4 → J5…) | ambas | 3 | 3 | 9 | A8 | +| R8 | La existencia y el precio cambian antes de pagar (el STM32 pasó de 6 a 2 en una tarde) | ambas | 3 | 3 | 9 | Releer existencias el día del pago | +| R9 | D20, U8 y U12 van a 90° de lo correcto. JLC tiene que escoger una de dos; si escoge mal, VBUS ↔ GND o V+ ↔ GND | ambas | 4 | 2 | 8 | A1 | +| R10 | J16 (5 V de la Mean Well), J3, J4 y J10 (JST THT) quedan a 180° de la huella de JLC: arnés con polaridad invertida | V5.6 (J16) · ambas | 4 | 2 | 8 | A1 y revisión del visor THT | +| R11 | Si no se pide «Epoxy Filled & Capped», 11 vías (V5.6) y 19 (V5.7) quedan en pads: EP de U14, U13, U9 y U15, y en la V5.7 también C74, C75 y D21 | ambas | 4 | 2 | 8 | A3 | +| R12 | U13 (y U15 de la V5.7): EP con 100 % de pasta sobre 4 a 6 vías → la pieza flota y las patas quedan abiertas | ambas | 3 | 2 | 6 | A3 (rayos X si JLC lo ofrece); pasta al 60–70 % en la siguiente revisión | +| R13 | Una alterna trae su propia huella de JLC (la SC7A20HTR necesita +90°; la C970679 tiene el mismo problema que C73) | ambas | 3 | 2 | 6 | A2: revisar la rotación de toda alterna | +| R14 | Inductores MWSA0804S sobre pads SRU8028 de 3.2 mm; la huella de JLC para esa pieza usa 5.5 mm. Ya probado en la V5.5; vibración en grúas | ambas | 2 | 2 | 4 | Banco; huella `IND-SMD_MWSA0804S` en la siguiente revisión | +| R15 | U15 MP1584 (ventilador) en `/24V`: opera hasta 28 V y la TVS recorta entre 36.7 y 53 V. Bien solo con la fuente regulada del gabinete | V5.6 | 3 | 1 | 3 | Manual de instalación | +| R16 | EN de U15 (TPS54360B) flotando a 0.15 mm de `/24V` (R78/R79 DNP; EN aguanta 8.4 V) | V5.7 | 3 | 1 | 3 | T42b, o poblar R78/R79 | +| R17 | `production/netlist.ipc` es el de la V5.7. Subirlo con la V5.6 da un falso «corto» en la prueba eléctrica | V5.6 | 2 | 1 | 2 | A5 | + +![Rotación del CPL contra la huella de JLC](img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png) + +*Arriba: cómo colocaría JLC su huella de biblioteca con la rotación que trae hoy el CPL. En rojo, la huella de JLC y su pin 1 (×). En gris, los pads de la tarjeta y su pin 1 (●). Abajo, en verde, la rotación corregida. Huellas tomadas de la biblioteca de JLC/EasyEDA por código LCSC.* + +## 3. Lo que contradice a las auditorías anteriores + +1. **«GO al piloto de 5 + 5, hoy»** (auditoría final, 22-oct). Hoy no se puede: 7 piezas no alcanzan ni para 5 tarjetas (§6.6). Esa auditoría usó la copia local de la base de JLC del 1-ago. +2. **«Rotación de U7, U25, U26 y L22 (easyeda2kicad), nunca fabricadas»** (P-3 y R2 del 22-oct). Esas cuatro, hoy U13, U15 (V5.7), U1 y L4 (V5.7), tienen la rotación correcta. Salen de la misma biblioteca de JLC, así que coinciden por construcción: U13, U1 y L4 con error menor a 0.01 mm. U15 queda a 0.2 mm porque su huella se copió de la del AP64350 (EP de 3.2 × 2.5 mm; la de JLC para el TPS54360B trae 2.0 × 2.0). El riesgo real está en huellas de la **biblioteca de KiCad** donde la tabla genérica del Fabrication Toolkit no coincide con la pieza concreta de JLC: + - QFN: la tabla suma +90 y este LTC4040 necesita +270. + - `CP_Elec`: la tabla suma +180 y estos tres capacitores necesitan 0. + - SOT-23-6, SOT-563, DPAK y los JST XH. + - La lista completa está en el §6.3. +3. **Costeo del 26-oct: «SC7A20: una alterna pide huella y firmware».** No es así. La **LIS2DH12TR** (C110926, 22 109 en existencia) usa la misma huella LGA-12 y la misma rotación. La SC7A20HTR (C19274408, 85 021) usa la misma huella con +90° en el CPL. El driver todavía no existe, así que no hay firmware que cambiar. +4. **Costeo del 26-oct: «cada tarjeta es un pedido aparte, colocados el mismo día».** Choca con el NO-GO de volumen de la auditoría final, que esta revisión confirma. Y aunque se pagara, el volumen no arrancaría: faltan STM32, AP64350 y SC7A20 para 500. +5. **Costeo: «MOD1 y J8/J9 son zócalos».** J8 y J9 (XBee) sí están en el BOM y JLC los suelda. MOD1 no: los 4 headers del simpleRTK2B (32 pines) no los compra ni los suelda JLC. Al costeo le falta ese material y esa mano de obra. +6. **Paridad.** La auditoría habla de «13 de paridad (PWR_FLAG)»; hoy son **0**. Se comprobó que la paridad sí corre: un valor cambiado a propósito en una copia la dispara. + +## 4. Antes de pagar el piloto (A1 a A9) + +| # | Acción | Quién | Tiempo | +|---|---|---|---| +| **A1** | **Corregir las rotaciones del CPL** (y la posición de Q6). Hay tres caminos:
(a) subir el CPL propuesto [`HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv`](files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv) / [`…Rev7…`](files/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv) (§6.3; ya trae la posición de Q6) y revisar en el visor;
(b) subir el CPL de siempre y girar a mano en el visor las piezas de la tabla del §6.3;
(c) lo permanente: agregar el campo `FT Rotation Offset` (columna de la tabla) a esas huellas, en el esquemático y en el PCB, y regenerar.
En cualquier caso, **con «Confirm production file» activado**, revisar en la imagen final de JLC: pin 1 de U14, D20, U8, U12 y Q6; la franja negra (−) de C1, C14, C30, C68 y C73 opuesta al «+» de la serigrafía; la pestaña de los JST J1–J4, J10 y J16 del lado del contorno de la serigrafía. **No girar los LED D1 y D13–D17**: JLC numera sus pads al revés que KiCad, pero la polaridad ya sale bien. | Aldair · Leo | 30 min | +| **A2** | **Resolver los faltantes del piloto** (tabla del §6.6):
STM32F411**RC**T6 (C222222), LIS2DH12TR (C110926), AO4406A (C2944312), MWSA0804S-3R3MT (C17700166), SRP1265A-150M (C189912) o -6R8M (C2041326) y 12.4 kΩ C22865.
**El AP64350SP-13 no tiene alterna pin a pin con existencia**: comprarlo a un distribuidor (Digi-Key, Mouser, Future) y mandarlo en consigna, o pedirlo por Global Sourcing de JLC. **Es la ruta crítica del piloto.**
Revisar la rotación de cada alterna en el visor. | Adriana (compra) · Leo (decide) | 1 día; AP64350 ≈ 1 semana | +| **A3** | **Opciones de la PCB:** 4 capas, 1.6 mm, JLC04161H-7628, ENIG, **Via covering: Epoxy Filled & Capped (obligatorio)** y «Confirm production file». En las notas de ensamble, **rayos X en U14** y en U1; en U13 (y U15 de la V5.7) si JLC lo ofrece. | Aldair · Leo | 10 min | +| **A4** | Releer existencias y precios en el carrito el mismo día del pago. Esta lista es de las 22:40 del 26-oct. | Aldair | 10 min | +| **A5** | No subir `production/netlist.ipc`: es el de la V5.7 y no lo pide JLC. | Aldair | — | +| **A6** | Dejar un solo renglón por código LCSC, unificando el `Value`: C45783, C25803, C17700171 (V5.6) y C5440143 (V5.7) salen hoy en dos renglones cada uno. Así JLC no cobra dos cargas de alimentador ni pregunta. Los conectores también se repiten por su nombre de función (C158012 en 4 o 5 renglones; C5160226, C7095263, C2925557 y C83205 en 2); unificarlos es opcional. | Leo | 10 min | +| A7 | **Arrancar 0.7.0-pre ya:** MODEM_EN en PC3, ignición por ADC, NTC_CELL, umbrales LFP y EFCR del SC16IS752. Si se usa el STM32F411RCT6, compilar para `GENERIC_F411RCTX`: la emulación de EEPROM usa el último sector, en `0x08020000`, y el binario tiene que quedar abajo de 128 KB; 0.6.3 pesa 99.6 KB. | Leo + Claude | 1–2 días | +| A8 | Actualizar procedimientos y etiquetas de arneses a los designadores de T43 (J16, J5, J3, J4, J2, J1, J10) y medir en una V5.5 si los arneses alcanzan las nuevas posiciones (§6.7). | Jesús | ½ día | +| A9 | Preparar el banco de la compuerta (§8): fuente de 9 a 32 V con límite de corriente, carga electrónica, osciloscopio, cámara térmica y paquete LFP. | Jesús | ½ día | + +## 5. Antes de pagar el volumen (B1 a B7) + +- **B1.** El piloto pasa la compuerta del §8 en al menos 4 de 5 tarjetas de cada versión, y en todas las pruebas de seguridad (polaridad, rieles, temperatura). Si algo falla: corrección y otro piloto, no retrabajo de 500. +- **B2.** Las rotaciones quedan corregidas en KiCad (A1-c) y el paquete se regenera. El volumen no debe depender de que alguien gire 20 piezas a mano en el visor. +- **B3.** **Pre-ordenar ya, en paralelo al piloto**, las piezas exactas del volumen al inventario de JLC: STM32F411RET6, AP64350SP-13, SC7A20 o LIS2DH12, AO4406, MWSA0804S-4R7MT (o la alterna que pase el banco) y SRP1265A-100M. Así el volumen arranca el día que pasa el banco, y la espera del piloto se traslapa con la de las piezas. +- **B4.** Apartar el LTC4040 (2 211 en existencia para unas 520 V5.x más 60 v6) y el SC16IS752, que son las piezas caras de una sola fuente. +- **B5.** Decidir T42b (clase HV24 con los patrones con diagonal) antes del volumen. No es riesgo eléctrico a 32 V o menos; es la regla del equipo. +- **B6.** Headers de MOD1: comprar 500 juegos y presupuestar 16 000 soldaduras a mano, o pasarlos al BOM (4 huellas `PinSocket` en lugar de MOD1) en la siguiente revisión. +- **B7.** 0.7.0 de campo completo: ciclo de 10 min, driver del SC16IS752 y Ethernet de campo. + +## 6. Hallazgos por tema + +### 6.1 El paquete es la tarjeta ✅ + +- **Gerber y taladros.** `tools/fab_package.py`, el mismo Fabrication Toolkit, se corrió sobre copias del proyecto con `.kicad_pro`, `.kicad_dru` y bibliotecas en `_to_delete/review-20261026/fab_v5` y `fab_v57`. Salieron 15 de 15 archivos idénticos a los de los zip del repositorio. Solo cambian `CreationDate` y «Created by … date». +- **BOM y CPL**, idénticos byte por byte: + - V5.6: zip `cb1ea9cc…`, BOM `41f28dff…`, CPL `af3f0acb…`. + - V5.7: zip `4bb4f9cd…`, BOM `33483b65…`, CPL `25220589…`. + - Tarjetas: `ee846ebe…` y `1f6bf63c…`, iguales al HEAD; el árbol de git está limpio. +- **CPL contra PCB.** Se reprodujo el cálculo del plugin desde el `.kicad_pcb`: ancla en SMD, centro de pads en THT y tabla de rotaciones. + - 226/226 y 229/229 piezas sin diferencia de posición (< 2 µm), de cara (todo arriba) ni de rotación. + - Fuera del CPL y del BOM, como debe: JP1–JP6, TP1–TP7, MH1–MH6, MOD1, R37 (DNP) y, en la V5.7, R78/R79 (DNP). +- **BOM contra esquemático.** Paridad 0, incluidos valor, huella, LCSC y DNP. Los 96 y 105 códigos (107 y 115 renglones) existen en JLC y coinciden en valor, voltaje y paquete con la descripción de la pieza. +- **Piezas THT que JLC cotizará y soldará:** + - V5.6: **19 piezas, 120 uniones por tarjeta**: J1–J16, K1, SW1 y SW2. J7 y J13 son los USB4085 de pines pasantes. + - V5.7: **18 piezas, 118 uniones** (sin J16). + - Las cifras cuadran con el costeo: 16 200 / 135 y 43 070 / 365. + +### 6.2 DRC, ERC y paridad (copias con proyecto, relleno, paridad y todos los errores de pista) + +| | V5.6 | V5.7 | +|---|---|---| +| Errores | 3 `npth_inside_courtyard` (MH2, MH4 y MH5 dentro de MOD1; excluidos en el `.kicad_pro` por T34/T36, y las 3 exclusiones apuntan exactamente a esos 3) | 3, los mismos | +| Avisos | 87 `lib_footprint_mismatch` · 6 `lib_footprint_issues` (biblioteca MountingHole no instalada) · 2 `silk_edge_clearance` (contorno de MOD1 fuera del borde, igual que en la V5.5) · 1 `silk_over_copper` (MOD1 sobre MH6) | 89 · 6 · 2 · 1 | +| Sin conectar · paridad | 0 · 0 | 0 · 0 | +| ERC | 0 errores; 17 `lib_symbol_mismatch`, 7 `lib_symbol_issues`, 1 cabo de cable de 0.033 mm | 0 errores; 19 · 7 · 1 | + +**Lo que el `.kicad_pro` apaga** (`ignore`): `missing_courtyard`, `footprint_type_mismatch`, `footprint_filters_mismatch`, `track_not_centered_on_via` y `tuning_profile_track_geometries`. Se revisó por fuera: + +- Todas las piezas colocadas tienen courtyard. +- Ninguna tiene el atributo SMD/THT en contra de sus pads. +- No hay nada sin conectar. + +Nada útil queda escondido. Las reglas bajadas a aviso (`hole_to_hole`, `copper_sliver`, `isolated_copper`, `track_dangling`…) no aparecen ni una vez. + +### 6.3 Rotación y polaridad: lo que verá JLC + +**Método.** Para cada código LCSC se bajó la huella que JLC usa para esa pieza (biblioteca de JLC/EasyEDA). Se giró con la rotación del CPL, en sentido antihorario visto desde arriba, como el resto del flujo de JLC, y se comparó pad por pad con la tarjeta. + +- **Validación.** Donde la tabla del Toolkit es conocida y buena, el método da exactamente lo que se fabricó bien en la V5.5: STM32 (LQFP-64), W5500, SC16IS752, PCF8574, TRS3232E, SP3485, MP1584, AO4406A, los SOT-23 y el SOT-223. El error va de 0.003 a 0.26 mm, que son las diferencias normales entre dos dibujos de la misma huella. +- **Ya correctas tal como están:** + - Las huellas easyeda2kicad: U13, U1 y, en la V5.7, U15 y L4. + - Todos los diodos SMD (cátodo en el pad 1 en las dos bibliotecas) y los LED. + - L1–L4, J5, J6, J7, J11, J12, J13, J15, F1, F2, los cristales de 25 y 3.6864 MHz y todas las R y C no polarizadas. + +| Ref | Pieza | CPL hoy | JLC necesita | `FT Rotation Offset` | Si JLC lo deja como dice el CPL | +|---|---|---|---|---|---| +| **U14** | LTC4040 QFN-24 (VQFN-24…-BL) | 90 | **270** | +180 | Girado 180°: el pin 1 cae en el pad 13, con VIN sobre BSTFB → tarjeta muerta. **No se nota en los pads**, solo en el punto de pin 1 | +| **C1** | 100 µF en `/3V3_ETH` | 0 | **180** | +180 | Invertido | +| **C14** | 220 µF polímero en `/VEH5V` | 180 | **0** | +180 | Invertido → corto: sin 5 V | +| **C30** | 220 µF polímero en `/3V3_MODEM` | 0 | **180** | +180 | Invertido → riel del módem en corto | +| **C68** | 220 µF polímero en `/SW_5V` | 0 | **180** | +180 | Invertido → etapa RTK en corto | +| **C73** | 47 µF/50 V en `/24V` | 180 | **0** | +180 | Invertido a 24 V → se calienta y ventea | +| **D20** | USBLC6-2SC6 (SOT-23-6) | 180 | **270** | +90 | 90°: no asienta. Si JLC lo corrige a 90° y no a 270°: VBUS ↔ GND | +| **Q6** | IRFR5305 (DPAK) | 90 | **270** | +180 y `FT Position Offset = -1.897,0` | 180°: la pestaña cae sobre los pads de G/S (JLC lo ve). Aun con 270°, la huella de JLC queda 1.9 mm corrida: `Mid Y` va de −118.09 a −119.987 (verificación de Claude) | +| **U8, U12** | TMP102 (SOT-563) | 0 | **270** | +270 | 90°: no asienta. Si se corrige mal: V+ ↔ GND y SCL ↔ ADD0 | +| **J16** | JST XH 2P, 5 V de la Mean Well (V5.6) | 0 | **180** | +180 | Conector al revés → el arnés mete el 5 V invertido | +| **J3, J4** | JST XH 2P ventilador / LED del panel | 0 | **180** | +180 | Ventilador y LED con polaridad invertida | +| **J10** | JST XH 4P RGB | 270 (V5.6) / 0 (V5.7) | 90 / 180 | +180 | LED RGB externo al revés | +| J1, J2 | JST XH 2P interruptores | 0 | 180 | +180 | Sin efecto eléctrico (contactos secos) | +| J8, J9, J14, K1 | Zócalos y header simétricos; relevador | 0, 0, 90, 0 | +270 | +270 | 90°: sin efecto (simétricos, o el relevador solo entra de una forma); solo dispara la pregunta de JLC | +| Y4 | Cristal de 32.768 kHz | 270 | 90 | +180 | Sin efecto (no polarizado) | + +En la V5.7 es igual, menos J16, que no existe, y J10 (0 → 180). Con el CPL propuesto, el mismo método da **0 desajustes** en las dos tarjetas. + +**Por qué funcionaron la V5.5 y la V4 con las mismas rotaciones.** La V5.5 llevó: + +- U6 (LTC4040) a 90. +- C10 (47 µF/50 V en `/24V`) a 180, y C3, C43, C78 y C103 con la misma regla de +180. +- Q10 (DPAK) a 90. +- U4 (TMP102) a 0. +- P2 (JST del 5 V) a 0. + +Todas son idénticas a las de hoy. La V4 llevó también U6 a 90 y C10 a 180. Si JLC las hubiera colocado tal cual, ninguna V5.5 encendería a 24 V. Las corrigió alguien en la revisión de ingeniería o en el visor. Las correcciones de 90° son obvias, porque la pieza no asienta. Las de 180° en piezas simétricas (QFN, capacitores, JST) dependen de que alguien mire la marca de pin 1 o de polaridad. + +### 6.4 Pasta, vías en pad y el QFN + +| Pieza | EP: pasta | Vías en el EP | Vías que tocan la pasta | Lectura | +|---|---|---|---|---| +| U14 LTC4040 (QFN 0.5 mm) | 48 % (6 ventanas de 0.95 × 0.85 mm) | 3 × 0.6/0.3 | 2 | Bien con **Epoxy Filled & Capped** y rayos X. Con vías solo tapadas por máscara regresan los puentes de la V5.5/V4 | +| U13 AP64350 (SO-8 EP) | **100 %** | 4 × 0.8/0.3 | 4 | Tapadas, no se vacían, pero sobra soldadura: la pieza puede flotar y dejar patas abiertas | +| U15 TPS54360B (V5.7) | **100 %** | 6 × 0.8/0.3 | 6 | Igual que U13 | +| U9 / U15 MP1584 (V5.6) | 62 % | 2 | 1–2 | Bien con vías tapadas | + +- **Vías en pads pasivos (V5.7).** C74 y C75 (47 µF de salida de U15) y D21 (B560C) también tienen vías en el pad. Otra razón para que «Epoxy Filled & Capped» sea obligatorio. +- **Máscara.** Las ventanas salen 1:1 con el pad, sin expansión. + - Así las presas entre pines quedan de 0.25 mm (U14), 0.22 mm (U1), 0.20 mm (LQFP) y 0.15 mm (TMP102). + - Si JLC expande 0.05 mm por lado, el TMP102 se queda sin presa, igual que en la V5.5, que salió bien. +- **Vías y orilla.** Todas las vías son de 0.3 o 0.4 mm, compatibles con el relleno. El cobre más cercano queda a 0.5 mm o más del borde. + +### 6.5 Eléctrica: cambios recientes y ruta de potencia + +- **T42a, se comprobó contra el historial de git** (`5c24f50` → `51a2cc6`). Cambiaron solo: + - Los campos de BOM documentados. + - `/IGN_IN` a 0.3 mm, con su vía recorrida 0.35 mm. + - En la V5.7, la segunda vía de `/SYS5V`. +- **Las tres piezas que cambió T42a:** + - D18 SMBJ33CA (C83325): DO-214AA sobre `D_SMB`, bidireccional, VRWM 33 V, VBR 36.7 V y VC 53.3 V. + - U10 TRS3232EIDR (C308878): SOIC-16 angosto, igual que la huella, y el mismo pinout del MAX3232. + - 22 µF C45783: 0805, 25 V, solo en rieles de 5 V o menos. +- **T43** (`51a2cc6` → `e13d074`): + - Mismas 247 y 252 huellas por UUID. + - Ningún pad ni geometría cambió. + - La partición pad → red es idéntica: 241 y 242 redes, de las que 56 solo cambian de nombre (`unconnected-(…)`, `/Q10_GATE` → `/Q6_GATE`, `/MODEM_EN_U7` → `/MODEM_EN_U13`, `/Q6_BASE` → `/Q5_BASE`). + - Pistas, vías, zonas y relleno idénticos. **El netlist no cambió.** +- **T44/T44b** (`e13d074` → `d19c832`): solo serigrafía (238 y 243 huellas y 18 gráficos de la cara superior). Cobre, máscara, pasta, taladros y `setup` idénticos. +- **Puntos de ajuste**, recalculados desde el netlist: + +| Bloque | Componentes | Resultado | +|---|---|---| +| LTC4040, corriente de carga | R58 1.43 kΩ | 2000 V / 1430 Ω = **1.40 A** | +| LTC4040, límite de entrada | R68 10 mΩ (Kelvin) | 25 mV / 10 mΩ = **2.5 A** | +| LTC4040, PFI | R59 270k / R60 100k | 1.19 × 3.7 = **4.40 V** cae / ≈ 4.51 V sube | +| LTC4040, VSYS en respaldo | R65 499k / R64 100k | 0.8 × 5.99 = **4.79 V** | +| LTC4040, química | JP3 2-3, JP4 1-2 y JP5 1-2, puenteados de fábrica | F2 F1 F0 = 0 0 1 → **LFP 3.50 V** | +| AP64350, módem | R50 100k / R51 31.6k · R57 100k a GND | **3.33 V**; apagado por omisión | +| TPS54360B (V5.7) | R80 57.6k / R77 10.2k · R75 162k · C77 100 nF · D21 B560C | **5.32 V** · ≈ 600 kHz · EN flotante (R78/R79 DNP) | +| MP1584 Ethernet / ventilador | R46/R47 · R76/R77 | 3.33 V · 4.99 V | +| Ignición en PA5 | R15 22k / (R16 22k ∥ R6 3.3k) + D2 BAT54 a 3V3 | × 0.1154: 12 V → 1.38 V, 24 V → 2.77 V, 32 V → 3.69 V, recortado por D2. Leerla por ADC, como dice `board_v56.h` | + +- **LTC4040 contra la hoja de datos** (LTC4040 rev. B). Coinciden las fórmulas y la tabla: + - F2 F1 F0 = 001 → LiFePO4 3.50 V. + - R_PROG = 2000 V / I_CHG y R_S = 25 mV / I_SYSLIM. + - PFI de 1.19 V con 30 mV de histéresis y BSTFB de 0.8 V. + - El pinout del símbolo propio (`Drogheda-sym`) coincide pin por pin. + - VIN opera de 3.5 a 5.5 V, con 6 V de máximo absoluto. Los 5.32 V de la V5.7 están dentro; en la V5.6, no subir el trimmer de la SD-15B arriba de 5.5 V. + - R18 (5.6 kΩ) está a propósito por debajo de los 10 kΩ de la hoja de datos: sube el corte por calor a ≈ 60 °C, como dice `board_v56.h`. +- **Entrada de la V5.7.** F2 3 A lento (125 V) → D18 → Q6 PMOS, con D19 de 15 V y R74 10k. Con el arnés al revés no conduce nada. +- **Entrada de la V5.6.** No tiene fusible; depende del breaker del gabinete. Su U15 (MP1584) en `/24V` opera hasta 28 V y la TVS recorta arriba de 36.7 V. Viene igual desde la V5.5; vale solo con la DDR-60G-24 regulada. +- **`board_v56.h`.** Los 31 `PIN_…` coinciden con el netlist de las dos tarjetas. Los pines del MCU que no define son DFU, SWD, BOOT1 y LSE. + +### 6.6 Piezas y existencias (JLC en vivo, 26-oct, 22:40) + +La merma se calculó como en el costeo: 2 % + 5 en pasivos y 1 % + 1 en lo demás. + +| Pieza | LCSC | Existencia | Piloto 5+5 | 135+365 | Qué hacer | +|---|---|---:|---:|---:|---| +| STM32F411RET6 (U3) | C94355 | **2** | 14 | 508 | **Piloto:** STM32F411RCT6, **C222222** (220; misma huella y rotación; 256 KB, ver A7). **Volumen:** pre-orden o consigna de RET6 | +| AP64350SP-13 (U13) | C2071691 | **1** | 14 | 508 | Sin alterna pin a pin con existencia (AP64350QSP-13: 0). **Consigna o Global Sourcing**, para el piloto y para el volumen | +| SC7A20TR (U1) | C5126709 | **2** | 14 | 508 | **LIS2DH12TR C110926** (22 109; misma huella y rotación; WHO_AM_I 0x33) o SC7A20HTR C19274408 (85 021; **+90° en el CPL**). O DNP en el piloto | +| AO4406AL (Q7) | C35349 | **0** | 14 | 508 | AO4406A **C2944312** (UMW, 31 017) o AO4406AL C5224299 (ElecSuper, 15 326); misma huella y rotación | +| MWSA0804S-4R7MT (L2) | C17700167 | **0** | 14 | 508 | MWSA0804S-**3R3**MT **C17700166** (4 675; misma familia; su huella de JLC coincide mejor) o -6R8MT C17700169 (276). Revisar el lazo del AP64350 en banco | +| SRP1265A-100M (L4, V5.7) | C840531 | **0** | 7 | 370 | SRP1265A-**150M C189912** (506) o -6R8M C2041326 (332), mismo cuerpo. A 24 V el rizo queda en 0.46 o 1.0 A p-p; revisar en banco | +| 12.4 kΩ 1 % (R23) | C103261 | **1** | 22 | 521 | **C22865** (183 079; misma serie 0603WAF) | +| 19.1 kΩ 1 % (R77, V5.6) | C103370 | 53 | 11 | 143 | C22897 (35 390) para el volumen | +| 47 µF/50 V (C73) | C165527 | 62 | 22 | 521 | C970679 (37 688). Su huella de JLC tiene la misma orientación que la actual: **misma corrección de 180°** | +| MWSA0804S-2R2MT (L3) | C17700165 | 171 | 14 | 508 | Pre-orden para el volumen | +| BAT54W (D2) | C131469 | 551 | 14 | 508 | Justo para las V5.x, no con la v6: C7502705 (Preferred, 128 275, misma rotación) | + +- **Tipos de pieza.** La V5.6 tiene 96 códigos: 42 Basic, 3 Extended «Preferred» y 51 Extended. La V5.7 tiene 105: 42, 4 y 59. +- **Precios.** Los del costeo coinciden con los de hoy. +- **Lista completa:** `existencias_JLC_2026-10-26.csv`. + +### 6.7 Mecánica, conectores y serigrafía + +- **Contorno y barrenos.** El contorno es idéntico al de la V5.5: 140.000 × 100.000 mm en el mismo origen. +- Los NPTH coinciden con el taladro del Gerber de la V5.5 que se fabricó (`HBOX_v5_PROD.zip`, 21-ago): MH1, MH3 y MH6 de 3.2 mm (base del HBOX), MH2, MH4 y MH5 de 2.75 mm (separadores del simpleRTK2B) y los postes del RJ45. +- **Falta MH11** (170.39, 83.8), el de la abrazadera del disipador de la V5.5. Ahí la V5.6/V5.7 tienen ahora R43, pistas de `/MODEM_RST` y una vía. **Comprobar que el HBOX no tenga poste ni tornillo en ese punto.** +- **Conectores que no se movieron:** GX16 (J15), RJ45, los dos USB-C, el zócalo XBee, MOD1, RS-485 y RS-232. +- **Conectores que se movieron:** + +| Conector (antes en la V5.5) | V5.6 | V5.7 | +|---|---|---| +| 5 V Mean Well (P2 → J16) | 12.6 mm | — | +| Corte (P11 → J2) | 12.1 mm | 21.5 mm | +| Batería (P4 → J5) | 25.1 mm | **38.2 mm** | +| Ventilador (P6 → J3) | 17.7 mm | 28.9 mm | +| LED del panel (P8 → J4) | 17.4 mm | 29.1 mm | +| RGB (P14 → J10) | 1.3 mm | **66.6 mm**, del borde derecho al superior | + +- **Serigrafía.** Dice «EINARBoard 5.6» / «HBOX v5.6 - 2026-10» y «EINARBoard 5.7» / «HBOX v5.7 - 2026-10», y «IGN 24V» / «IGN 12-24V». Todo está bien en cada tarjeta. +- Los textos quedan a 0.8 mm / 0.15 mm, el mínimo absoluto de JLC; JLC recomienda 1.0 / 0.2. La DRC del `.kicad_dru` no marca ninguno debajo. +- Los JST no tienen leyenda de función y sus nombres cambiaron con T43: ver A8. +- No hay texto «JLCJLCJLCJLC», así que JLC pondrá su número de pedido donde quiera. + +### 6.8 Firmware + +- `hbox_v5_bringup.ino` sigue en 0.6.3 (V5.5 y V4) y no incluye `board_v56.h`. Con él, el módem de la V5.6/V5.7 nunca enciende y la ignición se lee mal, como dice F-1 del 22-oct. +- Sin 0.7.0-pre, la compuerta del §8 no se puede correr. Es tan crítico como el AP64350. + +## 7. Plan: ¿pedir el volumen antes del piloto? + +**No.** El volumen no puede arrancar antes, y equivocarse en 500 tarjetas cuesta mucho más que esperar. + +| | Pedir 135 + 365 hoy | Piloto 5 + 5, y volumen al pasar el banco | +|---|---|---| +| Dinero expuesto | **≈ MX$513 mil** aterrizado sin IVA (costeo: US$26 402 a JLC) | Piloto ≈ **US$1 600 (≈ MX$30 mil)** con envío y mensajería | +| ¿Arranca JLC? | No. Faltan STM32 (2/508), AP64350 (1/508), SC7A20 (2/508), AO4406AL, MWSA 4R7 y SRP1265A | Sí, con las alternas de A2 y el AP64350 en consigna (≈ 1 semana) | +| Tiempo al volumen liberado | Lo que tarde la pre-orden de piezas (semanas) | Pre-orden **en paralelo** (B3), más ≈ 3–4 semanas de piloto: pedido 7–10 días, envío y aduana 5–10, banco 5–7. El retraso neto real es de ≈ 1–3 semanas | +| Si aparece un defecto | Se detecta en 500 tarjetas:
· un capacitor o una rotación: ≈ MX$50–100 mil de retrabajo;
· el LTC4040 o un defecto de diseño, como el del módem de la V5.5: retrabajo de QFN, tarjetas degradadas o chatarra, hasta MX$513 mil | Se detecta en 10 tarjetas: corrección y otro piloto de ≈ MX$30 mil | + +**Costo esperado.** Con 30 a 50 % de probabilidad de un defecto que obligue a retrabajar (la V5.5 tuvo uno de diseño y la V5.5/V4 uno de ensamble en el LTC4040), pedir el volumen a ciegas cuesta **≈ MX$80–200 mil en promedio**. El peor caso es MX$513 mil. Un piloto cuesta ≈ MX$30 mil y, si las piezas se pre-ordenan en paralelo, 1 a 3 semanas netas. La recomendación es el piloto, sin duda. + +## 8. Compuerta mínima de banco (5 + 5; pasa con al menos 4 de 5 por versión y con todas las de seguridad) + +1. **Recepción (las 10).** Lupa y rayos X de U14. Revisar contra la tabla del §6.3: + - la orientación de U14, D20, U8, U12 y Q6; + - la franja de C1, C14, C30, C68 y C73; + - la pestaña de J16 y de los JST. +2. **Encendido con límite de corriente.** + - V5.6: 5 V en J16 a 0.5 A y 24 V en J15 a 0.2 A. + - V5.7: 24 V en J15 a 0.5 A. + - Rieles: VEH5V 5.32 V (V5.7), SYS5V, MAIN5V, 3V3 y 3V3_ETH, todos dentro de ±3 %. +3. **0.7.0-pre por DFU (J7) y SWD.** Contestan en I²C: + - SHT40 0x44; + - TMP102 0x48 y 0x49; + - SC16IS752 0x4D; + - PCF8574 0x20; + - el acelerómetro 0x18 (WHO_AM_I 0x11 o 0x33). +4. **Módem.** MODEM_EN da 3V3_MODEM de 3.33 V. El módem registra y hace NTRIP. En batería: 20 cortes de 24 V con el módem transmitiendo, sin reset y con SYS5V arriba de 4.3 V en el osciloscopio. +5. **LTC4040.** Carga de 1.2–1.4 A y flotación de 3.50 V. 20 cambios de 24 V a batería sin reset. Pausa por NTC en frío y en calor. Temperatura de U14 y L3 a 1.4 A. +6. **U15 de la V5.7.** + - Barrido de entrada a 9, 12, 24 y 32 V, con carga de 0 a 2.5 A y escalón de 0.5 a 2.5 A sin oscilación. + - A 32 V y 2.5 A: U15 abajo de 110 °C y D21 abajo de 100 °C. + - Polaridad invertida en J15 sin daño. + - Si se usó una alterna de L4, revisar rizo y escalón. +7. **Comunicaciones.** Lazo de RS-485 y RS-232, Ethernet 24 h y USB-C del módem (J13 con D20). +8. **Ignición** por ADC a 12 y a 24 V. +9. **Mecánica.** Entra en el HBOX con la base de la V5.5 (3 tornillos), sin estorbo en el antiguo MH11, y los arneses alcanzan J5, J3, J4, J2, J16 y J10. Ver 6.7. La tapa cierra con los módulos puestos. +10. **24 h a 45 °C** (o en el gabinete) con etapa RTK y módem encendidos. + +## 9. Qué se verificó y cómo + +- **Copias.** Todo se trabajó sobre copias en `03-Architecture-Hardware/kicad/_to_delete/review-20261026/` (Mac) y `/home/claude/work/rv26/` (nube). + - No se tocó ninguna tarjeta, esquemático, paquete ni documento. + - No se corrió ningún git que escriba. Las versiones de T42a, T43 y T44 se sacaron con `git show`. +- **DRC.** `tools/t44_drc.py` sobre copias con proyecto, relleno, paridad y `--all-track-errors`. +- **ERC.** `kicad-cli sch erc --severity-all`. +- **Prueba de que la paridad corre.** Un valor alterado en una copia la dispara. +- **Fabricación.** El Fabrication Toolkit headless (`tools/fab_package.py`) se corrió sobre copias y se comparó archivo por archivo con los zip. +- **Comparación estructural de tarjetas** por UUID de huella (`scripts/bdiff.py`): pads, partición de redes, pistas, vías, zonas, relleno y serigrafía por separado. +- **Rotaciones.** Huellas de la biblioteca de JLC/EasyEDA (biblioteca oficial de JLCEDA/EasyEDA: [lceda.cn](https://lceda.cn/) · [easyeda.com](https://easyeda.com)) para los 79 códigos relevantes. Comparación pad por pad con la rotación del CPL (`scripts/orient.py`) y validación con las piezas que se sabe que salieron bien en la V5.5. +- **Existencias, tipo y precio.** API pública del buscador de jlcpcb.com, más el detalle de LCSC para los faltantes. Las alternas se buscaron por palabra clave y se revisó su huella de JLC con el mismo método. +- **Mecánica.** Contorno y NPTH contra el taladro del Gerber de la V5.5 fabricada y posición de los conectores contra el `.kicad_pcb` de la V5.5 (`49b61b9`). +- **Firmware.** `board_v56.h` contra los pines del MCU en el netlist de las dos tarjetas; estado del `.ino` en el repositorio de firmware. +- **Hojas de datos y referencias consultadas:** + - [LTC4040 rev. B (Analog Devices)](https://www.analog.com/media/en/technical-documentation/data-sheets/4040fb.pdf). + - [Especificación de serigrafía de JLCPCB](https://jlcpcb.com/blog/character-design-specifications). + - Compatibilidad del SC7A20H con el LIS2DH12: [ESP Component Registry](https://components.espressif.com/components/mydazy/esp_sc7a20h/versions/2.0.0/readme). + - Valores del TPS54360B y del AP64350 tomados de sus descripciones en JLC y de la auditoría del 22-oct. + +**Archivos de esta revisión** (en el sitio, junto a este documento; el original en `03-Architecture-Hardware/` del repositorio): + +- Este documento y la figura (`img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png`). +- CPL propuestos, con las rotaciones del §6.3 y la posición de Q6: [V5.6](files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv) · [V5.7](files/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv). Son una propuesta: con T46 los reemplaza el paquete regenerado; si se usan tal cual, verificar en el visor. +- Tabla del §6.3 con el `FT Rotation Offset`: [V5.6](files/rotaciones_V5.6_Rev6.csv) · [V5.7](files/rotaciones_V5.7_Rev7.csv). +- [Existencias de JLC del 26-oct](files/existencias_JLC_2026-10-26.csv). +- Scripts, DRC y ERC: carpeta `kicad/_to_delete/review-20261026/` de la Mac (no se sube al repositorio). diff --git a/mkdocs.yml b/mkdocs.yml index 97edba4..de04ce2 100644 --- a/mkdocs.yml +++ b/mkdocs.yml @@ -159,6 +159,7 @@ nav: - Diseño V5.7: hardware/diseno-v57.md - Diseño v6: hardware/diseno-v6.md - Auditorías y pasadas: + - 26 oct · Revisión independiente del pedido V5.6/V5.7: hardware/revision-pedido-26oct.md - 26 oct · Revisión v6 (fin de semana): hardware/v6-revision-26oct.md - 26 oct · Costeo JLC e importación: hardware/costeo-jlc-26oct.md - 22 oct · Serigrafía v6 (T44): hardware/v6-t44-serigrafia.md diff --git a/scripts/sync-docs.sh b/scripts/sync-docs.sh index b49dfb7..5294690 100755 --- a/scripts/sync-docs.sh +++ b/scripts/sync-docs.sh @@ -236,6 +236,14 @@ declare -a MAP=( # 2026-10-26: costeo JLCPCB + importación de 135 V5.6 / 365 V5.7 / 60 v6 "00-Project-Management/2026-10-26_Drogheda_Costeo-JLCPCB-Importacion_V5.6-V5.7-v6_ES_v1.0.md|docs/hardware/costeo-jlc-26oct.md" "00-Project-Management/2026-10-26_Drogheda_Costeo-JLCPCB_V5.6-V5.7-v6_v1.0.xlsx|docs/hardware/2026-10-26_Drogheda_Costeo-JLCPCB_V5.6-V5.7-v6_v1.0.xlsx" + # 2026-10-26 (noche): revisión independiente del pedido de V5.6/V5.7 (existencias en vivo, rotaciones del CPL contra JLC) + "03-Architecture-Hardware/2026-10-26_Drogheda_Revision-Independiente-Pedido_V5.6-V5.7_ES_v1.0.md|docs/hardware/revision-pedido-26oct.md" + "03-Architecture-Hardware/img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png|docs/hardware/img/2026-10-26_Drogheda_Rotaciones-CPL-vs-JLC_V5.6_v1.0.png" + "03-Architecture-Hardware/2026-10-26_Drogheda_Revision-Pedido_archivos/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv|docs/hardware/files/HBOX_v5_Rev6_PROD_positions_PROPUESTA-rotaciones.csv" + "03-Architecture-Hardware/2026-10-26_Drogheda_Revision-Pedido_archivos/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv|docs/hardware/files/HBOX_v5_Rev7_PROD_positions_PROPUESTA-rotaciones.csv" + "03-Architecture-Hardware/2026-10-26_Drogheda_Revision-Pedido_archivos/rotaciones_V5.6_Rev6.csv|docs/hardware/files/rotaciones_V5.6_Rev6.csv" + "03-Architecture-Hardware/2026-10-26_Drogheda_Revision-Pedido_archivos/rotaciones_V5.7_Rev7.csv|docs/hardware/files/rotaciones_V5.7_Rev7.csv" + "03-Architecture-Hardware/2026-10-26_Drogheda_Revision-Pedido_archivos/existencias_JLC_2026-10-26.csv|docs/hardware/files/existencias_JLC_2026-10-26.csv" ) n=0