Leopoldo Rodríguez
c2d02e15fb
Co-Authored-By: Claude Opus 5.5 <noreply@anthropic.com> Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx
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12 KiB
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title: "Instrucciones para Michelle — V5.6 y V5.7, pasada 4: cierre (19-oct-2026)"
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tags: [project-drogheda, hardware, hbox, einarboard, v5.6, v5.7, layout, pcb, michelle, t30]
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project: Project Drogheda
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author: Helgen Technologies
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date: 2026-10-19
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version: 1.0
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status: ACTIVO — sustituye lo pendiente de la pasada 3 (16-oct) · T30 subido (7650b96) · 19-oct tarde: prioridades de la parte A en la clasificación de la V5.6 (nuevo A-0, C129)
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audience: Michelle (layout), Leo
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# Instrucciones para Michelle — V5.6 y V5.7, pasada 4 (cierre) · 19-oct-2026
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**Primero, gracias:** la pasada 3 cerró casi todo lo grande en las dos tarjetas (el detalle está en la [re-auditoría del 19-oct](re-auditoria-19oct.md)). Esta pasada es corta: lo mecánico ya lo hace el script **T30** y aquí queda solo lo que necesita mover cobre o piezas.
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Base: **V5.6** = `hbox-watchdog-v5.kicad_pcb` y **V5.7** = `hbox-watchdog-v57.kicad_pcb`, los dos **después de T30**. Orden: **V5.6 completa → commit y push → V5.7.**
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Reglas de siempre:
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- Corriente solo por F.Cu/B.Cu (In1 e In2 son de 0.5 oz). Cada cambio de capa de una red de potencia lleva **2–3 vías** 0.6/0.3 (u 0.8/0.3), nunca una sola.
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- No mover U6, U7, U16, U26, MOD1, J7/J8, RS1, C31, Q7 ni la fila de conectores. No tocar la pasta del EP de U6.
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- **No tocar los hilos de sensado de RS1** (dos pistas de 0.25 mm de U6.6 y U6.7 a los pads de RS1, de T27) ni unirles cobre de potencia.
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- No mover ni borrar las vías que agregó T30 (las 0.6/0.3 nuevas junto a las vías de potencia y junto a C149/C150/D34). Si estorban para algo de esta lista, avísale a Leo.
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- Las coordenadas (x, y) en mm son para ubicarte rápido; manda el designator y el pin.
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## 0. Antes de empezar (Leo, 10 min)
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Con **KiCad cerrado** (PCB y esquemático de las dos tarjetas) y el árbol limpio:
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```bash
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cd ~/Documents/Claude/Projects/Drogheda/03-Architecture-Hardware/kicad
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git status # sin cambios; a lo más, tools/t30_v56_v57_mecanicos.py como archivo nuevo (??)
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git pull --ff-only
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# prueba en seco: no escribe nada, solo dice lo que haría
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python3 tools/t30_v56_v57_mecanicos.py hbox-watchdog-v5.kicad_pcb
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python3 tools/t30_v56_v57_mecanicos.py hbox-watchdog-v57.kicad_pcb
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# aplicar (deja .T30bak del PCB y del esquemático)
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python3 tools/t30_v56_v57_mecanicos.py hbox-watchdog-v5.kicad_pcb --apply
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python3 tools/t30_v56_v57_mecanicos.py hbox-watchdog-v57.kicad_pcb --apply
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```
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Lo que debe decir:
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| V5.6 (`hbox-watchdog-v5`) | V5.7 (`hbox-watchdog-v57`) |
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| — | `4 cobre suelto borrado: 12 elementos` |
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| `3 via micro …` × 4 (la de `/NTC` pasa a 0.5/0.3) | igual |
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| `1 vias en paralelo: 18 nuevas en 10 sitios, 30 tramos de union` | `1 vias en paralelo: 21 nuevas en 11 sitios …` |
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| — | `2 vias GND junto a C149/C150/D34/C153/C154: 11 nuevas` |
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| `5 conexion solida: 1 pads` | `5 conexion solida: 7 pads` |
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| `6 JP/TP/MOD1 fuera de BOM y posiciones en el PCB: 14 huellas` | igual |
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| `7 cajetin del PCB: EINARBoard HBOX V5.6, rev 5.6, 2026-10-19` | `… V5.7, rev 5.7, 2026-10-19` |
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| `6 esquematico: 14 simbolos …; cajetin actualizado` | igual |
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Si dice **ABORTAR**, el archivo ya no es el que se auditó (alguien lo cambió): no escribió nada; avísale a Claude.
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Después, en KiCad, cada tarjeta: **B** (rellenar zonas) → **Inspeccionar → DRC** con «Rellenar zonas» y «Comprobar paridad».
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- **V5.6:** debe dar lo mismo que antes de T30: 3 errores (MH7/MH9/MH10 dentro de MOD1, por diseño), 0 sin conectar, paridad solo con los PF*.
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- **V5.7:** lo mismo, y sin los 6 avisos de cobre suelto.
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Guarda (Ctrl+S) y sube:
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```bash
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mv hbox-watchdog-v5.kicad_pcb.T30bak hbox-watchdog-v5.kicad_sch.T30bak hbox-watchdog-v57.kicad_pcb.T30bak hbox-watchdog-v57.kicad_sch.T30bak _to_delete/
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git add tools/t30_v56_v57_mecanicos.py hbox-watchdog-v5.kicad_pcb hbox-watchdog-v5.kicad_sch hbox-watchdog-v57.kicad_pcb hbox-watchdog-v57.kicad_sch
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git commit -m "T30: V5.6/V5.7 vias en paralelo, vias micro a normales, cobre suelto V5.7, cajetin, stackup 7628, JP/TP/MOD1 fuera de BOM/CPL" --trailer "Co-Authored-By: Claude Opus 5.5 <noreply@anthropic.com>" --trailer "Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx"
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git push
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cd ../..
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git add 03-Architecture-Hardware/kicad
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git -c diff.ignoreSubmodules=none commit -m "kicad: T30 (V5.6/V5.7)" --trailer "Co-Authored-By: Claude Opus 5.5 <noreply@anthropic.com>" --trailer "Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx"
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git push
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```
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Michelle, después del aviso de Leo: `git pull --ff-only` y empiezas con la parte A. **No abras V5.6 ni V5.7 antes de ese aviso**: así no se repite el conflicto del lunes.
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## Parte A — V5.6 (`hbox-watchdog-v5`, ≈ 1 h)
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!!! danger "Prioridades de la parte A (19-oct, tarde)"
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- **Primero, A-0 — C129 junto a VSYS de U6 (crítico, nuevo):** un 10 µF 0603 pegado a los pines 1/24, con su vía a GND, reacomodando `/PROG`, `/CLPROG_TP` y `/CHRG_EN`. [Paso a paso](v56-clasificacion-19oct.md#1-paso-a-paso-c129-junto-a-vsys).
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- **Regresar** las 2 vías de T30 junto a (144.1, 98.05) en `/MAIN5V` y dejar `/3V3_MODEM` sin vías sencillas: se perdieron en el guardado de las 18:59.
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- **A-1:** si L7 no cabe más cerca de U7, se queda; lo que sí: quitar la rama de Dbk2.
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- Qué es crítico y qué se puede quedar, punto por punto: [**▶ clasificación de la V5.6**](v56-clasificacion-19oct.md).
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### A-1. L7 junto a U7, y Dbk2
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Hoy **L7.1** (139.0, 107.1) está a 7.1 mm de **U7.8** (141.87, 115.89) y el nodo SW corre 13 mm a 0.7 mm. Además, de L7.1 sale una rama de **18 mm** hasta **Dbk2** (141.8, 93.4), que no se monta (U7 es síncrono): es una antena de conmutación.
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1. Acerca **L7** para que L7.1 quede a **≤ 5 mm de U7.8**. U7 no se mueve.
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2. Pon **Dbk2** junto a L7.1 / U7.8, con **≤ 3 mm** de cobre de SW hasta su pad 1. Borra la rama larga.
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3. Nodo SW (U7.8 → L7.1, Cbst2.2, Dbk2.1) solo en F.Cu, **≥ 1.0 mm**, sin vías y sin pistas de otras redes debajo en In1.
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4. Reajusta `/3V3_MODEM` (L7.2 → J7.1) a 1.0 mm, como quedó en la pasada 3.
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### A-2. Salida VSYS de U6
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Los pines **U6.1** y **U6.24** (VSYS) llegan a la vía **(153.19, 110.88)** con dos pistas de **0.3 mm** (1.6 y 2.3 mm). Por ahí pasa todo el 5 V cuando la tarjeta va en batería.
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- Haz un polígono (o pistas) de **≥ 1.0 mm** desde los dos pines hasta la vía. Entra al pad con el ancho del pad y ensancha en cuanto salgas.
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- Pon **2 vías más** junto a esa vía, unidas en F.Cu y B.Cu.
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- Cuidado con los pines vecinos de U6 y con C35 (arriba a la izquierda).
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### A-3. `/SYS5V` hacia U7.2
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La vía **(141.2, 108.6)**, junto a U7.2 (VIN del buck del módem), es la única que une ese tramo de B.Cu con F.Cu. Pon **2 vías más** a su lado, o llega a U7.2 por F.Cu sin cambiar de capa.
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### A-4. `/VEH5V` en (162.6, 113.0)
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Vía sencilla en el camino de P2 a RS1, entre U6 y L6. **2 vías más**, unidas a la pista de 1.0 mm en F.Cu y en B.Cu. Ojo: ahí mismo llega la pista de 0.5 mm de U6.16 (OVSNS) por B.Cu: no la ensanches ni la muevas.
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### A-5. Entrada de RS1 (zona de T27)
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La vía **(151.0, 115.54)** lleva toda la entrada de 5 V a RS1.1. No la muevas: pon **una vía más** en otro punto del mismo camino. La mejor opción es junto a **C31.1** (149.46, 120.11): una vía de B.Cu a F.Cu pegada al pad, unida al B.Cu de `/VEH5V` y al pad de C31.1. Desde ahí la corriente entra a RS1.1 por la pista de 1.0 mm de T27.
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**Condición:** a ≥ 0.25 mm de los dos hilos de sensado de 0.25 mm (morados en la figura). Si no cabe sin acercarte, déjalo y avísale a Leo.
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### A-6. DRC: excluir MH7/MH9/MH10
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El DRC marca **MH7, MH9 y MH10 «dentro del courtyard de MOD1»**: son los barrenos del ArduSimple y es por diseño. Clic derecho en cada uno → *Excluir esta infracción*.
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### A-7. Cierre de V5.6
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1. **B** (rellenar zonas).
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2. **DRC** con «Rellenar zonas» y «Comprobar paridad»:
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- **0 errores** (con las 3 exclusiones de A-6);
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- 0 sin conectar;
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- paridad solo con los PF*;
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- 0 colgantes.
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Los ~85 avisos de «huella no coincide con la librería» son ruido; no los toques.
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3. Commit y push. Escribe en el mensaje lo que hiciste de verdad:
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```bash
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git add hbox-watchdog-v5.kicad_pcb hbox-watchdog-v5.kicad_pro
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git commit -m "V5.6 pasada 4: L7 y Dbk2 junto a U7, VSYS de U6 a 1 mm + 2 vias, vias en SYS5V/U7.2 y VEH5V, exclusiones MOD1"
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git push
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```
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Avísale a Leo con el hash. Claude revisa pad a pad y genera Gerber/BOM/CPL del piloto.
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## Parte B — V5.7 (`hbox-watchdog-v57`, ≈ medio día)
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### B-1. `/SYS5V` bajo K1: fuera de In2 — BLOQUEANTE
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Hoy va **10.9 mm por In2 a 0.5 mm** entre las vías **(156.56, 64.44)** y **(158.6, 57.92)**, rodeando bajo K1 (por (155.41, 64.28) → (154.19, 63.06) → (154.19, 60.23) → (156.47, 57.95)). Ese tramo está en serie con todo lo que alimenta a U7 (buck del módem) y U12 (3.3 V de Ethernet): 81 mΩ, y aguanta ≈ 0.44 A cuando por ahí pasan picos de 1.5 A.
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- Rutea esa unión por **F.Cu o B.Cu a ≥ 1.0 mm**. Si cambias de capa, con 2–3 vías.
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- **Borra los tramos de 0.5 mm de In2** y las dos vías que queden sueltas.
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- La rama de **1.5 mm** de `/SYS5V` que va por In2 hacia **R2** (de la vía (165.4, 47.08) a (155.74, 54.64)) se queda: es el pull-up de 10 k de la compuerta de Q1 y casi no lleva corriente.
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### B-2. Fuente U25: lazo de entrada y nodo SW
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Hoy el lazo C150 → U25.2 → U25.8 → D34 → C150 mide **52 mm²** (meta **< 30**), y el nodo SW (U25.8 → D34.1 → L22.1) mide **48 mm²** (meta **≤ 25**). L22.1 (191.8, 51.0) está a 10 mm de D34.1 (191.8, 61.0), entre centros. T30 ya puso 2 vías GND junto a la tierra de cada capacitor y 4 junto a D34.2; eso acorta el regreso, pero el área la define dónde están las piezas.
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1. **C149/C150** (181.2, 63.8 / 67.8): gíralos 180° para que su pad de tierra mire hacia D34/EP de U25, y acércalos al pin 2 de U25 (184.7, 67.97): **pad de `/24V` a ≤ 2 mm del pin 2**. Su tierra debe quedar sobre la misma isla de F.Cu que D34.2 y el EP, sin cuellos de menos de 1 mm.
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2. **L22**: que **L22.1 quede a ≤ 5 mm de D34.1**. Puedes girarla 90° o bajarla hacia D34; L22.2 sigue saliendo a C153/C154.
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3. Nodo SW solo en F.Cu, compacto, **sin nada en In1 debajo**.
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4. **Conserva las vías de T30.** Si al mover C149/C150 una queda dentro de un pad o choca, muévela junto al pad nuevo; deben quedar 2 por capacitor.
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5. No muevas U25, R121/R122 ni C152: el FB ya quedó bien (0.6 mm).
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### B-3. L7 junto a U7, y Dbk2
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Igual que A-1: hoy L7.1 a 7.0 mm de U7.8; rama de 17 mm hasta Dbk2 (142.0, 93.2).
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### B-4. Salida VSYS de U6
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Igual que A-2. Aquí las pistas son de 0.25–0.3 mm.
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### B-5. `/SYS5V` hacia U7.2
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Igual que A-3: vía (141.2, 108.6).
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### B-6. `/VEH5V`: dos vías sencillas entre U6 y L6
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- **(168.0, 110.6)** y **(162.85, 113.19)**: 2 vías más en cada una, unidas a la pista de 1.0 mm en las dos capas.
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- La de (162.85, 113.19) recibe la pista de 0.5 mm de U6.16 por B.Cu: no la toques.
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### B-7. Entrada de RS1
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Igual que A-5.
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### B-8. Serigrafía
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El texto «Cbst2» se encima con el contorno de U7 (142.5, 114.9). Muévelo.
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### B-9. DRC: excluir MH7/MH9/MH10
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Igual que A-6.
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### B-10. Cierre de V5.7
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Igual que A-7. Además, resalta `/24V`, `/SW_PWRIN`, `/VEH5V`, `/SYS5V` y `/FB_PWRIN` con F.Cu y B.Cu apagadas: **no debe quedar nada visible en In1 ni In2**, salvo la rama de 1.5 mm de `/SYS5V` hacia R2.
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```bash
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git add hbox-watchdog-v57.kicad_pcb hbox-watchdog-v57.kicad_pro
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git commit -m "V5.7 pasada 4: SYS5V fuera de In2, C149/C150 y L22 junto a U25/D34, L7 y Dbk2, VSYS de U6, vias, serigrafia, exclusiones MOD1"
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git push
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```
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Después: re-auditoría pad a pad, Gerber/BOM/CPL y los **5 prototipos**.
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## Lo que NO hay que hacer
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- No mover RS1, C31, la vía de entrada (151.0, 115.54) ni los hilos de sensado de 0.25 mm.
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- No borrar las vías que agregó T30.
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- No mover ni borrar MH4, MH5, MH6, MH7, MH9 ni MH10; no quitarles «No en el esquemático».
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- No mover U6, U7, U16, U26, MOD1, J7/J8, Q7, P1–P11 ni la fila de conectores.
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- No cambiar la pasta del EP de U6 (6 ventanas, 50 %, intencional).
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- No poner piezas en la cara inferior.
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- No cambiar valores ni huellas, ni correr *Actualizar PCB* (si Leo aprueba los puertos, él te avisa).
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- No editar la V5.7 hasta que la V5.6 esté en el servidor.
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