Leopoldo Rodríguez
d70dd806be
Co-Authored-By: Claude Opus 5.5 <noreply@anthropic.com> Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx
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title: "V5.6 — qué es crítico y qué se puede quedar (19-oct-2026, tarde)"
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tags: [project-drogheda, hardware, hbox, einarboard, v5.6, layout, auditoria, ltc4040, vsys, prioridades]
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project: Project Drogheda
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author: Helgen Technologies (revisión: Claude; pregunta: Leo)
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date: 2026-10-19
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version: 1.0
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status: ACTIVO — clasificación del archivo de trabajo de V5.6 del 19-oct 18:59 (sobre T30, `7650b96`, sin subir) · fija las prioridades de la pasada 4, parte A · 20-oct: C129 entra y Dbk2 sale del esquemático (T31, V5.6 y V5.7)
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audience: Leo, Michelle (layout), Jesús (banco)
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# V5.6 — qué es crítico y qué se puede quedar · 19-oct-2026 (tarde)
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!!! warning "Designadores de antes del 22-oct (T43)"
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Este documento conserva los designadores que tenía la tarjeta en su fecha. Desde el 22-oct (T43) la V5.6, la V5.7 y la v6 traen otros, y varios nombres viejos ahora son otra pieza: en la V5.6 y la V5.7 el LTC4040 es ahora U14 (antes U6) y J7 es el USB-C de DFU (antes J11). Para leerlo contra la tarjeta de hoy, usa la [tabla viejo → nuevo](designadores-t43-22oct.md#8-tablas-viejo-nuevo); lo que ya no existía el 22-oct no está en la tabla.
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**La pregunta (Leo, 19-oct 18:59):** «Las tolerancias están muy justas y ya cuesta mover piezas: clasifica qué es crítico y qué pasa si se queda como está.»
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**Archivo revisado:** `hbox-watchdog-v5.kicad_pcb` guardado a las 18:59 en la Mac de Leo, sin subir, sobre T30 (`7650b96`). Ese guardado mueve L7 y la red de compensación de U7, ensancha la salida VSYS de U6 y re-rutea `/3V3_MODEM`, `/MAIN5V`, `/SYS5V`, `/VEH5V` y algunas señales.
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- **DRC (KiCad 10.0.4, zonas rellenadas, paridad):** 3 errores (MH7/MH9/MH10 dentro de MOD1, por diseño), 0 sin conectar y 2 avisos nuevos: una vía y un tramo colgando.
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- **ERC:** sin cambios.
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!!! danger "Un solo punto crítico, y es nuevo: U6 (LTC4040) no tiene capacitor en VSYS"
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Los pines VSYS de U6 (1 y 24) no tienen capacitor cerca:
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- el más cercano es **C34 (10 µF), a 11.5 mm**;
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- **C32 y C33 (47 µF)** están a 15 mm;
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- los tres quedan del otro lado de vías.
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La hoja de datos del LTC4040 pone este capacitor **por encima de todo lo demás** en el layout, porque por VSYS y GND cierra el único lazo de alta frecuencia: el cargador conmuta a 2.25 MHz y el respaldo (boost) a 1.125 MHz.
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Viene así desde la V5.5 y no lo marcó ninguna de las auditorías del 13, 16 y 19-oct.
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**Arreglo:** un capacitor de 10 µF 0603 pegado a los pines 1/24 (C129). No se mueve ninguna pieza; solo se reacomodan tres pistas delgadas ([abajo](#1-paso-a-paso-c129-junto-a-vsys)).
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!!! tip "Lo demás"
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- **Dos regresiones del guardado de hoy (5 min cada una, sin mover piezas):**
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- se borraron las 2 vías de T30 junto a (144.1, 98.05), y toda la carga de P11 pasa otra vez por una sola vía;
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- `/3V3_MODEM` ahora baja a B.Cu con 2 vías sencillas.
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- **Bien hecho hoy:** la salida VSYS de U6 ya tiene pistas de 0.75 mm y 2 vías (A-2).
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- **El resto puede quedar para el piloto** y se mide en el banco.
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## Clasificación
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Clases:
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- 🔴 **crítico:** se corrige antes del piloto;
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- 🟠 **corregir:** es fácil y no mueve piezas;
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- 🟡 **se puede quedar:** se mide en el piloto y se decide antes de las 108;
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- ⚪ **trámite:** se resuelve antes de generar los Gerber.
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| # | Qué | Qué pasa si se queda así | Clase | Arreglo mínimo |
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| 1 | **U6 sin capacitor en VSYS** (pines 1/24). El más cercano, C34, está a 11.5 mm del otro lado de vías. | El lazo del cargador y del boost cierra por 11–15 mm de cobre. Eso da picos y zumbido en VSYS, que trabaja a ≈ 5 V con un máximo absoluto de 6 V; más ruido en todo el bloque; y un boost más débil cuando arranca o transmite el módem en batería, que es el ciclo de 10 s que la V5.6 tiene que pasar. La V5.5 funciona así en respaldo continuo, pero nunca se probó ciclando. | 🔴 Crítico | C129 de 10 µF 0603 junto a los pines; reacomodar `/PROG`, `/CLPROG_TP` y `/CHRG_EN` ([paso a paso](#1-paso-a-paso-c129-junto-a-vsys)). Esquemático: hecho (T31, 20-oct). |
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| 2 | `/MAIN5V`: vía sencilla en (144.1, 98.05), camino a P11. **Regresión de hoy:** se borraron las 2 vías de T30 en (145.15, 97.6) y (146.15, 97.6). | Toda la carga de SYS5V (buck del módem, Ethernet, ArduSimple, MCU) pasa por una vía de 0.3 mm. Eléctricamente aguanta (≈ 1.5 mΩ, unos mW), pero no hay respaldo: si esa vía sale mal de fábrica, la unidad se queda sin 5 V. | 🟠 Corregir | Regresar las 2 vías (o 1 más), unidas en F.Cu y B.Cu |
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| 3 | `/3V3_MODEM` (L7.2 → J7) ahora baja 8.9 mm a B.Cu con 2 vías sencillas, en (139.03, 97.61) y (136.76, 105.57). **Regresión de hoy.** | +5 mΩ: ≈ 11 mV más de caída en los picos de 2 A del módem, y 2 puntos sin respaldo en su alimentación. | 🟠 Corregir | Una 2.ª vía en cada cambio de capa, o regresar la pista a F.Cu como la dejó T30 |
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| 4 | Rama de **18.7 mm** del nodo SW de U7 hasta Dbk2, que no se monta. | Es una antena sin terminar: la mitad del cobre del nodo SW (36 mm² en total). No rompe nada, pero mete ruido junto al ArduSimple y al módem. | 🟠 Corregir | Dbk2 ya salió del esquemático (T31, 20-oct; D-19-2 resuelta: U7 es síncrono y no lo necesita). Falta borrar la rama: 5 tramos ([pasada 4, A-1](v56-v57-layout-pasada-4.md#a-1-rama-de-dbk2-y-l7)). **No se mueve nada.** |
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| 5 | L7.1 a **8.8 mm** de U7.8 (con T30 estaba a 7.1); el nodo SW mide 13 mm a 0.7 mm. | Ruido moderado: U7 conmuta 5 V, no 24 V. El movimiento de hoy no acortó el nodo. | 🟡 Se puede quedar | No alejarla más. Si el cambio de hoy fue solo de prueba, L7 puede regresar a donde la dejó T30. |
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| 6 | `/VEH5V`: 2 vías sencillas con toda la entrada, en (162.6, 113.02) y (151.0, 115.54). La vía nueva de (163.65, 113.46) quedó colgando. | Hasta 2.5 A por una vía de 0.3 mm: ≈ 9 mW, no se calienta. El riesgo es que no hay respaldo en la entrada. | 🟠 Conviene, fácil | Unir la vía nueva con la pista de 1.0 mm en F.Cu y en B.Cu, y queda resuelto (162.6, 113.02). La de RS1 (151.0, 115.54) se queda: zona de T27. |
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| 7 | U7.2 (VIN del buck del módem): su vía sencilla (141.16, 108.69) queda dentro del lazo de entrada, porque C121/C119 están a 3–5 mm del otro lado. El nodo FB mide 22 mm. Hoy además se alejaron 2.7 mm la compensación y el RT. | Más zumbido en el nodo SW y en el riel del módem. No daña a U7 (soporta 40 V). | 🟡 Se puede quedar | No alejar más Rcomp2/Ccomp2/C123/Rfreq2. Si cabe: 2.ª vía junto a U7.2, o un 100 nF 0402 entre U7.2 y GND. |
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| 8 | **Heredado de la V5.5:** L6 a 11.7 mm de los SW de U6; L8 a 35 mm de U12 (Ethernet) con D11 a 7.5 mm; Dbk1 a 18 mm y L2 a 11 mm de U2 (ventilador, 24 V). | Ruido y algo de zumbido en esos nodos SW. Las 15 V5.5 funcionan así. Mover esas piezas es mucho trabajo y no se justifica sin medir. | 🟡 Se queda | Medirlo en el piloto ([abajo](#que-medir-en-el-piloto)) |
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| 9 | Clase HV24 (`/24V`, `/IGN_IN` y `/Q10_GATE` sin la `/` en los patrones): [re-auditoría §5.4](re-auditoria-19oct.md#54-la-clase-hv24-no-se-aplica-v56-y-v57). | 12 pads expuestos a 0.15 mm del relleno de GND. Es confiabilidad a largo plazo (humedad, salinidad), no falla inmediata. | 🟡 Piloto así | Antes de las 108: patrones y 0.4 mm en capas externas (≈ 1 h) |
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| 10 | Puertos (D-19-1): U32, D39, R147… | Sin U32, el RS-485 ocupa el bus desde que se energiza. | Decisión de Leo | [Re-auditoría §7](re-auditoria-19oct.md#7-decisiones-para-leo) |
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| — | Vía colgando en (163.65, 113.46) (ver 6), tramo de 0.01 mm de `/RS485_B` en (136.59, 108.89), y las 3 infracciones de MH7/MH9/MH10. | El DRC no sale limpio. | ⚪ Trámite | Borrar o conectar; excluir MH7/MH9/MH10 (2 min) |
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**Se queda como está** (revisado, sin riesgo práctico):
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- `/BAT_PLUS` hacia U6.23/C35: 3 vías sencillas, pero es la rama de medición de BAT (casi sin corriente). El camino de potencia P4 → L6 no tiene vías sencillas.
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- `/SYS5V` hacia U12 (≈ 0.2 A), `/SW_IN` por In2 (ArduSimple, ≈ 0.3 A), ramas de `/24V` del ventilador (≈ 50 mA) y las vías sencillas de `/3V3` y `/3V3_ETH`: corrientes bajas.
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- Señales bajo el nodo SW de U7 (`/CHRG_STAT` y otras en In2/B.Cu): las tapa el plano de GND de In1. `/IGN_IN` en In1 queda acoplado con ≈ 0.14 pF, que el filtro de ignición absorbe.
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- EP de U6: pasta al 50 % y 3 vías. En el pedido van *Epoxy Filled & Capped* y rayos X en U6 (regla DFM del 8-oct).
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- El 10 nF con dos códigos y los avisos de serigrafía: limpieza de BOM y estética.
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**Ya quedó bien:** salida VSYS de U6 (0.75 mm, 2 vías), sensado Kelvin de RS1, `/BAT_PLUS` sin vías sencillas, EP de U7 (4 vías), barrenos y todo lo de T30.
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## 1. Paso a paso: C129 junto a VSYS
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El lugar está marcado en rojo punteado en el panel derecho de la figura de arriba.
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1. **Esquemático** (hoja del cargador, junto a U6): agregar **C129 = 10 µF 0603 X5R 10 V**, LCSC **C19702** (básico de JLC), entre `/MAIN5V` y GND. ✅ **Hecho el 20-oct con T31** (`kicad/tools/t31_c129_vsys_quitar_dbk2.py`) en V5.6 y V5.7; Leo corre *Actualizar PCB* (F8) y C129 llega sin colocar.
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2. **Colocación:** C129 en vertical en **≈ (153.07, 111.95)**, a la izquierda de la esquina de los pines 1/24 de U6.
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- Pad de `/MAIN5V` arriba, en ≈ (153.07, 111.18): queda a 0.5 mm de U6.1 y pegado a la vía (153.19, 110.88). Únelo a la pista de 0.75 mm de U6.1/U6.24.
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- Pad de GND abajo, en ≈ (153.07, 112.73): 1–2 vías a GND a ≤ 0.5 mm del pad, para bajar directo al plano.
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3. **Reacomodar 3 pistas** que hoy pasan justo ahí: `/PROG` (U6.2 → R50), `/CLPROG_TP` (U6.3 → TP1) y `/CHRG_EN` (U6.4 → MCU, U16.41). Son señales casi sin corriente:
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- bájalas a B.Cu en cuanto salgan de U6, o rodea el capacitor por abajo;
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- con 0.25 mm alcanza;
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- `/PROG` y `/CLPROG_TP` son analógicas (fijan y miden la corriente de carga): que queden cortas y lejos de `/SW_BAT`.
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4. **No mover:** U6, C35, RS1, Q7 ni los **hilos Kelvin de RS1** (`/VEH5V` y `/VIN_SW` de 0.25 mm). Tampoco toques la pasta del EP de U6.
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5. **Cierre:**
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- B (rellenar zonas) y DRC con «Rellenar zonas» y «Comprobar paridad»: 0 sin conectar, solo los errores de MOD1.
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- Commit y push, y avisar a Claude con el hash.
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**V5.7:** mismo problema y mismo arreglo. U6 y sus pistas están igual, y el mejor lugar también es (153.07, 111.95), con las mismas 3 pistas por reacomodar ([pasada 4, B-0](v56-v57-layout-pasada-4.md#b-0-c129-junto-a-vsys-de-u6-critico)).
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**Si de plano no cabe:** se puede poner C129 en la cara inferior, justo debajo de la esquina 1/24. Eso obliga a pedir ensamble por las dos caras (más caro: hoy no hay piezas montadas abajo). La última opción es pedir el piloto sin C129 y hacer obligatoria la medición de VSYS del banco (abajo). Si esa medición falla, se corrige antes de las 108.
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## Qué medir en el piloto
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Para lo que se queda (5, 7, 8) y para confirmar el 1. Usa punta corta con resorte de tierra y la unidad completa (módem y ArduSimple conectados).
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| Qué | Dónde | Pasa si |
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| VSYS al cargar a corriente máxima y en respaldo con el módem transmitiendo | U6.1 contra el EP | picos < 5.8 V, sin oscilación |
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| Riel del módem en ráfagas de transmisión | J7.1 | caída < 150 mV y sin reinicios del módem en 20 ciclos de 10 s |
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| GNSS con el módem transmitiendo y apagado | C/N0 promedio en u-center | diferencia < 2 dB |
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| Nodos SW de U6, U7, U12 y U2 | sonda de campo cercano | sin picos nuevos contra una V5.5 en la misma mesa |
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| Vías de entrada (162.6, 113.02) y (151.0, 115.54) | cámara térmica, 2.5 A | < 10 °C sobre la tarjeta |
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## Cómo se hizo
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- **Archivo:** se copió el `.kicad_pcb` de las 18:59 y se comparó por UUID contra `7650b96` (T30). Se encontraron 21 huellas cambiadas (L7, la red de compensación de U7, y JP/TP re-guardados por KiCad), 142 tramos nuevos, 129 borrados y 5 vías nuevas por 4 borradas.
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- **DRC y ERC:** KiCad 10.0.4 en una copia, con zonas rellenadas y paridad.
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- **Medidas:** script propio sobre el cobre rellenado:
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- vías de corte por red de potencia;
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- caminos en serie con su resistencia (1 oz exterior, 0.5 oz interior);
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- distancia de cada convertidor (U6, U7, U12, U2) a sus capacitores de entrada, inductor y diodo;
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- si esa unión es directa en F.Cu o pasa por vías.
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- **Historia:** las mismas medidas sobre `v5.5-as-fabbed`, `5a93232`, `f65c830` y `7650b96`. Los puntos 1 y 8 son idénticos desde la V5.5.
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- **Lugar para C129:** búsqueda en rejilla de 0.1 mm alrededor de la esquina 1/24 de U6, para 0603 y 0805. Se descartaron las posiciones que pisan el courtyard de otra pieza o quedan a < 0.2 mm de cobre ajeno. Ningún lugar a ≤ 3 mm sale libre sin tocar pistas; el mejor solo choca con las 3 señales del paso 3.
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- **Hoja de datos:** LTC4040 (Analog Devices, rev. B): sección *PCB Layout Guidelines* y capacitor de VSYS (mínimo 100 µF cerámicos en total; el de los pines, primero).
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