- docs/hardware/t42b-hv24-28oct.md (+3 figuras): qué estaba mal en la clase HV24, las reglas F-01, los arreglos de
cobre de cada tarjeta, cómo se probó (DRC, paquete, red de cada vía/pista/pad en el Gerber) y la revisión
independiente en 2 rondas (NO-GO por una vía de costura que el paquete sacaba como /3V3; corregido; GO).
- diseno-v56/v57 v1.5 (§12 clases y reglas, §13 E-15/T42b hechos, §14 historial), victorias rápidas (§4 hecho),
instrucciones para Leo v1.3 (los paquetes del piloto ya llevan T42b; commit 8b0a23a o posterior).
- hardware/index.md y bitácora: entrada del 28-oct. mkdocs.yml: Auditorías y pasadas. sync-docs.sh: MAP de T42b.
- backend/lotes/2026-10-28_t42b-hv24.json: t-v5-t42b-hv24 a Hecho, nota y descripción en t-v56-piloto, lección
para t-v6-g1-paquete (gerber_netcheck.py).
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- Descargas: hbox-tarjetaV56_0.7.0-pre.bin en prueba/ (112 456 B, SHA-256 8dd26047…), fila V5.6/V5.7 y aviso
«solo banco»; notas de versión 0.7.0-pre; README del firmware al día (sync).
- Procedimientos (borrador, T43): prueba y flasheo V5.6/V5.7 (con la revisión del firmware: 4 flancos, 180 s,
DIN_4G en 0 V en Q, DE de U7 y R48 en banco) y ensamble V5.6/V5.7.
- Actas nuevas: prueba-v56 / prueba-v57, ensamble V5.6 / V5.7, banco del piloto; series ARD/RTK hasta 100,
V56/V57; expediente, actas, producción y admin conocen los tipos nuevos.
- Bitácora 27-oct: firmware, procedimientos y actas, faltan ArduSimple.
- Tablero (lote aplicado): t-compras-ardusimple, D-27-7, notas en t-fw-070, t-banco-v5-procedimiento-t43,
t-v56-banco-piloto, t-v57-banco-prototipos, t-inventario-inicial, t-compras-prioridad, t-plan-570.
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Páginas nuevas: hardware/instrucciones-leo-27oct (pedido del piloto paso a paso, decisiones D-26-1/D-22-4/D-22-6, SIM nano/micro, cambios de T47) e instrucciones-michelle-27oct (Actualizar PCB con T48 + T49 y el cobre que se borra, con 2 figuras; bloques A–H de la semana). Al día con T47/T48/T49: revisión del pedido (A2 cerrado), diseño V5.6/V5.7 (v1.4) y v6 (v1.2), auditoría final, FOTA (RCT6 en el piloto), costeo (aviso), índice de hardware y bitácora. Lote aplicado (20 cambios); el del costeo sigue para Leo.
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Página hardware/revision-pedido-26oct (revisión de un agente + verificación de Claude): paquete
bien (regenerado idéntico), 7 piezas sin existencia en JLC ni para 5 tarjetas, CPL con 21/20
rotaciones equivocadas contra la huella de JLC (U14 a 180°, electrolíticos invertidos, D20/U8/U12
a 90°, JST al revés) y Q6 1.9 mm corrido. CPL propuestos y tablas en hardware/files/.
Avisos en los documentos de diseño V5.6/V5.7 y en la auditoría final del 22-oct; índice de
hardware y bitácora al día. Lote 2026-10-26_revision-pedido-v56-v57.
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Página nueva hardware/designadores-t43-22oct: reglas, resultado por tarjeta,
mapas de designadores para el banco (V5.6, V5.7, v6), cómo se comprobó,
D-22-9 (designadores de 0.5 mm, debajo del mínimo de JLC), lo que sigue con
la numeración vieja, comandos para Michelle y tablas viejo -> nuevo (+ CSV).
Índice de hardware, bitácora, decisiones de ingeniería y Ruta (V5.6, V5.7,
v6) al día; T42a marcado como aplicado (D-22-7: a); aviso de numeración
vieja en el pinout y la hoja de datos de la V5.6 y en el mapa de pines de la
v6. Lote 2026-10-22_t43-designadores.
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Lista de trabajo para Michelle (U25/U20, vías térmicas, anchos de potencia, F2),
pendientes de Leo y parámetros de pedido JLCPCB. Diagrama del lazo caliente de U25.
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- backend Flask (backend/): recibe formularios firmados, guarda JSON por
numero de serie en /srv/projects/drogheda/actas, indice CSV, GET /api/actas
+ systemd unit + README de instalacion (nginx /api proxy)
- formularios (docs/formularios/): acta.css/acta.js (motor con autoguardado
y envio), V5 fiel al procedimiento verificado, V4 borrador adaptado,
checklist de ensamble borrador; firma = nombre + conformidad
- docs/actas/index.md + guia-ensamble-qc.md; nav actualizada
- probado end-to-end (headless): envio + validacion + guardado por serie
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