Leopoldo Rodríguez
4c0b98cc27
Co-Authored-By: Claude Opus 5.5 <noreply@anthropic.com> Claude-Session: https://claude.ai/code/session_01QCy5VHMVLkAmftYM6swWmx
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12 KiB
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title: "HBOX v6 — Auditoría pre-fabricación"
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tags: [project-drogheda, hardware, hbox, v6, pcb, auditoria, jlcpcb]
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project: Project Drogheda
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author: Helgen Technologies
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date: 2026-09-25
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version: 1.0
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status: ACTIVO — NO se ordena hasta cerrar la sección 3
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audience: Michelle (layout), Leo
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# HBOX v6 — Auditoría pre-fabricación
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!!! warning "Designadores de antes del 22-oct (T43)"
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Este documento conserva los designadores que tenía la tarjeta en su fecha. Desde el 22-oct (T43) la V5.6, la V5.7 y la v6 traen otros, y varios nombres viejos ahora son otra pieza: en la v6, U6 es ahora el módem A7670SA (antes U19) y el LTC4040 es U17 (antes U6). Para leerlo contra la tarjeta de hoy, usa la [tabla viejo → nuevo](designadores-t43-22oct.md#8-tablas-viejo-nuevo); lo que ya no existía el 22-oct no está en la tabla.
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!!! warning "EinarBoard v6 (`hbox-watchdog-v6`): en diseño, no se pide"
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Diseño nuevo con ZED-F9P y módem A7670SA soldados a bordo. **No es la V5.6** que se manda a fabricar esta semana (`hbox-watchdog-v5`, zócalos para simpleRTK2B y 4G NTRIP Master). Los hallazgos marcados «Impacto en V5.6» ya se aplicaron a la V5.6 y están en su informe de cambios.
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!!! warning "Sustituida por la auditoría del 28-sep"
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Esta auditoría del 25-sep queda como **histórico**. La sustituyen la [auditoría completa del 28-sep](v6-auditoria-completa.md)
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y su [plan de corrección y estado](v6-plan-correccion.md).
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Tarjeta: `hbox-watchdog-v6` (repo HBox_PCB) · Pedido previsto: 5 prototipos en JLCPCB
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(PCB + ensamble) · Fecha: 25-sep-2026 · [English version](v6-prefab-audit.md)
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!!! warning "Veredicto: todavía no se ordena"
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Lo que dependía de esquemático, BOM y atributos ya está resuelto (sección 2).
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Faltan trabajos de layout (sección 3, Michelle) y tres decisiones/compras (sección 4, Leo).
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Cuando Michelle suba su trabajo se repite la auditoría completa y se da el GO final.
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Estado hoy: DRC **0 errores**, 0 sin conectar, 0 pistas colgando · ERC **0 errores** ·
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BOM: todas las piezas pobladas tienen número LCSC verificado.
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## 1. Por qué "DRC 0" no basta
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El DRC solo compara la geometría contra las reglas de separación del propio archivo. **No ve**:
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- un regulador conmutado con su diodo a 18 mm (debe estar a ≤ 4 mm),
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- una pista de 0.25 mm llevando 2.5 A,
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- una pieza sin número LCSC (JLC simplemente **no la coloca**),
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- un chip de potencia **sin vías** bajo su pad térmico.
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Eso es lo que revisó esta auditoría.
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## 2. Lo que ya quedó resuelto (no hay que hacer nada)
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| # | Qué | Detalle |
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|---|---|---|
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| ✅ | SIM: el porta-SIM físico es ahora el principal | Telcel no dará la MFF2. **J14** (nano-SIM JAE, LCSC C2977286) + R131–R134 se montan; U22 (MFF2) + R127–R130 quedan **sin montar (DNP)**. La huella de la MFF2 se queda en la tarjeta como opción futura. |
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| ✅ | **U19 (módem) y L22** marcados SMD | Estaban como "through-hole" y JLC los habría dejado fuera de la línea SMT. Corregido también en la librería. |
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| ✅ | **64 piezas sin número LCSC** | Todas con número verificado en la base de JLC (Basic cuando se pudo). JP1–JP5 (puentes de soldadura) fuera del BOM. |
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| ✅ | **Fusible de entrada F2** | Ahora es fusible en porta-fusible: Littelfuse **0154002.DR** (C206910), bloque SMD 9.7 × 5 mm con fusible NANO2 de 2 A / 125 V. En campo se saca y se cambia el fusible sin soldar. *(Falta cambiar la huella en el PCB → tarea M2.)* |
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| ✅ | Barrenos de montaje | Los 4 en un rectángulo exacto de **130.0 × 90.0 mm**, a 5 mm de cada orilla; nombres únicos MH5–MH8. |
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| ✅ | Limpieza | 6 tramos de pista colgando borrados; copias "respaldo" fuera de git; reglas de ancho de potencia en el DRC. |
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## 3. Lo que falta — lista de trabajo de **Michelle**
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!!! warning "Antes de empezar — tres reglas"
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1. **Primero `git pull`.** El `.kicad_pcb` cambió hoy (atributos, LCSC, barrenos, fusible).
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Si trabajas sobre una copia vieja y la guardas, se pierde todo eso.
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2. **NO usar "Actualizar PCB desde esquemático"** hasta que Leo decida J10/P11/P12 (sección 4):
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los volvería a poner como montados.
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3. Si KiCad avisa que el archivo cambió en disco, elegir Recargar. Nunca guardar encima una copia vieja.
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Orden recomendado (de mayor a menor impacto):
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### M1 · Traer los cambios
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- [ ] `git pull` en HBox_PCB (ver sección 6).
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### M2 · Cambiar la huella de F2 (fusible)
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- [ ] En el PCB: clic derecho en **F2** → *Change Footprint…* → `Fuse:Fuseholder_Littelfuse_Nano2_154x`.
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- [ ] El bloque mide **9.7 × 5 mm** (antes 4.5 × 3.2). Acomodarlo cerca de donde está (159.5, 127),
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entre **P1** (entrada 24 V) y **Q23**. Pistas **/24V_IN** y **/VIN_FUSED** de **≥ 1.5 mm**.
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- [ ] Dejar acceso con pinzas al fusible (se saca hacia arriba): nada alto a menos de 2 mm de sus lados largos.
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### M3 · Rehacer el grupo del regulador U25 (24 V → 5 V) — **la más importante**
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Problema: U25 (TPS54360B) está 15 mm al norte de sus piezas de potencia:
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| Medida | Hoy | Objetivo |
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|---|---|---|
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| Diodo **D34** (cátodo) → pin 8 (SW) de U25 | **18.2 mm** | **≤ 4 mm** |
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| Capacitores de entrada **C149/C150** → pin 2 (VIN) | 5–8 mm | **≤ 3 mm** |
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| Inductor **L22** (pad 1) → pin 8 | **25.9 mm** | ≤ 12 mm (L22 es grande; se acepta) |
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| Cobre del nodo SW (pin 8 → D34 → L22) | pista 0.5 mm | **polígono ≥ 2 mm**, lo más corto posible |
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| Vías GND bajo el pad térmico de U25 | **0** | **≥ 6** (a In1 e In2) |
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| R120–R123, C155, C156 (compensación/FB/RT) | cerca | ≤ 5 mm de los pines 3–6, lejos de SW |
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<figure markdown>
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{ width="100%" }
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</figure>
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Idea clave: junto a U25 ya no hay lugar (el cargador U6 y sus piezas ocupan el noreste).
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Entonces **U25 baja a donde están sus piezas grandes**, en vez de subir las piezas grandes.
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Pasos:
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- [ ] **Paso 1 — Sacar C151** (electrolítico 100 µF, hoy en 173.75, 123.9). Es solo reserva de
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energía: funciona igual a 10–20 mm. Sugerencia: rotado 90°, centrado en ≈ **(169.5, 112)**,
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el hueco que deja U25. Sigue conectado a **/VIN_PROT**.
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- [ ] **Paso 2 — Poner U25 donde estaba C151**, centro aprox. **(175.5, 124.5)**, girado para que:
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el **pin 8 (SW)** quede en la esquina **más cercana al cátodo de D34** (el pad sur de D34, en 182.5, 126.65),
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y el **pin 2 (VIN)** mire al oeste.
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- [ ] **Paso 3 — C149 y C150 pegados al pin 2 (VIN)**, a ≤ 3 mm, con su lado GND hacia el pad
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térmico de U25. Este es el lazo que radia: **entrada → U25 → D34 → GND → entrada**. Chiquito.
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- [ ] **Paso 4 — D34 se queda** donde está (182.5, 123.25). Su ánodo (GND) va a la misma isla de
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GND que C149/C150 y el pad de U25.
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- [ ] **Paso 5 — L22 se queda.** Unir pin 8 → cátodo de D34 → pad 1 de L22 (193.5, 126.9) con **un
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polígono de ≥ 2 mm**. No más ancho de lo necesario (es la parte que "grita").
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- [ ] **Paso 6 — Piezas chicas junto con U25:** C152 (BOOT) entre pin 1 y pin 8; R120, R121, R122, R123,
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C155, C156 del lado de los pines 3–6 (lado silencioso). El divisor FB (R121/R122) toma el 5 V
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en los capacitores de salida C153/C154, no en el pad del inductor.
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- [ ] **Paso 7 — Tierra:** una sola isla de GND en F.Cu bajo todo el grupo, **≥ 6 vías bajo el pad
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térmico de U25** y 2–3 vías junto al GND de cada capacitor y del ánodo de D34.
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- [ ] **Paso 8 — /VIN_PROT** desde Q23 hasta C149/C150: **≥ 1.5 mm** (o polígono).
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!!! tip "Referencia"
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Es el mismo acomodo que el diseño de referencia de TI para el TPS54360 y que la
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[Guía de cobre y colocación EMC v6, §2](EinarBoard-v6_Plan-de-Cobre_ES.html).
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### M4 · Mismo arreglo, más chico, en el regulador del módem U20
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| Medida | Hoy | Objetivo |
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|---|---|---|
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| L20 (pad SW) → pin 8 (SW) de U20 | 7.6 mm, pista de **23 mm** a 0.25 mm | **≤ 3 mm**, pista corta **≥ 1 mm** |
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| C127 (10 µF) → pin 2 (VIN) de U20 | 5.4 mm | **≤ 3 mm** |
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| Vías GND bajo el pad de U20 | 0 | **≥ 4** |
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- [ ] Acercar **L20** al pin 8 de U20 y rutear **/SW_MODEM** directo y ancho.
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- [ ] Acercar **C127** al pin 2. (C128 ya está bien, a 2 mm.)
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- [ ] Vías bajo el pad térmico de U20.
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### M5 · Vías bajo los otros chips de potencia
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- [ ] **U6** (LTC4040, cargador de batería), **U2** y **U12** (MP1584): hoy **0 vías** bajo su pad
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térmico. Poner **≥ 4** en cada uno (el pad térmico también es su tierra y su disipador).
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### M6 · Ensanchar las pistas de potencia
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Usa esta tabla (la lista de avisos del DRC está incompleta: no marca SW_BAT ni las del módem).
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| Prioridad | Red | Hoy | Objetivo | Por qué |
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|---|---|---|---|---|
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| 1 | **/SW_BAT** | 0.25 mm, 12 mm | **≥ 1.0 mm** o polígono | ~2.5 A de batería. Ya se marcó crítica en la v5.5 (0.3 mm); en v6 está más delgada. |
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| 2 | **/VEH5V** | cuello 0.25 + 0.5 mm, ~110 mm | **≥ 1.0 mm** | Salida de U25, hasta ~3 A |
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| 3 | **/MAIN5V**, **/SYS5V** | 0.25–0.5 mm, 100–150 mm c/u | **≥ 1.0 mm** en el tronco | 5 V principal de toda la tarjeta |
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| 4 | **/BAT_PLUS** | 0.25–0.5 mm, 118 mm | **≥ 1.0 mm** | Corriente de batería |
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| 5 | **/SW_MODEM** | 0.25 mm, 23 mm | ≥ 1.0 mm y corta | Se resuelve con M4 |
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| 6 | **/VBAT_MODEM** | cuello 0.25 (1 mm), 0.5 (11 mm) | **≥ 1.0 mm** | Picos de 2 A al transmitir |
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| 7 | /VIN_MODEM, /SW_IN, /VIN_SW | 0.25–0.5 mm | ≥ 0.8 mm | Entradas de reguladores |
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| — | /VIN_PROT, /SW_PWRIN | 0.5 mm | — | Se resuelven con M3 |
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| No | /3V3_ETH, /5V_FAN, /SW_FAN, /FAN_RET | 0.25–0.5 mm | dejar | Menos de 0.3 A |
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- [ ] Prioridades 1 a 7.
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### M7 · Cerrar
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- [ ] Rellenar zonas (tecla B) — los barrenos se movieron y el relleno es viejo.
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- [ ] **DRC → 0 errores.** (Los avisos amarillos de ancho de pista que queden en redes "No" de la tabla están bien.)
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- [ ] Revisar en el visor 3D que **J14** (porta-SIM) tenga el frente libre: la tarjeta entra por un
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extremo corto; confirmar cuál en el dibujo de JAE y dejar ~6 mm libres enfrente.
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- [ ] `git add` + `commit` + `push` (sección 6) y avisar a Leo.
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## 4. Lo que falta — **Leo**
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- [ ] **Pre-ordenar J14** (C2977286) en la cuenta de JLC: es parte "Pre-ordered", sin eso no la colocan.
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- [ ] **Decidir J10 (RJ45), P11 y P12:** ¿se montan en esta corrida? Hoy están DNP solo en el PCB.
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- [ ] Revisar las piezas donde la elección importa: L20 Sunlord MWSA0804S-4R7MT (C17700167; checar que sus pads
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entren en la huella SRU8028), L21 Murata LQG18HN68NJ00D (C162555, choke de la antena GNSS),
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C149/C150 2.2 µF 100 V (C153036), C151 Nichicon 100 µF 50 V (C116241), RS1 10 mΩ 1 W (C105362),
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F2 0154002.DR (C206910).
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## 5. Parámetros del pedido en JLCPCB (cuando haya GO)
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| Opción | Valor |
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|---|---|
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| Capas / espesor | 4 capas, 1.6 mm, stackup **JLC04161H-7628** |
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| Acabado | **ENIG** (obligatorio por los módulos LGA U19 y U18) |
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| Ensamble | Standard PCBA, solo lado superior |
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| Rayos X | Pedir en **U19** (A7670SA) y **U18** (ZED-F9P) |
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| Pre-orden | **J14 C2977286** antes del pedido |
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| Piezas through-hole | H4, J9, J11, K1, P1–P10, SW1, SW2 (16): soldar a mano en 5 piezas es razonable |
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| Archivos | BOM/CPL generados del PCB (Fabrication Toolkit). Revisar rotaciones en la vista previa de JLC: U19, U18, J14, SOT-23 |
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## 6. Comandos de git
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Michelle (clon de HBox_PCB):
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```bash
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git pull
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# … trabajo en KiCad, guardar …
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git add hbox-watchdog-v6.kicad_pcb
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git commit -m "v6 layout: U25/U20 regrouped, thermal vias, power widths, F2 holder"
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git push
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```
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Leo (proyecto Drogheda, después de que Michelle suba):
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```bash
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cd ~/Documents/Claude/Projects/Drogheda/03-Architecture-Hardware/kicad && git pull helgen main
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cd ~/Documents/Claude/Projects/Drogheda && git add 03-Architecture-Hardware/kicad && git commit -m "bump kicad" && git push
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```
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## 7. Historial de cambios de esta auditoría (HBox_PCB)
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| Commit | Qué |
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|---|---|
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| `bb78cb8` · `0288bd0` | T14: J14 principal, U22 DNP, errores ERC corregidos, LCSC de J14 |
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| `91d2049` · `8a49327` | T15: LCSC en 64 piezas, JP fuera del BOM, SIM + U19/L22 en el PCB, pistas colgando, avisos de ancho; librería |
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| `61652cc` | T16: barrenos 130 × 90 mm, MH5–MH8 |
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| `d2db77f` · `03d83d1` | T17: fusible F2 → porta-fusible 0154002.DR |
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## Historial de revisiones
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| Versión | Fecha | Cambios |
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|---|---|---|
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| 1.0 | 2026-09-25 | Auditoría pre-fabricación v6 y lista de trabajo. |
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| 1.1 | 2026-09-29 | Presentación: vocabulario de avisos. Sin cambios técnicos. |
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