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Tarjetas y hardware

Tarjetas y hardware

Estado de cada versión de la EinarBoard al 22-oct-2026, con sus documentos vigentes, los históricos y el siguiente paso. ¿No sabes qué tarjeta tienes? Manuales por tarjeta te la identifica por serigrafía, conectores y LEDs. Estado vivo (tareas, decisiones, responsables): Tablero de ingeniería.

!!! success "22-oct: auditoría final de producción de V5.6 y V5.7 — GO al piloto de 5 + 5 con tres condiciones de pedido" - V5.6 y V5.7 — paquetes verificados. HBOX_v5_Rev6_PROD y HBOX_v5_Rev7_PROD son idénticos a una regeneración con relleno fresco (0.000 mm² de diferencia); DRC solo con los 3 de MOD1, 0 sin conectar, paridad solo PWR_FLAG, RS1 Kelvin en las dos; BOM y CPL cuadran con el PCB. Todos los puertos funcionan en hardware; la V5.7 va de 9 a 32 V sin la SD-15B; el apagón del módem de la V5.5 desapareció por diseño. - Condiciones del pedido (no tocan el cobre): (1) vías Epoxy Filled & Capped + rayos X en U6 (3 vías dentro de la pasta del QFN); (2) rotación y polaridad en el visor de JLC (U6, U7, U25, U26, L22, Q7, U16, D34, D10, electrolíticos: huellas easyeda2kicad nunca fabricadas); (3) BOM: D10 SMBJ33A → SMBJ33CA. - NO-GO para las 108 / 322 hasta que el piloto pase el banco con el firmware 0.7.0: hoy ningún firmware enciende el módem de estas tarjetas. board_v56.h ya existe; 0.7.0-pre (módem, NTC, LFP, ignición por ADC) es 1 día y va antes de que lleguen las tarjetas. - P-1 cerrado a las 13:00: Leo rellenó, guardó y regeneró los paquetes; re-verificado a las 13:30 (relleno guardado = fresco, 0.000 mm²; mismo cobre y mismo paquete que en la mañana; BOM/CPL iguales). Falta el commit de kicad/ y production/. Regla D-22-3: todo script T que toque cobre termina con rellenado en el GUI (re-verificación). - v6: T39 (22-oct, Claude) hizo el bloque A con la propuesta α, y T40 (22-oct, tarde) dejó libre MH4: D23 y D24 fuera del barreno, /SIM_CLK por In1, /SIM_RST por arriba de D25 y /NTC alrededor del barreno. DRC: 11 errores (los encimes de margen), 0 sin conectar. Falta el push de T40 y que Leo decida D-22-4 (las TVS de la SIM junto a J14) → estado de la v6, §7.

[**▶ Auditoría final (veredicto, hallazgos, riesgos)**](auditoria-final-22oct.md) · [PDF completo, 33 pp.](2026-10-22_Drogheda_Auditoria-Final-Produccion_V5.6-V5.7_ES_v1.0.pdf) · [presentación, 19 láminas](2026-10-22_Drogheda_Auditoria-Final-Produccion_V5.6-V5.7_Presentacion_ES_v1.0.pdf) · [protocolo](auditoria-final-protocolo.md). Antes: [auditoría del 21-oct (pasadas 4 a 6)](v56-v57-auditoria-21oct.md) · [re-auditoría del 19-oct](re-auditoria-19oct.md) · [qué es crítico en la V5.6](v56-clasificacion-19oct.md) · [plan v6 (rev. 1.5)](v6-plan-fines-de-semana.md).

Tarjeta	Estado	Pedido	Proyecto KiCad	Firmware
V5.5	En campo (15 pzas, 22-ago). No se fabrica más.	—	hbox-watchdog-v5 (tag v5.5-as-fabbed)	hbox-v5-bringup_0.6.0 CAMPO · 0.6.3 banco
V5.6	Auditoría final del 22-oct: GO al piloto con tres condiciones de pedido (vías tapadas + rayos X en U6, visor de JLC, D10 → SMBJ33CA). Paquete HBOX_v5_Rev6_PROD verificado = cobre con relleno fresco; DRC y paridad limpios. P-1 cerrado a las 13:00 (relleno fresco en el repo, re-verificado; falta el commit) (auditoría final).	113 (piloto de 5 primero, se pide hoy)	hbox-watchdog-v5	0.7.0: board_v56.h listo; 0.7.0-pre por escribir (1 día)
V5.7	Auditoría final del 22-oct: GO a los 5 prototipos con las mismas condiciones. Fuente U25 a 5.32 V / 600 kHz: 9–32 V sin la SD-15B; C149/C150 se quedan (D-21-2) y el timbre se mide en banco; D10 → SMBJ33CA es obligatorio aquí (con el arnés al revés abre F2, que es SMD) (auditoría final).	327 (5 prototipos primero, se piden hoy)	hbox-watchdog-v57 (convive con v5)	el mismo 0.7.0 (mismos pines de MCU)
v6	Revisada el 22-oct (d5f5002 + T40): NO LISTA. T28 cerró 2 de los 8 bloqueantes de la auditoría v6, T25 regresó los barrenos, T38 corrigió courtyards, MH6 y el /3V3 bajo los barrenos, T39 hizo el bloque A (D34 entre U25 y L22, MH8 libre) y T40 liberó MH4. Faltan los bloques B a H y D-22-4 (estado, §7). Plan: fines de semana 24-oct → 22-nov.	130 + reemplazos (piloto de 20, pedido previsto el 2-nov)	hbox-watchdog-v6	0.7.x (board_v6.h + NTRIP), no existe
V4	En prueba y campo. Sin producción nueva.	—	hbox-watchdog-v4	hbox-tarjetaV4_0.6.0 CAMPO
V3	3 unidades en campo. Registro congelado.	—	hbox-watchdog-v3-PROD (no editar)	hbox-tarjetaV3_4.0.0

!!! warning "Reglas que aplican a toda revisión" - DFM del LTC4040 (U6, QFN 4×5, 8-oct): pasta del pad expuesto ≤ 50 %; vías del EP rellenas y tapadas (JLC Epoxy Filled & Capped) o fuera de las ventanas de pasta; pedir X-ray/AOI en U6; revisar U6 con lupa en cada tarjeta antes de energizar. Aplica a V5.6, V5.7 y v6. - Nada de corriente por capas internas (In1 e In2 son de 0.5 oz): /BAT_PLUS, /MAIN5V, /SYS5V y los nodos de conmutación van por F.Cu/B.Cu a ≥ 1.5 mm. Hallazgo de la auditoría del 13-oct. - Barrenos de la V5.5 de producción (16-oct): MH5 (65.2, 45.3), MH6 (65.2, 135.3) y MH4 (185.2, 90.3) de 3.2 mm para la placa base; MH7, MH9, MH10 de 2.75 mm para el ArduSimple (la V5.5 tiene además MH11 para la abrazadera; V5.6 y V5.7 no lo llevan, decisión del 16-oct). Como huellas «No en el esquemático» para que Actualizar PCB no los borre (script T25). Sin cobre ajeno a GND a menos de 3.1 / 2.6 mm del centro. - Sensado Kelvin de RS1 (16-oct): U6.6 (VIN) y U6.7 (CLN) con pista propia directo a los pads de RS1; la corriente de entrada pasa solo por RS1. Sin esto el límite de entrada del LTC4040 queda en ≈ 1 A. En V5.6/V5.7 lo deja así el script T27 (RS1 girado 180°): figura y explicación. Prueba en banco: (TP1 ÷ 32) ÷ voltaje en RS1 ≈ 1.0. - Archivos de KiCad: una persona por tarjeta a la vez (19-oct, después del merge del lunes): git pull --ff-only antes de abrir el PCB; commit y push al terminar, y avisar en Mattermost. Los scripts (T25…T30) los corre Leo con KiCad cerrado y el árbol limpio. Git ya no mezcla archivos de KiCad línea por línea (merge=binary, 4f4681f). Qué pasó. - Relleno de zonas antes del commit (22-oct, D-22-3): el .kicad_pcb que va a git lleva el relleno fresco (abrir, B, guardar); un Gerber exportado sin rellenar (kicad-cli, o el GUI sin B) manda cobre encima de las vías nuevas. El Gerber de producción sale del Fabrication Toolkit (rellena solo) y se compara contra el cobre antes de pedir (auditoría final, §2). - El firmware se elige por tarjeta, nunca por número de versión: Descargas.

V5.5 — en campo

Estado. 15 tarjetas fabricadas el 22-ago-2026 (JLCPCB), en ensamble, taller y puertos. Es la tarjeta que hoy tienen los técnicos en la mano. Diseño congelado (v5.5-as-fabbed); no se corrige ni se vuelve a fabricar: sus defectos se arreglan en la V5.6.

	Documentos
Vigentes	Manual de la tarjeta V5 (V5.5 y V5.6) · Pinout V5.6 (sección «Diferencias V5.5 → V5.6» al final) · Hoja de datos V5.6 (valores comunes)
Procedimientos	Prueba y flasheo · Módem 4G en batería · Ethernet y puertos serie
Históricos	Auditoría EMC del 22-ago (03-Architecture-Hardware/2026-08-22_Drogheda_EinarBoard-v5_EMC-Audit_v1.0.md, repositorio): /SW_BAT 0.3 mm y /BAT_PLUS finos → corregidos en la V5.6
Lo que no hace	Ciclo de etapa en batería (el módem no arranca en frío sobre el boost). Regla de campo: respaldo continuo, nunca ciclos de etapa en batería.
Hallazgo del 16-oct	El límite de entrada del LTC4040 quedó en ≈ 1 A (diseño 3.1 A) por el ruteo del sensado de RS1: con la unidad trabajando, la batería carga a ≈ 0.4–0.5 A. Sin retrabajo; confirmarlo en banco con un multímetro: auditoría §4.3, o con TP1 a cualquier corriente: §4.5.

Siguiente paso. Ninguno de diseño. En taller: diagnóstico y reflasheo con el binario V5 vigente; medir el límite de entrada en una unidad.

V5.6 — auditoría final → piloto de 5 → pedido de 113

Estado. Esquemático cerrado (ECO 27/28-sep + acelerómetro U26 el 8-oct − sonda P12 el 9-oct). Pasada 3 de Michelle (17 y 19-oct, be30764 → 13af8f3) y arreglo del merge de Leo (240e2c3). Re-auditada el 19-oct: casi lista.

• Hecho: barrenos de la V5.5 (sin MH11), sensado Kelvin de RS1, /BAT_PLUS sin capas internas, /MAIN5V a 1.0–1.5 mm, /3V3_MODEM a 1.0 mm, 4 vías en el EP de U7, sin cobre suelto. DRC: solo los 3 errores de MOD1 (MH7/MH9/MH10, por diseño), 0 sin conectar, paridad limpia.

• Ya lo hizo T30 (7650b96, 19-oct): vías en paralelo en los cambios de capa de potencia (18 vías), las 4 vías «micro» a vías normales, JP/TP/MOD1 fuera del BOM y del CPL, cajetín Rev 5.6 y stackup JLC04161H-7628.

• Pasada 4 entregada el 21-oct (85e7602): C129 colocado (T31 + F8), rama de Dbk2 fuera, U7 girado (L7.1 a 4.0 mm de U7.8), vías de /MAIN5V hacia P11 de vuelta.

• T32 + T33 (21-oct, tarde): C130 en el esquemático; fuera el corto de R106 y la separación de 0.09 mm; 2.ª vía de VSYS; 3 vías en cada cambio de capa de /3V3_MODEM y de /SYS5V hacia U12; vías sueltas fuera. DRC: solo los 3 errores de MOD1, 0 sin conectar.

• Pasada 5 (6458c5d, 21-oct, noche): C130 junto a U7.2 con su vía a GND y la vía al GND de C129. Nuevo: la vía de entrada de RS1 quedó encima del hilo de sensado de U6.6 (ya no es Kelvin) y la «2.ª vía» de RS1 no está unida en B.Cu.

• Pasada 6, hecha por Claude (21-oct, noche): T34 regresa el sensado Kelvin de RS1 (2 vías de entrada unidas en F.Cu y B.Cu; el hilo de U6.6 entra al pad por su lado), quita la vía colgando y el tramo de /RS485_B, y excluye los 3 errores de MOD1; T35 pone la 2.ª vía de la entrada de U7. DRC: 0 errores, 0 sin conectar, paridad solo PF*. Cobre listo para Gerber (pasada 6).

  L7 y lo heredado de la V5.5 se pueden quedar para el piloto, y se miden en el banco: ▶ qué es crítico y qué se puede quedar.

Lleva Mean Well SD-15B-05 externa (igual que V5.5).

	Documentos
Vigentes	▶ Auditoría del 21-oct, pasadas 5 y 6 · Pasada 4 (19-oct) · Re-auditoría 19-oct · Auditoría de producción 16-oct (requisitos uno por uno, prueba de RS1) · ECO V5.6 — requisitos R1–R5 · Cambios al esquemático V5.5 → V5.6 · Reglas de layout esquemático → PCB
Referencia	Hoja de datos V5.6 · Pinout V5.6 — generados de la netlist del 28-sep: todavía listan P12 y no traen U26; se regeneran al cerrar la pasada 4
Históricos	Layout pasada 3 (16-oct) — cerrada; lo pendiente pasó a la pasada 4 · Layout pasada 2 (13-oct) y auditoría del 13-oct (inglés) · Layout pasada 1 (12-oct)
Firmware	0.7.0 con board_v56.h (control del módem por MODEM_EN/RST, ciclo de 10 s en batería, Ethernet de campo, SC16IS752/RS-485, acelerómetro, ignición por ADC, paquete LFP-HT). No existe todavía; ningún 0.6.x enciende su módem.
Decisiones pendientes (Leo)	D-19-1, hoy: portar las correcciones de puertos de la v6 (inversor U32 para el RS-485, TVS D39, R147 en RS-232, J10.8 a GND, LED de actividad); si van, entran al piloto. D-19-2: resuelta el 20-oct, Dbk2 fuera (T31). D-21-1: C130 de 100 nF en la entrada de U7 (auditoría §4). Re-auditoría §7 · auditoría 16-oct §10.

Siguiente paso. Leo hace commit y push de T34 + T35 → B + DRC en KiCad (debe salir igual) → Gerber/BOM/CPL con Fabrication Toolkit → piloto de 5 (pedido ≈ 21–22-oct, junto con los 5 prototipos de V5.7) → banco con 0.7.0 (ciclo de 10 s ×20, carga, Ethernet, RS-232/485, acelerómetro) → las 108 restantes.

V5.7 — fuente a bordo (9–32 V) → 5 prototipos → pedido de 327

Estado. Decidida el 12-oct, esquemático aplicado el 13-oct (ERC 0): V5.6 + bloque de entrada de la v6 (U25 TPS54360B, 5.32 V fijos), fusible F2 SMD 3 A, fuera el buck del ventilador U2 y la entrada P2, JP1 puenteado. Proyecto KiCad separado hbox-watchdog-v57. Rango de entrada: 9–32 V DC (12 y 24 V). Pasada 3 de Michelle (f3f35f4, 17-oct). Re-auditada el 19-oct: NO LISTA, pero avanzó mucho.

• Hecho: ya replica la pasada 2 de la V5.6 (/BAT_PLUS por B.Cu de 1.5 mm, /MAIN5V y /SW3_NODE fuera de capas internas); el EP de U25 tiene 6 vías y el divisor de FB quedó a 0.6 mm (nodo FB de 3 mm).
• Bloqueante: /SYS5V va 10.9 mm por In2 a 0.5 mm bajo K1: 81 mΩ en serie con el buck del módem.
• Importante: el lazo de entrada de U25 mide 52 mm² (meta < 30) y su nodo SW 48 mm²; L22 está a 10 mm de D34.
• Lo hace T30: lo mismo que en la V5.6, más 11 vías de tierra en la entrada y la salida de U25, y borra 12 cobres sueltos.
• Pasada 4, auditada el 21-oct (1416dcb): hechos /SYS5V fuera de In2, L22 junto a D34, U7 girado (L7.1 a 0.4 mm), C129 y la serigrafía de Cbst2.
• T32 + T33 (21-oct, tarde): C130 en el esquemático, 2.ª vía de VSYS y otros 3 cambios de capa del 5 V reforzados, vías sueltas fuera. DRC: solo los 3 errores de MOD1, 0 sin conectar.
• Pasada 5 (6458c5d, 21-oct, noche): C130 junto a U7.2 con su vía a GND, 2 vías en (168.0, 110.6) y C149/C150 a 1.0 mm de U25.2. Nuevo: igual que en la V5.6, la vía de entrada de RS1 quedó encima del hilo de sensado.
• Pasada 6, hecha por Claude (21-oct, noche): T36 hace lo mismo que T34 + T35 en la V5.6 y quita un tramo suelto de /24V; T37 pone la vía de GND de C129 a 0.18 mm del pad (B.Cu e In2 le abren lugar). DRC: 0 errores, 0 sin conectar, paridad solo PF*. Cobre listo para Gerber. C149/C150 se quedan: girarlos no baja el lazo a < 30 mm² y, con el plano de GND entero debajo, no cambia nada medible; se verifica en el banco (por qué).

	Documentos
Vigentes	▶ Auditoría del 21-oct, §3.2 · Pasada 4, parte B · Re-auditoría 19-oct, §4 · Auditoría de producción 16-oct (§5 rango de entrada) · ECO V5.7 — fuente a bordo (v0.2)
Históricos	Pasada 3, parte B (16-oct) — cerrada · Guía de layout V5.7 (Leo, 13-oct) y colocación y ruteo (14-oct) — superadas: la fuente ya está colocada · ECO v0.1 del 12-oct (03-Architecture-Hardware/2026-10-12_Drogheda_EinarBoard-V5.7_ECO-Fuente-a-bordo_ES_v0.1.md, repositorio)
Hereda de V5.6	Todo lo demás: ECO V5.6, cambios al esquemático, acelerómetro, sin P12. Hoja de datos y pinout propios: pendientes.
Decisiones pendientes (Leo)	D10 → SMBJ33CA (bidireccional, misma huella) para que la polaridad invertida no abra F2; puertos como en V5.6 (D-19-1); D-21-2: C149/C150 se quedan como están (auditoría §4).

Siguiente paso. Leo hace commit y push de T36 + T37 → B + DRC en KiCad → Gerber/BOM/CPL → 5 prototipos, pedidos junto con el piloto de V5.6 (validación de la ECO §6: barrido 9/12/24/32 V, polaridad invertida, temperatura de U25) → pedido de 327.

v6 — GNSS y 4G a bordo → pedido de 130 + reemplazos

Estado. Diseño nuevo: ZED-F9P y módem A7670SA soldados, sin zócalos; fuente de 5 V a bordo. Esquemático terminado y verificado el 28-sep (4 pasadas, ERC 0, d58a89ba…). El PCB se actualizó desde el esquemático el 16-oct (ff5a8ed) y Michelle terminó el ruteo ese mismo día (57e480d, 2612891): DRC con 0 errores y 0 sin conectar, paridad limpia.

Auditoría del 16-oct (tarde): NO LISTA — auditoría v6. Re-auditoría del 19-oct: sin cambio — el commit del sábado (00a9af4, Michelle) solo agregó 15 vías de tierra (§8). La lista L-1…L-67 del 28-sep sigue casi toda abierta. Bloqueantes:

• U25 trae todavía el código del AP64350 (40 V) → T28.
• No hay barrenos → T25 --set v6.
• El 5 V va 12 mm por In1 y 22 mm por In2 a 0.5 mm.
• Cargador: /SW_BAT y /BAT_PLUS de 0.5 mm; EP de U6 con 1 vía.
• U25 con L22 a 13 mm y sin vías en el EP.
• RF del módem 22 mm por In1.
• 96 vías de tierra (meta ≥ 400; eran 81 el 16-oct).
• Stackup genérico → T28.

El sensado de RS1 ya está bien (hay que conservarlo).

21-oct (9255b84, Michelle): adelantó el bloque A (L22 a 2.2 mm del pin SW de U25, 6 vías en su EP) y llevó /VEH5V de L22 a RS1 todo por F.Cu. Pero D34 quedó a 13 mm del pin SW: el lazo caliente pasó de ≈ 47 a ≈ 115 mm². T25 y T28 ya están aplicados: cierran los bloqueantes 1 y 8 y regresan los barrenos.

21-oct, noche (T38, Claude):

• Courtyards reales en las 11 huellas de easyeda2kicad: el DRC no veía encimes en U19, U20, U23–U26, D22, D27, J12, J13 ni L22. Salió uno real: C153 debajo del cuerpo de L22.
• /3V3 de MH6 por B.Cu, a 4.06 mm del centro.
• Regla nueva: en F.Cu y B.Cu, solo GND a menos de 4 mm del centro de un barreno. El plano /3V3 de B.Cu llegaba a 1.85 mm, desnudo bajo los separadores.

DRC: 52 errores, todos conocidos (MH4 28 · MH8 10 · courtyards 14), 0 sin conectar. Para el bloque A, D34 no cabe abajo del pin SW: la propuesta α pone D34 entre U25 y L22.

22-oct (T39, Claude; Leo: «haz tú los cambios de la v6, es la prioridad»):

• Bloque A con la propuesta α, por script:
  • D34 en (181.08, 121.75), girado 90°, con el cátodo a 3.52 mm del pin SW;
  • L22 en (192.18, 122.5), con L22.1 a 8.79 mm;
  • R53/R54 abajo de JP2;
  • nodo SW (9.8 mm² fuera de los pads) y /VEH5V (2 mm) en F.Cu;
  • lazo por centros de 56.5 mm² con C149 (antes ≈ 115).
• In1 e In2 sin pistas bajo la fuente: I²C y la toma de 5 V de R121 pasan a B.Cu.
• MH8 libre.

DRC: 44 errores (≈ 33 de MH4 y 11 encimes de courtyard de margen, que ya estaban), 0 sin conectar, paridad igual. Del bloque A quedan Rig1 y el /24V sin montar. Detalle: ▶ estado de la v6, rev. 1.3 (§6).

22-oct, tarde (T40, Claude): MH4 libre.

• D23 (TVS de /SIM_DATA) debajo de U19.31 y D24 (TVS de /SIM_CLK) junto a R129/R133; D25 no se mueve. Las tres tienen vía de GND propia.
• /SIM_CLK baja a In1; /SIM_RST pasa por F.Cu arriba de D25, a 4.2 mm del centro, hasta una vía nueva.
• /NTC (In2) ya no cruza el barreno: pasa a 0.95 mm de su orilla.
• Los pines 92 y 94 de U19 quedaban sin tierra: pista de GND y vía nueva.

DRC: 11 errores, los encimes de margen; ya no hay errores de barreno, de máscara ni de courtyard con barreno. 0 sin conectar, paridad igual. D-22-4 (Leo): las TVS siguen del lado del módem; Claude recomienda pasarlas a /SIMB_*, pegadas a J14 (L-38). Detalle: ▶ estado de la v6, rev. 1.3 (§7).

El firmware que sustituye al 4G NTRIP Master no existe. Decisión vigente: no habrá v6.1.

	Documentos
Vigentes	▶ Estado al 22-oct (T25, T28, T38, T39 y T40) · ▶ Auditoría de producción v6 (16-oct) · ▶ Plan de fines de semana (rev. 1.5: 24-oct → 22-nov) · Re-auditoría 19-oct, §8 · Plan de corrección y lista de liberación (28-sep, el porqué de cada punto) · Esquemático final — resumen de 3 pasadas · Mapa de pines MCU para board_v6.h · Plan de cobre y colocación EMC (inglés) · Manual v6 (marcador)
Detalle (28-sep)	Auditoría completa (inglés) · Pasada 1 — cambios al esquemático · Pasada 2 — puertos (inglés) · Pasada 3 — revisión final (inglés)
Históricos	Próximos pasos para ordenar (29-sep) — superado por el plan de fines de semana · Auditoría V5.6 · V5.7 · v6 del 16-oct (mañana), §8 · Revisión contra lecciones V5.5 — superada por la auditoría completa · Auditoría pre-fab 25-sep (inglés) — superada por la del 28-sep
Cantidad	La auditoría de septiembre hablaba de 5 prototipos; el plan del 13-oct son 130 unidades y todos los reemplazos futuros. Recomendado: piloto de 20 que pase el banco con el firmware 0.7.x antes de las 130.

Siguiente paso (plan de fines de semana, rev. 1.5; recorrido una semana el 19-oct):

• Lun 19 o mar 20: pre-órdenes en JLC (THVD1410DR, TPS7A2033PDBVR, J14). No se recorren.
• 21-oct: T25, T28 y T38 aplicados; Leo subió T38 el 22-oct (b74b96f).
• 22-oct: T39 (Claude): bloque A con la propuesta α y MH8 libre (d5f5002). En la tarde, T40: MH4 libre; falta el push. Leo decide D-22-4 (TVS de la SIM junto a J14).
• Sáb 24: Michelle revisa el bloque A y MH4 que dejaron T39 y T40, hace Rig1 y el /24V, las TVS junto a J14 si Leo elige (b) en D-22-4, y sigue con el bloque B (estado, §3).
• Dom 25: RF del módem, U20, GNSS y U12.
• Sáb 31 y dom 1-nov: pares, puertos, In1, vías de tierra (T29), serigrafía y DRC final. P7/P8 se quitan del esquemático (decisión del 9-oct).
• Lun 2-nov: pedido del piloto de 20.
• Fines de semana 7–8 y 14–15 nov: firmware v6. Banco del piloto el 21–22 nov (G2 ≈ 22-nov).

V4 y V3 — tarjetas anteriores aún en campo

Tarjeta	Estado	Documentos
V4	Blackpill en zócalo + Ethernet y puertos serie; mismas redes que la V5. En prueba con 0.6.0; casos sin NMEA en oct (H0016, H0011, H0024).	Manual V4 · Preparación y prueba con 0.6.0 · Riel SW_5V y arranque del F9P
V3	EinarBoard 1.0 (jul-2026, 10 pzas); 3 unidades en campo (RTK-003/006/014).	Manual V3 · Pinout V3 · históricos: BOM V3 · bring-up

Por necesidad

Necesito	Página
Saber si una tarjeta ya se puede pedir	Re-auditoría 19-oct · requisitos uno por uno: auditoría 16-oct
Saber qué tarjeta tengo	Manuales por tarjeta
Pin, puente o LED de V5.5/V5.6	Pinout V5.6 · Manual V5
Límites eléctricos, consumos, rieles	Hoja de datos V5.6 · rango de entrada de la V5.7: auditoría §5
Qué cambió de V5.5 a V5.6	ECO V5.6 · Cambios al esquemático
Qué debe corregir Michelle hoy	Pasada 4 — V5.6 y V5.7 · prioridades de la V5.6: qué es crítico
Qué hace el script T30	Re-auditoría §6 · comandos: pasada 4, §0
Dónde van los barrenos	Auditoría §3
Qué trae la V5.7 y por qué	ECO V5.7
Qué falta para pedir la v6	Auditoría v6 (16-oct) · Plan de corrección
Qué se hace cada fin de semana en la v6	Plan de fines de semana
Cuántas de cada versión y cuándo	Tablero de producción
El binario correcto	Descargas
KiCad o el repositorio	Guía Git
Cómo llegamos aquí	Historia del proyecto